ADC08D502
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SNOSC85 - 2012年8月
ADC08D502高性能，低功耗，双路，8位， 500 MSPS A / D转换器
检查样品：
ADC08D502
1
特点
内部采样和保持
单+ 1.9V ± 0.1V操作
SDR和DDR输出时钟的选择
多ADC同步功能
保证无失码
对扩展的控制串行接口
输入满量程微调和
OFFSET
占空比校正的采样时钟
2
应用
直接RF下变频
数字示波器
卫星机顶盒
通信系统
测试仪表
描述
该ADC08D502是一款双通道，低功耗，高性能CMOS模拟至数字转换器，数字化信号
以采样速率高达500 MSPS， 8位分辨率。从一个单一的消耗，在500 MSPS的典型1.4瓦
1.9伏电源，该设备是保证无失码在整个工作温度范围内。
独特的折叠和内插架构，完全差分比较器的设计，创新设计
内部采样和保持放大器和自校准方案使所有动态的一个非常平坦的响应
超出奈奎斯特参数，产生一个高7.5 ENOB具有250MHz的输入信号和500MHz的采样
同时提供了一个10速度
-18
B.E.R.输出格式为偏移二进制和LVDS数字输出兼容
符合IEEE 1596.3-1996 ，除0.8V和1.2V之间的可调节的共模电压。
每个转换器具有1： 2分离器馈送两组LVDS总线和减少了对各输出数据速率
总线到采样率的一半。
该转换器的典型功耗小于3.5毫瓦的省电模式，并且可以在一个128引脚，
耐热增强型裸露焊盘LQFP封装，工作在工业（ -40°C
≤
T
A
≤
+ 85 ° C）温度
范围内。
表1.主要规格
价值
决议
最大转换速率
误码率
ENOB @ 250 MHz输入
DNL
耗电量
操作
掉电
模式
1.4
3.5
W（典型值）
毫瓦（典型值）
8
500
10
-18
单位
位
MSPS （分钟）
（典型值）
比特（典型值）
LSB （典型值）
7.5
±0.15
1
2
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
所有商标均为其各自所有者的财产。
版权所有2012，德州仪器
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
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引脚配置
V
A
CalDly / SCS
CalRun
DId0+
DId0-
DId1+
DId1-
V
DR
NC
DR GND
DId2+
DId2-
DId3+
DId3-
DId4+
DId4-
DId5+
DId5-
V
DR
128
127
126
125
124
123
122
121
120
119
118
117
116
115
114
113
112
111
110
109
108
107
106
105
104
103
102
101
100
99
98
97
NC
DR GND
DId6+
DId6-
DId7+
DId7-
DI0+
DI0-
DI1+
DI1-
V
DR
NC
DR GND
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
DI2+
DI2-
DI3+
DI3-
DI4+
DI4-
DI5+
DI5-
V
DR
DR GND
DI6+
DI6-
DI7+
DI7-
DCLK +
DCLK-
或 -
OR +
DQ7-
DQ7+
DQ6-
DQ6+
DR GND
V
DR
DQ5-
DQ5+
DQ4-
DQ4+
DQ3-
DQ3+
DQ2-
DQ2+
GND
V
A
OUTV / SCLK
OutEdge / DDR / SDATA
V
A
GND
V
CMO
V
A
GND
V
IN
I-
V
IN
I+
GND
V
A
FSR / ECE
DCLK_RST
V
A
V
A
CLK +
CLK-
V
A
GND
V
IN
Q+
V
IN
Q-
GND
V
A
PD
GND
V
A
PDQ
CAL
V
BG
R
EXT
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
ADC08D502
*
*在包装背面的裸露焊盘必须焊接到接地平面，以确保达到额定性能。
引脚说明和等效电路
引脚功能
PIN号
符号
等效电路
V
A
V
A
Tdiode_P
Tdiode_N
DQd0+
DQd0-
DQd1+
DQd1-
V
DR
50k
3
OUTV / SCLK
GND
GND
DR GND
DQd2+
DQd2-
DQd3+
DQd3-
DQd4+
DQd4-
DQd5+
DQd5-
V
DR
NC
DR GND
DQd6+
DQd6-
DQd7+
DQd7-
DQ0+
DQ0-
DQ1+
DQ1-
V
DR
NC
DR GND
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
描述
输出电压幅值和串行接口的时钟。配合这个引脚
高正常差分DCLK和数据的幅度。该地
销的降低差分输出的幅度和减小的功率
消费。当启用扩展控制模式，该引脚
作为SCLK输入该钟表中的串行数据。
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3
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引脚功能
PIN号
符号
V
A
等效电路
描述
50k
200k
8 pF的
DDR
4
OutEdge / DDR /
SDATA
GND
50k
DCLK边沿选择，双倍数据速率开启和串行数据
输入。这个输入设置DCLK +的输出边缘，这时，输出
数据转换。当该引脚悬空或连接到1/2
电源电压，DDR时钟使能。当扩展
控制模式被激活时，此引脚用作SDATA输入。
SDATA
V
A
15
26
DCLK_RST
PD
V
A
DCLK复位。该引脚上的正脉冲用于复位和
同步多个转换器的DCLK出局。
掉电引脚。在PD引脚上的逻辑高电平使整个设备
进入掉电模式。
30
CAL
GND
校准周期启动。最低80输入时钟周期逻辑低电平
其次是最低的80输入时钟周期高点这个引脚
启动自校准序列。
V
A
50 k:
29
PDQ
在PDQ引脚上的逻辑高电平使只有"Q" ADC插入电源
掉电模式。
GND
V
A
50k
14
FSR / ECE
200k
50K 8 pF的
满量程范围选择和扩展控制使能。在非
扩展控制模式下，该引脚为逻辑低电平设置满量程
差分输入范围为650毫伏
P-P
。在这个引脚设置为逻辑高电平
满量程差分输入范围到870毫伏
P-P
。要启用
扩展控制模式，由此，串行接口和控制
寄存器采用，使该引脚悬空或连接到
电压等于V
A
/2.
GND
V
A
50k
127
CalDly / SCS
50k
延迟校准和串行接口芯片选择。与逻辑高
或低引脚14 ，此引脚用作校准延迟和套
时钟周期校准后通电前的数
开始。随着14脚悬空，此引脚用作使能引脚为
串行接口输入和CalDly值变为0B （短延时
用了很长电校准延迟概不提供） 。当此
脚悬空或连接到等于V的电压
A
/2,
GND
4
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