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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第35页 > AD9979BCPZ
14位CCD信号处理器
精确定时
CORE
AD9979
特点
1.8 V模拟和数字内核电源电压
相关双采样( CDS )用的-3 dB ,0分贝, 3分贝和
6分贝增益
6分贝到42分贝10位可变增益放大器器( VGA )
14位65 MHz的模拟 - 数字转换器
黑电平钳位变平控制
完整的片内时序发生器
精密Timing
核心拥有240 ps分辨率@ 65兆赫
片内3 V水平和RG驱动器
通用输出( GPO)的快门和系统
支持
7毫米×7毫米, 48引脚LFCSP封装
内部LDO稳压器电路
概述
该AD9979是一款高度集成的CCD信号处理器
高速数码摄像机应用。在指定像素
高达65兆赫的速率, AD9979包括一个完整的
与模拟 - 数字转换的模拟前端,结合
具有可编程定时驱动。该
精确定时
CORE
允许调整高速时钟,大约
240 ps的分辨率在65 MHz工作频率。
模拟前端包括黑色电平钳位, CDS,VGA
和一个65 MSPS,14位模拟 - 数字转换器(ADC ) 。该
时序驱动器提供高速CCD时钟驱动器的RG ,
HL和H1至H4 。操作使用3线编程
串行接口。
可在一个节省空间, 7毫米×7毫米, 48引脚LFCSP封装,
在AD9979中指定了的工作温度范围
-25 ° C至+ 85°C 。
应用
专业高清摄录一体机
专业/高端数码相机
广播级摄像机
工业高速摄像机
功能框图
REFT
REFB
AD9979
CCDINP
CDS
CCDINM
-3dB器,0dB , + 3dB时, + 6分贝
VGA
VREF
14 DOUT
ADC
6分贝TO 42分贝
D0到D13
LDOOUT
LDO
内部时钟
RG
HL
H1至H4
4
DRIVERS
精确
定时
CORE
CLI
SYNC
发电机
国内
注册
05957-001
GPO1 GPO2
HD
VD
SL
SCK
SDI
图1 。
版本C
信息ADI公司提供的被认为是准确和可靠。然而,没有
责任承担ADI公司供其使用,也为专利或其他任何侵权行为
第三方可能导致其使用的权利。规格如有变更,恕不另行通知。没有
获发牌照以暗示或其他方式ADI公司的任何专利或专利权。
商标和注册商标均为其各自所有者的财产。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781.329.4700
www.analog.com
传真: 781.461.3113 2007-2009 ADI公司保留所有权利。
AD9979
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
概述................................................ ......................... 1
功能框图............................................... ............... 1
修订历史................................................ ............................... 2
规格................................................. .................................... 3
时序规格................................................ .................. 4
数规格................................................ ................... 5
模拟技术指标................................................ ................... 6
绝对最大额定值............................................... ............. 7
热阻................................................ ...................... 7
ESD注意事项................................................ .................................. 7
引脚配置和功能说明............................. 8
典型性能特征........................................... 10
等效输入/输出电路............................................. ... 11
工作原理............................................... ....................... 12
可编程时序发生.............................................. 13
精确定时
高速计时芯............................. 13
卧式合模和冲裁......................................... 16
完整的现场结合H-模式............................... 23
模式寄存器................................................ ........................... 24
水平时序序列示例.................................... 26
通用输出( GPO ) ........................................... 27
GP查找表( LUT ) .......................................... .............. 30
模拟前端描述和操作...................... 31
应用信息................................................ .............. 35
推荐的上电顺序....................................... 35
待机模式操作............................................... ........... 37
CLI频率变化............................................... ............... 37
电路结构................................................ ................ 38
接地和去耦建议.................... 38
3线串行接口时序............................................ ......... 40
布局内寄存器.............................................. ........ 41
更新新的寄存器值的............................................. 42
完成注册上市............................................... .......... 43
外形尺寸................................................ ....................... 54
订购指南................................................ .......................... 54
修订历史
10月9日 - 修订版。 B到C版
更改时钟速率( CLI )参数,表1 ......................... 3
9月9日 - 修订版。 A到版本B
改变SCK下降沿到SDATA有效保持参数
SCK上升沿到SDATA保持............................................ ...... 4
更改单个HBLK模式第.......................... 18
6月9日 - 修订版。 SP0到版本A
更改表1 .............................................. .............................. 3
更改表2 .............................................. .............................. 4
更改表3 .............................................. .............................. 5
图2 ..............................................变化............................ 6
更改表5和热阻第................... 7
改变图3和表7 ........................................... ........... 8
图22 ..............................................变化........................ 16
新增GP_LINE_MODE名称,表16 ................................. 28
图42 ..............................................变化........................ 31
新增示例寄存器设置上电科.......... 36
更改附加的限制部分................................. 37
更改表22 , 3 V系统兼容性节,并
接地和去耦建议部分.......... 38
更改表33 .............................................. ......................... 51
更改表34 .............................................. ......................... 52
添加裸露焊盘的符号来外形尺寸........ 54
2/07 - SP0版本:最初的版本
版本C |页56 2
AD9979
特定网络阳离子
表1中。
参数
温度范围
操作
存储
电源电压
AVDD ( AFE ,计时芯)
RGVDD ( RG , HL驱动器)
HVDD ( H1至H4驱动程序)
DVDD (内置数字电源)
DRVDD (并行数据输出驱动器)
IOVDD ( I / O供电,无需使用LDO的)
电源电流, 65 MHz工作频率
AVDD ( 1.8 V )
RGVDD ( 3.3 V , 20 pF的RG负载, 20 pF的负载HL )
HVDD
1
( 3.3 V ,在H1至H4 200 pF的总负荷)
DVDD ( 1.8 V )
DRVDD ( 3.0 V)
IOVDD ( 1.8 V )
电源电流,待机工作模式
参考待机
共关闭
LDO
2
IOVDD ( I / O电源使用LDO时)
输出电压
输出电流
时钟速率( CLI )
1
25
65
1.6
2.7
2.7
1.6
1.6
1.6
典型值
最大
+85
+150
单位
°C
°C
V
V
V
V
V
V
mA
mA
mA
mA
mA
mA
mA
mA
1.8
3.3
3.3
1.8
3.0
1.8
48
8
40
13
4
2
10
0.5
2.0
3.6
3.6
2.0
3.6
3.6
2.5
1.8
60
8
3.0
1.85
3.6
1.9
65
V
V
mA
兆赫
的总功率由HVDD (或RGVDD )供应消散可通过以下公式来近似
总HVDD电源
= [C
负载
×
HVDD
×
像素频率]
×
HVDD
哪里
C
负载
是看到所有的H输出的总电容。
降低了电容性负载和/或降低HVDD供应减少功率耗散。
2
LDO可用于提供AVDD和DVDD只。
版本C |第56 3
AD9979
时序特定网络阳离子
C
L
= 20 pF的, AVDD = DVDD = 1.8 V,F
CLI
= 65兆赫,除非另有说明。
表2中。
参数
主时钟( CLI )
CLI时钟周期
CLI高/低电平脉冲宽度
从CLI延迟上升沿到内部
像素位置0
AFE
SHP上升沿SHD上升沿
AFE流水线延迟
CLPOB脉冲宽度(可编程)
1
高清脉冲宽度
VD脉冲宽度
串行接口
最大SCK频率
SL到SCK建立时间
SCK为SL保持时间
SDATA有效到SCK上升沿安装
SCK上升沿保持SDATA
H- COUNTER RESET规格
高清脉冲宽度
VD脉冲宽度
VD下降沿到HD下降沿
HD下降沿到CLI上升沿
CLI上升沿SHPLOC (内部
样品边)
计时芯上设置限制
抑制区域小水电边缘位置
2
(参见图19)
抑制区域小水电或与SHD
对于H-时钟(见图19 )
3, 4, 5, 6
重新定时= 0, MASK = 0
重新定时= 0, MASK = 1
重新定时= 1, MASK = 0
重新定时= 1, MASK = 1
禁止香港特别行政区DOUTPHASE边缘
位置(参见图19)
1
2
符号
t
CONV
t
ADC
t
CLIDLY
15.38
6.9
典型值
最大
单位
ns
ns
ns
评论
参见图15
7.7
5
8.9
t
S1
t
COB
6.9
2
t
CONV
1高清期
40
10
10
10
10
t
CONV
1高清期
0
3
3
7.7
16
20
8.5
ns
周期
像素
ns
ns
兆赫
ns
ns
ns
ns
见图19
见图20
见图56
f
SCLK
t
LS
t
LH
t
DS
t
DH
见图53
ns
ns
ns
ns
ns
t
VDHD
t
HDCLI
t
CLISHP
VD期 - 吨
CONV
t
CONV
2
t
CONV
2
t
SHPINH
50
64/0
边缘位置
t
SHDINH
t
SHDINH
t
SHPINH
t
SHPINH
t
DOUTINH
高× NEGLOC - 15
高× POSLOC - 15
高× NEGLOC - 15
高× POSLOC - 15
SHDLOC + 0
高× NEGLOC - 0
高× POSLOC - 0
高× NEGLOC - 0
高× POSLOC - 0
SHDLOC + 15
边缘位置
边缘位置
边缘位置
边缘位置
边缘位置
最小CLPOB脉冲宽度仅用于功能操作。更宽的典型脉冲建议达到良好的钳位性能。
仅适用于从模式工作。被抑制的区域的SHP是需要满足定时要求吨
CLISHP
进行适当的H计数器复位操作。
3
当0x34 [2:0 ] HxBLKRETIME位被使能,禁止区域SHD位置变更为SHP位置抑制区域。
4
当序列。寄存器0x09 [ 23:21 ] HBLK屏蔽寄存器被设置为0 ,则H-边缘基准为H × NEGLOC 。
5
具有SHP / SHD的H时钟信号抑制区域取决于HCLK模式:模式1 = H 1,模式2 = H 1 ,H 2,和模式3 = H1,H3 。
6
这些规范适用于在H1POL , H2POL , RGPOL和HLPOL都设置为1 (默认设置) 。
版本C |第56 4
AD9979
数码特定网络阳离子
IOVDD = 1.6 V至3.6 V , RGVDD = HVDD = 2.7 V至3.6 V ,C
L
= 20 pF的,T
给T
最大
中,除非另有说明。
表3中。
参数
逻辑输入
高电平输入电压
低电平输入电压
高电平输入电流
低电平输入电流
输入电容
逻辑输出
高电平输出电压
低电平输出电压
CLI的输入( CLI_BIAS = 0)
高电平输入电压
低电平输入电压
H-驱动器输出
高电平输出电压在最大电流
低电平输出电压最大电流
最大输出电流(可编程)
最大负载电容
符号
V
IH
V
IL
I
IH
I
IL
C
IN
V
OH
V
OL
V
IHCLI
V
ILCLI
V
OH
V
OL
IOVDD - 0.6
0.6
10
10
10
IOVDD - 0.5
0.5
IOVDD / 2 + 0.5
IOVDD / 2 - 0.5
HVDD - 0.5
0.5
30
100
典型值
最大
单位
V
V
μA
μA
pF
V
V
V
V
V
V
mA
pF
I
OH
= 2毫安
I
OL
= 2毫安
测试条件/
评论
版本C |第56个5
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