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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1698页 > AD9912ABCPZ-REEL7
1 GSPS直接数字
合成器, 14位DAC
AD9912
特点
1 GSPS内部时钟速度(高达400 MHz的直接输出)
集成的1 GSPS 14位DAC
与4 μHz的分辨率48位频率控制字
差分HSTL比较
灵活的系统时钟引脚可以接受晶振或外部
参考时钟
片上低噪声PLL REFCLK乘法器
2 SpurKiller渠道
低抖动时钟倍频器的频率高达750 MHz的
单端CMOS比较器;对<150 MHz的频率
可编程输出分频器的CMOS输出
串行I / O控制
出色的动力性能
软件控制断电
提供2个64引脚LFCSP封装
残余相位噪声@ 250 MHz的
10赫兹的偏移: -113 dBc的/赫兹
1 kHz偏置: -133 dBc的/赫兹
100 kHz偏置: -153 dBc的/赫兹
40 MHz偏移: -161 dBc的/赫兹
应用
雅居乐LO频率合成
低抖动,微调时钟发生器
测试和测量设备
无线基站和控制器
安全通信
快速跳频
概述
该AD9912是直接数字频率合成器( DDS ) ,具有
一个集成的14位数字 - 模拟转换器(DAC ) 。该
AD9912有48位频率调谐字( FTW )的
能合成频率的步长不超过4 μHz的大。
绝对频率精度可以通过调整来实现
DAC系统时钟。
该AD9912还集成了系统时钟相位
锁相环(PLL ),其允许对系统时钟输入为低
25兆赫。
在AD9912工作在工业温度范围内,
跨越-40 ° C至+ 85°C 。
基本框图
AD9912
DAC_OUT
S1至S4
启动
CON组fi guration
逻辑
直接
数字
合成
CORE
FDBK_IN
滤波器
数字
接口
串口,
I / O逻辑
时钟
产量
DRIVERS
OUT
OUT_CMOS
系统时钟
倍增器
06763-001
图1 。
牧师F
信息ADI公司提供的被认为是准确和可靠。然而,没有
责任承担ADI公司供其使用,也为专利或其他任何侵权行为
第三方可能导致其使用的权利。规格如有变更,恕不另行通知。没有
获发牌照以暗示或其他方式ADI公司的任何专利或专利权。
商标和注册商标均为其各自所有者的财产。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781.329.4700
www.analog.com
传真: 781.461.3113 2007-2010 ADI公司保留所有权利。
AD9912
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
概述................................................ ......................... 1
基本框图............................................... ......................... 1
修订历史................................................ ............................... 3
规格................................................. .................................... 4
直流规范................................................ ......................... 4
交流规范................................................ .......................... 6
绝对最大额定值............................................... ............. 8
热阻................................................ ...................... 8
ESD注意事项................................................ .................................. 8
引脚配置和功能说明............................. 9
典型性能特征........................................... 11
输入/输出端接建议.......................... 16
工作原理............................................... ....................... 17
概述................................................. ..................................... 17
直接数字频率合成器( DDS ) ............................................ 17
数字 - 模拟( DAC )输出......................................... ... 18
重建滤波器................................................ ................. 18
FDBK_IN输入................................................ ........................ 19
系统时钟输入................................................ ........................... 20
输出时钟驱动器和2 ×倍频............. 22
谐波杂散降低............................................... ......... 22
热性能................................................ .................... 24
上电............................................... .......................................... 25
上电复位.............................................. ............................ 25
上电默认输出频率................................ 25
供电分区............................................... .............. 26
3.3 V电源............................................... ............................... 26
1.8 V电源............................................... ............................... 26
串行控制端口............................................... .......................... 27
串行控制端口引脚说明....................................... 27
串行控制端口的操作............................................. 27
指令字( 16位) ........................................... ..... 28
MSB / LSB优先传输............................................. .............. 28
I / O寄存器映射............................................. ............................... 31
I / O寄存器说明............................................. ................. 33
串行端口配置(寄存器0x0000到
寄存器0×0005 ) .............................. .......................... 33
掉电和复位(寄存器0×0010到
注册0x0013 ) .............................. .......................... 33
系统时钟(寄存器为0x0020到寄存器0×0022 ) ............. 34
CMOS输出分频器( S-分频) (注册0100到
注册0x0106 ) .............................. .......................... 35
频率调谐字(注册0x01A0到
注册0x01AD ) .............................. ........................ 35
倍频器和输出驱动器(寄存器0x0200到
注册0x0201 ) .............................. .......................... 37
校准(用户可访问的修剪) (注册的0x0400到
注册0x0410 ) .............................. .......................... 37
谐波杂散抑制(寄存器0x0500到
注册0x0509 ) .............................. .......................... 37
外形尺寸................................................ ....................... 39
订购指南................................................ .......................... 39
修订版F |页40 2
AD9912
修订历史
6月10日 - 修订版。 E至版本F
的注册0x003更改的默认值设置为0x19符号(
表12)
.....31
5/10 -REV 。 D钮英文内容
删除的64引脚LFCSP封装( CP- 64-1 ) .................................通用
更改系统时钟使能PLL /
系统的最大输入速率
时钟的PFD ,表2中
............................................................................... 6
更新的外形尺寸............................................... ......... 39
更改订购指南.............................................. ............. 39
11月9日 - 修订版。 C到Rev. D的
添加了64引脚LFCSP ( CP- 64-7 ) ....................................通用
更改串行端口时序规范和
传播延迟参数............................................... 6 .........
添加裸露焊盘符号图2 ................................ 8
更改电源分区段........................... 25
切换到串行控制端口部分......................................... 26
图52 ..............................................变化........................ 28
添加裸露焊盘的符号来外形尺寸......... 38
更改订购指南.............................................. ............. 39
7月9日 - 修订版。 B到C版
更改逻辑输出参数,如表1 .............................. 3
更改为AVDD (引脚25 ,引脚26 ,引脚29和引脚30 ) ............ 25
6月9日 - 修订版。 A到版本B
图40的变化和直接数字频率合成器部分.. 17
图48 ..............................................变化........................ 22
更改表11 .............................................. .......................... 30
改变表22和表23 ........................................... ...... 34
1月8日 - 修订版。 0到版本A
更改表1 .............................................. .............................. 3
更改表2 .............................................. .............................. 5
更改表4 .............................................. .............................. 8
更改典型性能特征....................... 10
更改功能描述第................................ 19
更改为单端CMOS输出部分...................... 21
更改谐波杂散降低部件.......................... 21
更改电源分区段........................... 25
10月7日 - 修订版0 :初始版
修订版F |第40 3
AD9912
特定网络阳离子
DC特定网络阳离子
AVDD = 1.8V的±5%, AVDD3 = 3.3V ±5%, DVDD = 1.8 V±5% , DVDD_I / O = 3.3V ±5%, AVSS = 0V , DVSS = 0V时,除非另有说明。
表1中。
参数
电源电压
DVDD_I / O(引脚1 )
DVDD (引脚3 ,引脚5 ,引脚7 )
AVDD3 ( 14脚, 46脚, 47脚, 49脚)
AVDD3 (引脚37 )
AVDD (引脚11 ,引脚19 ,引脚23与引脚26 ,引脚29 ,
30针, 36针, 42针, 44针, 45针, 53针)
电源电流
I
AVDD3
(引脚37 )
I
AVDD3
(引脚46 ,引脚47 ,引脚49 )
I
AVDD
(引脚11 ,引脚19 ,引脚23与引脚26 ,引脚29 ,
30针, 36针, 42针, 44针, 45针)
I
AVDD
(引脚53 )
I
DVDD
( 3针, 5针, 7针)
I
DVDD_I / O
(引脚1 ,引脚14
1
)
逻辑输入(除了引脚32 )
输入高电压(V
IH
)
低输入电压(V
IL
)
输入电流(I
INH
, I
INL
)
最大输入容量(C
IN
)
CLKMODESEL (引脚32 )逻辑输入
输入高电压(V
IH
)
低输入电压(V
IL
)
输入电流(I
INH
, I
INL
)
最大输入容量(C
IN
)
逻辑输出
输出高电压(V
OH
)
输出低电压(V
OL
)
FDBK_IN输入
输入电容
输入阻抗
差分输入电压摆幅
2.0
DVSS
±60
3
1.4
AVSS
18
3
3.135
1.71
3.135
1.71
1.71
典型值
3.30
1.80
3.30
3.30
1.80
最大
3.465
1.89
3.465
3.465
1.89
单位
V
V
V
V
V
测试条件/评论
销37一般是3.3伏,但是可以被设置为1.8伏
8
26
113
9.6
31
136
mA
mA
mA
40
205
2
48
246
3
mA
mA
mA
又见总功耗
特定网络阳离子
CMOS输出驱动电压为3.3 V , 50兆赫,与
5 pF负载
DAC输出电流源,女
S
= 1 GSPS
总结模拟电源,用系统
时钟的PLL , HSTL输出驱动器,和S-除法
启用
DAC电源
数码芯( SpurKiller关闭)
数字I / O(动态变化)
9针, 10针, 54针, 55针, 58针到61针,
63脚, 64脚
DVDD_I / O
0.8
±200
V
V
μA
pF
V
V
μA
pF
在V
IN
= 0 V和V
IN
= DVDD_I / O
引脚32只
AVDD
0.4
50
在V
IN
= 0 V和V
IN
- AVDD
引脚62和以下的双向引脚:
9针, 10针, 54针, 55针, 63针
I
OH
= 1毫安
I
OL
= 1毫安
40针, 41针
迪FF erential
相当于每条腿112.5 mV的摆动;
必须是交流耦合
2.7
DVSS
3
22
DVDD_I / O
0.4
V
V
pF
mV的P-P
18
225
26
修订版F |第40 4
AD9912
参数
系统时钟输入
系统时钟PLL旁路
输入电容
输入阻抗
内部产生的直流偏置电压
2
差分输入电压摆幅
系统时钟PLL使能
输入电容
输入阻抗
内部产生的直流偏置电压
2
差分输入电压摆幅
晶体谐振器与系统时钟使能PLL
串联电阻
时钟输出驱动
HSTL输出驱动器
差分输出电压摆幅
共模输出电压
2
CMOS输出驱动器
输出电压高(V
OH
)
输出电压低(V
OL
)
输出电压高(V
OH
)
输出电压低(V
OL
)
总功耗
DDS只
典型值
最大
单位
测试条件/评论
系统时钟输入端应始终AC-
加上(包括单端和差分)
单端,每个引脚
迪FF erential
相当于每条腿316 mV的挥杆
单端,每个引脚
迪FF erential
相当于每条腿316 mV的挥杆
25兆赫, 3.2毫米×2.5毫米,切
2.4
0.93
632
1.5
2.6
1.17
2.9
1.38
pF
V
mV的P-P
pF
V
mV的P-P
Ω
2.4
0.93
632
3
2.6
1.17
2.9
1.38
9
100
1080
0.7
1280
0.88
1480
1.06
mV
V
输出驱动器的静态,见图27
输出摆幅与频率的关系
输出驱动器的静态的,参见图28和
图29为输出摆幅与频率的关系
I
OH
= 1毫安,引脚37 = 3.3 V
I
OL
= 1毫安,引脚37 = 3.3 V
I
OH
= 1毫安,引脚37 = 1.8 V
I
OL
= 1毫安,引脚37 = 1.8 V
上电默认情况下,除了系统时钟PLL逐
通过与CMOS驱动器关闭; SYSCLK = 1 GHz的;
HSTL驱动器关闭;刺激减少脱落; F
OUT
=
200兆赫
同为“仅DDS ”的情况下,除了这两个骨刺
关于减少渠道
同为“仅DDS ”的情况下,除了HSTL驱动器
启用
同为“仅DDS ”的情况下,除了CMOS
驱动器和S-分频器使能,并在3.3伏;
CMOS F
OUT
= 50兆赫(S-分频器= 4)的
同为“仅DDS ”的情况下,除非双方HSTL
而CMOS驱动器启用; S-分
启用和设置为4 ; CMOS F
OUT
= 50 MHz的
同为“仅DDS ”的情况下,除了25兆赫
SYCLK输入和PLL倍频= 40
无论使用哪种电源关闭,并启用
注册或PWRDOWN销
2.7
0.4
1.4
0.4
637
765
V
V
V
V
mW
DDS与减少带动
DDS与HSTL驱动程序启用
DDS与CMOS驱动器已启用
686
657
729
823
788
875
mW
mW
mW
DDS与HSTL和CMOS驱动器已启用
747
897
mW
DDS与系统时钟使能PLL
掉电模式
1
2
648
13
777
16
mW
mW
引脚14是AVDD3组中,但建议该引脚14连接到引脚1 。
AVSS = 0V。
修订版F |第40 5
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