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中频数字化子系统
AD9864*
特点
10 MHz至300 MHz的输入频率
6.8 kHz到270 kHz的输出信号带宽
7.5分贝SSB NF
-7.0 dBm的IIP3
AGC免费范围高达-34 dBm的
12分贝连续AGC范围
16分贝前端衰减器
基带I / Q 16位(或24位)串行数字输出
LO和采样时钟合成器
可编程抽取系数,输出格式,
AGC和合成仪的设置
370
输入阻抗
2.7 V至3.6 V电源电压
低电流消耗: 17毫安
48引脚LFCSP封装
产品概述
的AD9864是一个通用的IF子系统,数字化处理
低电平10兆赫至300兆赫的中频输入与信号带宽
从6.8 kHz到270 kHz的。的信号链
AD9864包括一个低噪声放大器(LNA) ,混频器,一个
带通Σ - Δ模拟到数字转换器(ADC ) ,以及一个决策
息过滤器具有可编程抽取系数。一个自动
MATIC增益控制( AGC )电路给出了AD9864 12分贝
连续增益调整。辅助模块包括
时钟和LO频率合成器。
的AD9864和固有antialias-的高动态范围
通过带通Σ - Δ转换器提供ING允许装置
对付阻塞信号高达95 dB小于所需的强
信号。此属性通常由reduc-降低无线电的成本
荷兰国际集团IF滤波要求。此外,它使多模式无线电
变化的信道带宽,从而允许IF滤波器的要
为最大的信道带宽指定。
该SPI端口程序AD9864的许多参数,
使器件对任何给定的应用进行优化。
可编程参数包括合成器的分频比,
AGC衰减和上升/下降时间,接收到的信号
强度水平,抽取系数,输出数据格式, 16分贝
衰减器,并且所选择的偏压电流。
该AD9864是采用48引脚LFCSP封装,
采用单2.7 V至3.6 V电源。的总功率
消费一般是56毫瓦和掉电模式
通过串行接口提供。
应用
多模窄带无线产品
模拟/数字UHF / VHF FDMA接收机
TETRA , APCO25 , GSM / EDGE
便携式和移动无线产品
卫星通信终端
*受美国专利号5969657 ;其他专利正在申请中。
功能框图
MXOP MXON IF2P IF2N
GCP GCN
DAC
–16dB
AGC
AD9864
IFIN
LNA
∑-
ADC
抽取
滤波器
格式化/ SSI
DOUTA
DOUTB
FS
FREF
控制逻辑
CLKOUT
LO
SYN
CLK SYN
电压
参考
SPI
IOUTL
LOP LON
LO和VCO
环路滤波器
IOUTC
CLKP
CLKN
VREFP VCM VREFN
PC
PD
PE
SYNCB
04319-0-001
环路滤波器
图1. AD9864框图
第0版
信息ADI公司提供的被认为是准确和可靠。
但是,没有责任承担由Analog Devices供其使用,也不对任何
侵犯第三方专利或其他权利,可能导致其使用的。
规格如有变更,恕不另行通知。没有获发牌照以暗示
或者以其他方式在ADI公司的任何专利或专利权。商标
注册商标是其各自公司的财产。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781.329.4700
www.analog.com
传真: 781.326.8703
2003 ADI公司保留所有权利。
AD9864
目录
概述................................................ ......................... 3
AD9864规格................................................ ..................... 4
数规格................................................ ........................ 6
绝对最大额定值............................................... ............. 7
热阻................................................ ...................... 7
引脚配置和功能说明.......................... 8
规格定义/测试方法............................... 9
典型性能特征........................................... 10
串行外设接口(SPI ) ............................................ ... 15
工作原理............................................... ....................... 17
串行端口接口( SPI ) ............................................ .............. 17
同步串行接口( SSI ) ........................................... 18
同步化使用SYNCB ............................................... ... 22
连接至DSP ............................................... ...................... 22
功率控制................................................ ............................. 23
LO频率合成................................................ ............................ 23
快速获取方式............................................... ....................... 24
时钟合成器................................................ ....................... 24
如果LNA /混频器.............................................. ............................... 26
带通Σ -Δ型ADC ........................................... ....................... 27
抽取滤波器................................................ ....................... 29
可变增益放大器,具有自动增益
控制................................................. ........................................ 30
可变增益控制............................................... ................. 31
自动增益控制( AGC ) ............................................ ... 32
系统的噪声系数( NF )与VGA (或AGC )控制.. 34
申请注意事项................................................ ..... 35
杂散响应................................................ .................... 37
外部无源组件要求.......................... 37
应用................................................. ............................... 38
布局示例,评估板和软件................. 42
外形尺寸................................................ ....................... 43
ESD注意事项................................................ ................................ 43
订购指南................................................ .......................... 43
修订历史
修订版0 :初始版
第0版|第44 2
AD9864
概述
的AD9864是一个通用的窄带IF子系统
数字化水平低10兆赫至300兆赫的中频输入同一个信号
带宽从6.8 kHz到270 kHz的。的信号链
的AD9864包括一个低噪声放大器的,混频器,带通Σ - Δ模数转换器,
和抽取滤波器具有可编程抽取系数。
该输入LNA是具有一个输入阻抗的固定增益块
大约370 Ω|| 1.4 pF的。 LNA的输入是单端
和自偏压,允许将输入的IF为交流耦合。该
LNA可通过串行接口被禁用,从而提供一个
固定16分贝衰减输入信号。
在LNA驱动一个吉尔伯特型有源混频器的输入端口。
该混频器LO端口的片内LO缓冲器,驱动它
可以由外部驱动,单端或差分。本振
缓冲输入是自偏置,并允许LO输入为
交流耦合。混频器的集电极开路输出驱动
外部谐振回路组成的差分LC网络
调谐带通Σ - Δ ADC的中频。
外部差分LC槽形成的谐振器的
带通Σ - Δ ADC的第一阶段。该坦克LC值必须
被选择用于的中心频率
f
CLK
/ 8,其中
f
CLK
ADC的采样速率。该
f
CLK
/ 8频率为中频数字化
通过带通Σ - Δ模数转换器。片内校准允许标
准公差电感和电容值。校准
通常进行一次上电时。
ADC包括一个六阶多位带通Σ- Δ调制
荡器,可实现非常高的瞬时动态范围
一个窄频带中心在
f
CLK
/ 8 。调制器
输出正交混合到基带,并过滤由三个
级联线性相位FIR滤波器以移除带外噪声。
第一FIR滤波器是由12采用四阶固定的抽取
梳状滤波器。第二FIR滤波器还采用了四阶梳
具有可编程抽取滤波器,从1到16的第三
的FIR级可编程为4或5的抽取
级联抽取因子的可编程范围为48 960 。
抽取滤波器数据是通过同步串行输出
该芯片的接口(SSI) 。
内置于AD9864的附加功能包括LO和
时钟合成器,可编程增益控制,以及灵活的同步的
理性的串行接口来输出数据。
本振合成器是一个可编程的PLL由低
噪声的相位频率检测器(PFD ) ,一个可变输出电流
电荷泵( CP ) , 14位参考分频器, A和B计数器,
与双模预分频器。用户仅需要增加一个
适当的环路滤波器和VCO的完整操作。
时钟合成相当于LO合成与
以下区别:
它不包括预分频器或计数器。
它包括一个用于压控振荡器的负电阻芯
一代。
的AD9864包含一个可变增益放大器(VGA)和一个
数字VGA ( DVGA ) 。这两个可手动操作或
自动。在手动模式下,对于每个增益进行编程
通过SPI 。在自动增益控制模式下,收益是
自动调节,以保证ADC不夹和
ADC的均方根输出电平等于一个可编程REF-
erence水平。
在VGA具有衰减范围的12 dB和由实施
调整ADC满量程的参考电平。该DVGA增益
通过按比例抽取滤波器的输出来实现。该
DVGA在狭隘延伸的动态范围是最有用
行频段应用要求的16位I和Q数据的格式。
投机提供了一个可编程的框架结构,使
24位或16位的I和Q数据和灵活性通过包括
衰减和RSSI数据(如果需要) 。
第0版|第44 3
AD9864
AD9864规格
表1. VDDI = VDDF = VDDA = VDDC = VDDL = VDDH = 2.7 V至3.6 V , VDDQ = VDDP = 2.7 V至5.5 V,F
CLK
= 18 MSPS ,
f
IF
= 109.65兆赫,女
LO
= 107.4兆赫,女
REF
= 16.8兆赫,除非另有说明。标准工作模式: VGA最小衰减
设置,在正常(未快速获取)模式,抽取因子= 900 , 16位的数字输出,并在SSI输出引脚10 pF负载合成器。
参数
系统的动态性能
1
SSB噪声系数@最小VGA衰减
2, 3
@最大VGA衰减
2,3
动态范围AGC启用
2,3
IF输入剪辑点@最大VGA衰减
3
@最小VGA衰减
3
输入三阶截取( IIP3 )
增益随温度变化
LNA +混频器
最大RF和LO频率范围
LNA的输入阻抗
混频器LO输入电阻
LO合成
LO输入频率
LO输入幅度
FREF频率(正弦输入ONLY)
FREF输入幅度
FREF摆率
最小电荷泵电流@ 5 V
4
最大电荷泵电流@ 5 V
4
电荷泵输出符合
5
合成器解决方案
时钟合成器
CLK输入频率
CLK输入幅度
最小电荷泵输出电流
4
最大电荷泵输出电流
4
电荷泵输出符合
5
合成器解决方案
Σ -Δ型ADC
决议
时钟频率(f
CLK
)
中心频率
通带增益变化
别名衰减
增益控制
可编程增益步
AGC增益范围
GCP输出电阻
温度
25°C
25°C
考试级别
IV
IV
IV
IV
IV
IV
IV
IV
V
V
IV
IV
IV
IV
IV
VI
VI
VI
IV
IV
IV
VI
VI
VI
VI
IV
IV
V
IV
IV
V
V
IV
典型值
7.5
13
95
–19
–31
–7.0
0.7
500
370||1.4
1
300
2.0
25
3
0.67
5.3
0.4
6.25
13
0.3
0.67
5.3
0.4
2.2
16
13
f
CLK
/8
1.0
80
16
12
72.5
VDDQ - 0.4
VDDP - 0.4
最大
9.5
单位
dB
dB
dB
DBM
DBM
DBM
dB
兆赫
Ω|| pF的
k
兆赫
V P-P
兆赫
V P-P
V / μs的
mA
mA
V
千赫
兆赫
V P-P
mA
mA
V
千赫
兆赫
兆赫
dB
dB
dB
dB
k
91
–20
–32
–12
2
300
7.75
0.3
8
0.3
7.5
26
VDDC
24
26
50
95
1
2
这包括0.9分贝损失匹配网络。
AGC与DVGA启用。
3
测量10 kHz的带宽。
4
可编程0.67毫安步骤。
5
电压范围在LO (或CLK )电荷泵的输出电流范围内保持对VDDP / 2 (或VDDQ / 2 )的标称值的5% 。
第0版|第44 4
AD9864
参数
整体
模拟电源电压( VDDA , VDDF , VDDI )
数字电源电压( VDDD , VDDC , VDDL )
接口电源电压( VDDH )
1
电荷泵电源电压( VDDP , VDDQ )
总电流
操作模式
2
待机
工作温度范围
温度
考试级别
VI
VI
VI
VI
VI
VI
–40
2.7
2.7
1.8
2.7
典型值
3.0
3.0
5.0
17
0.01
+85
最大
3.6
3.6
3.6
5.5
单位
V
V
V
V
mA
mA
°C
1
2
VDDH必须小于VDDD + 0.5V。
时钟VCO关和附加0.7毫安与VGA @最大衰减。
第0版|第44 5
中频数字化子系统
AD9864*
特点
10 MHz至300 MHz的输入频率
6.8 kHz到270 kHz的输出信号带宽
7.5分贝SSB NF
-7.0 dBm的IIP3
AGC免费范围高达-34 dBm的
12分贝连续AGC范围
16分贝前端衰减器
基带I / Q 16位(或24位)串行数字输出
LO和采样时钟合成器
可编程抽取系数,输出格式,
AGC和合成仪的设置
370
输入阻抗
2.7 V至3.6 V电源电压
低电流消耗: 17毫安
48引脚LFCSP封装
产品概述
的AD9864是一个通用的IF子系统,数字化处理
低电平10兆赫至300兆赫的中频输入与信号带宽
从6.8 kHz到270 kHz的。的信号链
AD9864包括一个低噪声放大器(LNA) ,混频器,一个
带通Σ - Δ模拟到数字转换器(ADC ) ,以及一个决策
息过滤器具有可编程抽取系数。一个自动
MATIC增益控制( AGC )电路给出了AD9864 12分贝
连续增益调整。辅助模块包括
时钟和LO频率合成器。
的AD9864和固有antialias-的高动态范围
通过带通Σ - Δ转换器提供ING允许装置
对付阻塞信号高达95 dB小于所需的强
信号。此属性通常由reduc-降低无线电的成本
荷兰国际集团IF滤波要求。此外,它使多模式无线电
变化的信道带宽,从而允许IF滤波器的要
为最大的信道带宽指定。
该SPI端口程序AD9864的许多参数,
使器件对任何给定的应用进行优化。
可编程参数包括合成器的分频比,
AGC衰减和上升/下降时间,接收到的信号
强度水平,抽取系数,输出数据格式, 16分贝
衰减器,并且所选择的偏压电流。
该AD9864是采用48引脚LFCSP封装,
采用单2.7 V至3.6 V电源。的总功率
消费一般是56毫瓦和掉电模式
通过串行接口提供。
应用
多模窄带无线产品
模拟/数字UHF / VHF FDMA接收机
TETRA , APCO25 , GSM / EDGE
便携式和移动无线产品
卫星通信终端
*受美国专利号5969657 ;其他专利正在申请中。
功能框图
MXOP MXON IF2P IF2N
GCP GCN
DAC
–16dB
AGC
AD9864
IFIN
LNA
∑-
ADC
抽取
滤波器
格式化/ SSI
DOUTA
DOUTB
FS
FREF
控制逻辑
CLKOUT
LO
SYN
CLK SYN
电压
参考
SPI
IOUTL
LOP LON
LO和VCO
环路滤波器
IOUTC
CLKP
CLKN
VREFP VCM VREFN
PC
PD
PE
SYNCB
04319-0-001
环路滤波器
图1. AD9864框图
第0版
信息ADI公司提供的被认为是准确和可靠。
但是,没有责任承担由Analog Devices供其使用,也不对任何
侵犯第三方专利或其他权利,可能导致其使用的。
规格如有变更,恕不另行通知。没有获发牌照以暗示
或者以其他方式在ADI公司的任何专利或专利权。商标
注册商标是其各自公司的财产。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781.329.4700
www.analog.com
传真: 781.326.8703
2003 ADI公司保留所有权利。
AD9864
目录
概述................................................ ......................... 3
AD9864规格................................................ ..................... 4
数规格................................................ ........................ 6
绝对最大额定值............................................... ............. 7
热阻................................................ ...................... 7
引脚配置和功能说明.......................... 8
规格定义/测试方法............................... 9
典型性能特征........................................... 10
串行外设接口(SPI ) ............................................ ... 15
工作原理............................................... ....................... 17
串行端口接口( SPI ) ............................................ .............. 17
同步串行接口( SSI ) ........................................... 18
同步化使用SYNCB ............................................... ... 22
连接至DSP ............................................... ...................... 22
功率控制................................................ ............................. 23
LO频率合成................................................ ............................ 23
快速获取方式............................................... ....................... 24
时钟合成器................................................ ....................... 24
如果LNA /混频器.............................................. ............................... 26
带通Σ -Δ型ADC ........................................... ....................... 27
抽取滤波器................................................ ....................... 29
可变增益放大器,具有自动增益
控制................................................. ........................................ 30
可变增益控制............................................... ................. 31
自动增益控制( AGC ) ............................................ ... 32
系统的噪声系数( NF )与VGA (或AGC )控制.. 34
申请注意事项................................................ ..... 35
杂散响应................................................ .................... 37
外部无源组件要求.......................... 37
应用................................................. ............................... 38
布局示例,评估板和软件................. 42
外形尺寸................................................ ....................... 43
ESD注意事项................................................ ................................ 43
订购指南................................................ .......................... 43
修订历史
修订版0 :初始版
第0版|第44 2
AD9864
概述
的AD9864是一个通用的窄带IF子系统
数字化水平低10兆赫至300兆赫的中频输入同一个信号
带宽从6.8 kHz到270 kHz的。的信号链
的AD9864包括一个低噪声放大器的,混频器,带通Σ - Δ模数转换器,
和抽取滤波器具有可编程抽取系数。
该输入LNA是具有一个输入阻抗的固定增益块
大约370 Ω|| 1.4 pF的。 LNA的输入是单端
和自偏压,允许将输入的IF为交流耦合。该
LNA可通过串行接口被禁用,从而提供一个
固定16分贝衰减输入信号。
在LNA驱动一个吉尔伯特型有源混频器的输入端口。
该混频器LO端口的片内LO缓冲器,驱动它
可以由外部驱动,单端或差分。本振
缓冲输入是自偏置,并允许LO输入为
交流耦合。混频器的集电极开路输出驱动
外部谐振回路组成的差分LC网络
调谐带通Σ - Δ ADC的中频。
外部差分LC槽形成的谐振器的
带通Σ - Δ ADC的第一阶段。该坦克LC值必须
被选择用于的中心频率
f
CLK
/ 8,其中
f
CLK
ADC的采样速率。该
f
CLK
/ 8频率为中频数字化
通过带通Σ - Δ模数转换器。片内校准允许标
准公差电感和电容值。校准
通常进行一次上电时。
ADC包括一个六阶多位带通Σ- Δ调制
荡器,可实现非常高的瞬时动态范围
一个窄频带中心在
f
CLK
/ 8 。调制器
输出正交混合到基带,并过滤由三个
级联线性相位FIR滤波器以移除带外噪声。
第一FIR滤波器是由12采用四阶固定的抽取
梳状滤波器。第二FIR滤波器还采用了四阶梳
具有可编程抽取滤波器,从1到16的第三
的FIR级可编程为4或5的抽取
级联抽取因子的可编程范围为48 960 。
抽取滤波器数据是通过同步串行输出
该芯片的接口(SSI) 。
内置于AD9864的附加功能包括LO和
时钟合成器,可编程增益控制,以及灵活的同步的
理性的串行接口来输出数据。
本振合成器是一个可编程的PLL由低
噪声的相位频率检测器(PFD ) ,一个可变输出电流
电荷泵( CP ) , 14位参考分频器, A和B计数器,
与双模预分频器。用户仅需要增加一个
适当的环路滤波器和VCO的完整操作。
时钟合成相当于LO合成与
以下区别:
它不包括预分频器或计数器。
它包括一个用于压控振荡器的负电阻芯
一代。
的AD9864包含一个可变增益放大器(VGA)和一个
数字VGA ( DVGA ) 。这两个可手动操作或
自动。在手动模式下,对于每个增益进行编程
通过SPI 。在自动增益控制模式下,收益是
自动调节,以保证ADC不夹和
ADC的均方根输出电平等于一个可编程REF-
erence水平。
在VGA具有衰减范围的12 dB和由实施
调整ADC满量程的参考电平。该DVGA增益
通过按比例抽取滤波器的输出来实现。该
DVGA在狭隘延伸的动态范围是最有用
行频段应用要求的16位I和Q数据的格式。
投机提供了一个可编程的框架结构,使
24位或16位的I和Q数据和灵活性通过包括
衰减和RSSI数据(如果需要) 。
第0版|第44 3
AD9864
AD9864规格
表1. VDDI = VDDF = VDDA = VDDC = VDDL = VDDH = 2.7 V至3.6 V , VDDQ = VDDP = 2.7 V至5.5 V,F
CLK
= 18 MSPS ,
f
IF
= 109.65兆赫,女
LO
= 107.4兆赫,女
REF
= 16.8兆赫,除非另有说明。标准工作模式: VGA最小衰减
设置,在正常(未快速获取)模式,抽取因子= 900 , 16位的数字输出,并在SSI输出引脚10 pF负载合成器。
参数
系统的动态性能
1
SSB噪声系数@最小VGA衰减
2, 3
@最大VGA衰减
2,3
动态范围AGC启用
2,3
IF输入剪辑点@最大VGA衰减
3
@最小VGA衰减
3
输入三阶截取( IIP3 )
增益随温度变化
LNA +混频器
最大RF和LO频率范围
LNA的输入阻抗
混频器LO输入电阻
LO合成
LO输入频率
LO输入幅度
FREF频率(正弦输入ONLY)
FREF输入幅度
FREF摆率
最小电荷泵电流@ 5 V
4
最大电荷泵电流@ 5 V
4
电荷泵输出符合
5
合成器解决方案
时钟合成器
CLK输入频率
CLK输入幅度
最小电荷泵输出电流
4
最大电荷泵输出电流
4
电荷泵输出符合
5
合成器解决方案
Σ -Δ型ADC
决议
时钟频率(f
CLK
)
中心频率
通带增益变化
别名衰减
增益控制
可编程增益步
AGC增益范围
GCP输出电阻
温度
25°C
25°C
考试级别
IV
IV
IV
IV
IV
IV
IV
IV
V
V
IV
IV
IV
IV
IV
VI
VI
VI
IV
IV
IV
VI
VI
VI
VI
IV
IV
V
IV
IV
V
V
IV
典型值
7.5
13
95
–19
–31
–7.0
0.7
500
370||1.4
1
300
2.0
25
3
0.67
5.3
0.4
6.25
13
0.3
0.67
5.3
0.4
2.2
16
13
f
CLK
/8
1.0
80
16
12
72.5
VDDQ - 0.4
VDDP - 0.4
最大
9.5
单位
dB
dB
dB
DBM
DBM
DBM
dB
兆赫
Ω|| pF的
k
兆赫
V P-P
兆赫
V P-P
V / μs的
mA
mA
V
千赫
兆赫
V P-P
mA
mA
V
千赫
兆赫
兆赫
dB
dB
dB
dB
k
91
–20
–32
–12
2
300
7.75
0.3
8
0.3
7.5
26
VDDC
24
26
50
95
1
2
这包括0.9分贝损失匹配网络。
AGC与DVGA启用。
3
测量10 kHz的带宽。
4
可编程0.67毫安步骤。
5
电压范围在LO (或CLK )电荷泵的输出电流范围内保持对VDDP / 2 (或VDDQ / 2 )的标称值的5% 。
第0版|第44 4
AD9864
参数
整体
模拟电源电压( VDDA , VDDF , VDDI )
数字电源电压( VDDD , VDDC , VDDL )
接口电源电压( VDDH )
1
电荷泵电源电压( VDDP , VDDQ )
总电流
操作模式
2
待机
工作温度范围
温度
考试级别
VI
VI
VI
VI
VI
VI
–40
2.7
2.7
1.8
2.7
典型值
3.0
3.0
5.0
17
0.01
+85
最大
3.6
3.6
3.6
5.5
单位
V
V
V
V
mA
mA
°C
1
2
VDDH必须小于VDDD + 0.5V。
时钟VCO关和附加0.7毫安与VGA @最大衰减。
第0版|第44 5
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