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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1238页 > AD9861BCPRL-80
混合信号前端(的MxFE
)基带
收发器,用于宽带应用
AD9861
特点
接收路径包括双通道10位模拟至数字
与内部或外部参考转换器, 50 MSPS
和80 MSPS版本
发射路径包括双通道10位, 200 MSPS数字 -
模拟转换器, 1 × , 2 × ,或4 ×插值
可编程增益控制
内部时钟分配模块包括一个可编程
锁相环和定时发生电路,
允许单基准时钟的操作
20引脚灵活的I / O数据接口允许各种交错
或者在半双工模式下非交叉存取的数据传输和
在全双工模式下交错数据传输
通过配置寄存器编程或
通过模式引脚可选可编程的限制
独立Rx和Tx电源关闭控制引脚
64引脚LFCSP封装( 9毫米×9 mm占位面积的)
3配置的辅助变流器的引脚
VIN + A
ADC
VIN -A
VIN + B
ADC
VIN -B
I / O
接口
CON组fi guration
数据
MUX
LATCH
RX数据
功能框图
I / O
接口
控制
灵活的
I / O总线
[0:19]
LOW- PASS
滤波器
IOUT + A
DAC
IOUT -A
IOUT + B
DAC
IOUT -B
数据
LATCH
解复用
Tx数据
AUX
ADC
AUX
DAC
ADC时钟
AUX
DAC
DAC时钟
AUX
ADC
PLL
CLKIN
应用
宽带接入
宽带网络
通信(调制解调器)
AD9861
AUX
DAC
03606-0-001
图1 。
概述
该AD9861是MxFE系列,一组中的一员
集成转换器的通信市场。该
AD9861集成了双通道10位模拟 - 数字转换器
器(ADC)和双10位的数字 - 模拟转换器( TxDAC ) 。
两个速度等级可供选择, -50和-80 。 -50进行了优
而得到优化的50 MSPS和更少的ADC采样,而-80是
50 MSPS和80 MSPS之间的ADC采样速率进行了优化。
双TxDACs的速度运行在高达200 MHz和
包括一个可旁路的2倍或4倍内插滤波器。三
辅助变流器也可以提供所需的
系统级控制电压或监视系统的信号。该
AD9861是高性能,低功耗,小优化
形成因子,并提供了一种具有成本效益的解决方案
宽带通信市场。
的AD9861使用单一输入时钟引脚( CLKIN) ,以产生
所有的系统时钟。产生ADC和TxDAC系列时钟
定时生成模块,它提供用户可编程内
均衡器选项,如鸿沟电路, PLL乘法器和开关。
灵活的双向20位I / O总线容纳各种
第0版
信息ADI公司提供的被认为是准确和可靠。
但是,没有责任承担由Analog Devices供其使用,也不对任何
侵犯第三方专利或其他权利,可能导致其使用的。
规格如有变更,恕不另行通知。没有获发牌照以暗示
或者以其他方式在ADI公司的任何专利或专利权。商标
注册商标均为其各自所有者的财产。
定制的数字后端或开放市场的DSP 。
在半双工系统中,接口支持20位并行
传输或10-bit交错传输。在全双工系统,
接口支持交错的10位ADC总线和一个
交错的10位TxDAC系列总线。灵活的I / O总线减少了引脚
算,因此,减小了所需的封装尺寸上的
AD9861与它连接的设备。
在AD9861可以使用任一模式引脚或串行编程
梅布尔接口( SPI )配置接口总线,操作
ADC在低功率模式下,配置的TxDAC插
率,并控制ADC和通道TxDAC掉电。在SPI
提供多个可编程选项都的TxDAC路径
(例如,粗略和精细增益控制和偏移控制
信道匹配)和ADC路径(例如,内部
占空比稳定器和二进制补码数据格式) 。
AD9861的封装在一个64引脚LFCSP封装(薄型,细
高亢,芯片级封装) 。 64引脚LFCSP封装足迹
仅9毫米×9毫米,小于0.9毫米高,装配到
紧密间隔开的应用,如PCMCIA卡
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781.329.4700
www.analog.com
传真: 781.326.8703
2003 ADI公司保留所有权利。
AD9861
目录
Tx通道规格............................................... ....................... 3
Rx通道规格............................................... ....................... 4
电源规格................................................ ......................... 5
数规格................................................ ........................ 5
时序规格................................................ ....................... 6
绝对最大额定值............................................... ............. 7
ESD注意事项................................................ .................................. 7
引脚配置和引脚功能描述...................... 8
典型性能特征........................................... 10
术语................................................. ................................... 21
工作原理............................................... ....................... 22
系统结构................................................ ............................... 22
接收路径座............................................... ............................... 22
发射路径座............................................... ............................... 24
辅助变流器................................................ .................. 27
数字模块................................................ ................................ 30
可编程寄存器................................................ ............ 42
时钟分配块............................................... ........... 45
外形尺寸................................................ ....................... 49
订购指南................................................ .......................... 50
修订历史
修订版0 :初始版
第0版|第52 2
AD9861
TX路径规范
表1. AD9861-50和AD9861-80
F
DAC
= 200 MSPS ; 4 ×插值;
SET
= 4.02 kΩ的; 100 Ω差分负载电阻
1
; TxPGA = 20 dB时, AVDD = DVDD = 3.3 V ,
除非另有说明
参数
发射路径一般
决议
最大DAC更新速率
最大满量程输出电流
满量程误差
增益失配误差
偏移量不匹配错误
参考电压
输出电容
相位噪声( 1 kHz偏置, 6兆赫音)
输出电压范围符合
TxPGA增益范围
TxPGA步长
Tx通道动态性能
(I
OUTFS
能力= 20 mA ; F
OUT
= 1兆赫)
SNR
SINAD
THD
SFDR ,宽带( DC至奈奎斯特频率)
SFDR ,窄带( 1 MHz的窗口)
1
温度
25°C
25°C
考试级别
IV
IV
IV
V
IV
IV
V
V
V
IV
V
V
典型值
10
最大
单位
兆赫
mA
200
20
1%
–3.5
–0.1
1.23
5
–115
–1.0
20
0.10
+1.0
+3.5
+0.1
% FS
% FS
V
pF
dBc的/赫兹
V
dB
dB
IV
IV
IV
IV
IV
60.2
59.7
64.6
72.5
60.8
60.7
77.5
76.0
81.0
65.8
dB
dB
dBc的
dBc的
dBc的
参见图2为TxDAC系列端接方案的说明。
TxDAC系列
50
50
03606-0-030
100 Ω差分图2示出终止
负载部分的TxDAC测量
第0版|第52 3
AD9861
接收路径规范
表2. AD9861-50和AD9861-80
F
ADC
= 50 MSPS的AD9861-50 , 80 MSPS的AD9861-80 ;内部参考;差分模拟输入,
ADC_AVDD = DVDD = 3.3V,除非另有说明
参数
接收路径一般
决议
最大的ADC采样率
增益失配误差
偏移量不匹配错误
参考电压
参考电压( REFT , REFB )错误
输入电阻(差分)
输入电容
输入带宽
差分模拟输入电压范围
Rx通道DC精度
积分非线性( INL )
微分非线性( DNL )
通光孔径延迟
通光孔径不确定度(抖动)
输入参考噪声
AD9861-50 Rx通道动态性能
(V
IN
= -0.5 dBFS的; F
IN
= 10兆赫)
SNR
SINAD
SINAD
总谐波失真(第二至第九谐波)
SFDR ,宽带( DC至奈奎斯特频率)
ADC输入端之间的串音
AD9861-80 Rx通道动态性能
(V
IN
= -0.5 dBFS的; F
IN
= 10兆赫)
SNR
SINAD
总谐波失真(第二至第九谐波)
SFDR ,宽带( DC至奈奎斯特频率)
ADC输入端之间的串音
温度
25°C
25°C
25°C
25°C
25°C
考试级别
V
IV
V
V
V
IV
V
V
V
V
V
V
V
V
V
典型值
10
50/80
±0.2
±0.1
1.0
±6
2
5
30
2
±0.75
±0.75
2.0
1.2
450
最大
单位
MSPS
% FS
% FS
V
mV
k
pF
兆赫
V P-P差分
最低位
最低位
ns
ps的均方根
uV
–30
+30
25°C
IV
IV
IV
IV
IV
V
55.5
55.6
58.5
65.7
60
60
60
71.5
73.5
80
64.6
dBc的
dBc的
dBc的
dBc的
dBc的
dB
IV
IV
IV
IV
V
55.4
52.7
59.5
59.0
67
67
80
dBc的
dBc的
dBc的
dBc的
dB
第0版|第52 4
AD9861
电源规格
表3. AD9861-50和AD9861-80
模拟和数字电源= 3.3 V ; F
CLKIN
= 50 MHz的; PLL 4 ×设置;正常时间模式
参数
电源电压范围
模拟电源电压( AVDD )
数字电源电压( DVDD )
驱动器电源电压( DRVDD )
模拟电源电流
TxPath (20 mA满量程输出)
TxPath (2 mA满量程输出)
接收路径( -80 ,在80 MSPS )
RxPath ( -80 ,在40 MSPS ,低功耗模式)
RxPath ( -80 ,在20 MSPS ,超低功耗模式)
接收路径( -50 ,在50 MSPS )
RxPath ( -50 ,在50 MSPS ,低功耗模式)
RxPath ( -50 ,在16 MSPS ,超低功耗模式)
TxPath ,掉电模式
RxPath ,掉电模式
PLL
数字电源电流
TxPath , 1×插值,
50 MSPS DAC更新两个DAC ,
半双工模式24
TxPath , 2×插值,
100 MSPS DAC更新两个DAC ,
半双工模式24
TxPath , 4×插值,
200 MSPS DAC更新两个DAC ,
半双工模式24
RxPath数字,半双工模式24
温度
考试级别
IV
IV
IV
2.7
2.7
2.7
典型值
最大
3.6
3.6
3.6
单位
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
70
20
165
82
35
103
69
28
2
5
12
20
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
V
50
mA
V
80
mA
V
15
mA
数码特定网络阳离子
表4. AD9861-50和AD9861-80
参数
逻辑电平
输入逻辑高电压,V
IH
输入逻辑低电压,V
IL
输出逻辑高电压,V
OH
(1 mA负载)
输出逻辑低电压,V
OL
(1 mA负载)
数字引脚
输入漏电流
输入电容
最小复位低电平脉宽
数字输出上升/下降时间
温度
考试级别
IV
IV
IV
IV
IV
IV
IV
IV
DRVDD - 0.7
0.4
DRVDD - 0.6
0.4
12
3
5
2.8
4
典型值
最大
单位
V
V
V
V
A
pF
输入时钟周期
ns
第0版|第52 5
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