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位置：首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1022页 > AD9854
a
特点
300 MHz的内部时钟频率
集成的12位DAC输出
超高速， 3 ps的RMS抖动比较
出色的动力性能： 80分贝SFDR @ 100 MHz的
（ 1兆赫）一
OUT
4到20个可编程参考时钟倍频器
两个48位可编程频率寄存器
双14位可编程相位偏移寄存器
12位调幅和可编程
形的开/关抠像功能
单引脚FSK和PSK数据接口
线性或非线性FM调频功能单
针频率“HOLD”功能
频率斜坡FSK
<25的ps RMS总抖动时钟发生器模式
双向自动频率扫描
的sin（x ）/ x内修正
简化的控制接口
10MHz的串行， 2线或3线SPI兼容或
100MHz的并行8位的编程
CMOS 300 MHz的正交
完整DDS
AD9854
3.3 V单电源供电
多重省电功能
单端或差分输入参考时钟
小型80引脚LQFP封装
应用
雅居乐，正交L.O。频率合成
可编程时钟发生器
FM调频源雷达和扫描系统
测试和测量设备
商业和业余RF激励
概述
该AD9854数字频率合成器是一种高度集成的器件
采用先进的DDS技术，加上两个内部
高速，高性能正交D / A转换器和一个
比较器，以形成一个数字可编程的I和Q合成
功能。当引用一个准确的时钟源，
AD9854产生高度稳定的频率 - 相位振幅
可以用来作为一个可编程的正弦和余弦输出
敏捷L.O.在通信，雷达，以及许多其他应用。
在AD9854的创新型高速DDS内核可提供48位
频率分辨率（ 1 microHertz调整步骤） 。相trunca-
重刑17位，保证出色的SFDR 。在AD9854的电路
（待续
第14页）
功能框图
器R
SET
300MHz
DIFF /单
SELECT
频率
累加器
相
累加器
DDS
SINE - TO-振幅
变流器
INV 。
SINC
滤波器
数字
乘
I
12位"I"
DAC
模拟出
参考
CLOCK IN
4 –20
REF CLK
多
多路复用器
系统
时钟
Q
PHASE / OFFSET
调制
INV 。
SINC
滤波器
斜升/降压
时钟/逻辑
和
多路复用器
MUX
12-BIT
"Q"或
控制DAC
模拟出
FSK / BPSK / HOLD
DATA IN
频率控制字/相位字
多路复用器和坡道起步STOP LOGIC
48-BIT
频率
调谐字
14位的相
OFFSET /
调制
形
开/关键控
12位控制
DAC数据
ANALOG IN
AD9854
12-BIT
AM
MOD
双向
I / O更新
读
写
编程寄存器
I / O端口缓冲器
可编程的速率
和更新CLOCKS
比较
CLOCK OUT
串行/并行
SELECT
6比特的地址
或串行
程序设计
线
8位并行
负载
主
RESET
+V
S
GND
第0版
信息ADI公司提供的被认为是准确和
可靠的。但是，没有责任承担由Analog Devices其
使用，也不对第三方专利或其他权利的任何侵犯
这可能是由于它的使用。没有获发牌照以暗示或
否则，在ADI公司的任何专利或专利权。
一个技术的方式， P.O. 9106箱，诺伍德，MA 02062-9106 ， U.S.A.
联系电话： 781 / 329-4700
万维网网站： http://www.analog.com
传真： 781 / 326-8703
ADI公司， 1999
= 3.9 k
参考
AD9854–SPECIFICATIONS
（V = 3.3 V，5 ％ ，R频率= externalwith REFCLKclock频率= 30atMHz与
REFCLK乘法器10启用AD9854ASQ ，外部参考时钟
20兆赫
乘数启用10
S
SET
AD9854AST除非另有说明）。
参数
参考时钟输入特性
1
内部时钟频率范围
外部参考时钟频率范围
REFCLK乘法器启用
REFCLK乘法器残疾人
占空比
输入电容
输入阻抗
差模共模电压范围
最小信号幅度
共模电压范围
V
IH
（单端模式）
V
IL
（单端模式）
DAC静态输出特性
输出更新速度
决议
I和Q满量程输出电流
I和Q DAC， DC增益不平衡
2
增益误差
输出失调
微分非线性
积分非线性
输出阻抗
顺从电压范围
DAC的动态输出特性
I和Q DAC四。相位误差
DAC宽带SFDR
1 MHz至20 MHz的
OUT
20 MHz至40 MHz的
OUT
40 MHz至60 MHz的
OUT
60 MHz到80 MHz的
OUT
80 MHz到100 MHz的
OUT
100 MHz至120 MHz的
OUT
DAC窄带SFDR
10 MHz的
OUT
（±1 MHz）的
10 MHz的
OUT
（ ± 250千赫）
10 MHz的
OUT
（ ± 50千赫）
41 MHz的
OUT
（±1 MHz）的
41 MHz的
OUT
（ ± 250千赫）
41 MHz的
OUT
（ ± 50千赫）
119 MHz的
OUT
（±1 MHz）的
119 MHz的
OUT
（ ± 250千赫）
119 MHz的
OUT
（ ± 50千赫）
剩余相位噪声
(A
OUT
= 5兆赫，分机。 CLK = 30 MHz时，
REFCLK乘法器从事10 × ）
1 kHz偏置
10 kHz偏置
100 kHz偏置
(A
OUT
= 5兆赫，分机。 CLK = 300 MHz时，
REFCLK乘法器旁路）
1 kHz偏置
10 kHz偏置
100 kHz偏置
流水线延迟
相位累加器和DDS内核
反SINC滤波器
数字乘法器
温度
满
满
满
25°C
25°C
25°C
25°C
25°C
25°C
25°C
满
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
TEST
水平
VI
VI
VI
IV
IV
IV
IV
IV
IV
IV
I
IV
IV
I
I
I
I
I
IV
I
IV
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
民
5
5
5
45
AD9854ASQ
典型值
最大
300
75
300
55
民
5
5
5
45
AD9854AST
典型值
最大
200
50
200
55
单位
兆赫
兆赫
兆赫
%
pF
k
mV的P-P
V
V
V
MSPS
位
mA
dB
％ FS
A
最低位
最低位
k
V
度
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
50
3
100
50
3
100
800
1.6
2.3
1.75
1.9
1
300
800
1.6
2.3
1.75
1.9
1
200
5
–0.5
–6
12
10
+0.15
0.3
0.6
100
–0.5
0.2
58
56
52
48
48
48
83
83
91
82
84
89
71
77
83
20
+0.5
+2.25
2
1.25
1.66
+1.0
1
5
–0.5
–6
12
10
+0.15
0.3
0.6
100
–0.5
0.2
58
56
52
48
48
20
+0.5
+2.25
2
1.25
1.66
+1.0
1
83
83
91
82
84
89
25°C
25°C
25°C
V
V
V
140
138
142
140
138
142
dBc的/赫兹
dBc的/赫兹
dBc的/赫兹
25°C
25°C
25°C
25°C
25°C
25°C
V
V
V
IV
IV
IV
142
148
152
17
12
10
142
148
152
17
12
10
dBc的/赫兹
dBc的/赫兹
dBc的/赫兹
系统时钟周期
系统时钟周期
系统时钟周期
–2–
第0版
AD9854
参数
MASTER RESET期限
比较器输入特性
输入电容
输入阻抗
输入电流
迟滞
比较器输出特性
逻辑“1”电压，高阻抗负载
逻辑“0”电压，高阻抗负载
输出功率， 50
负载， 120 MHz的切换率
传播延迟
输出占空比误差
3
上升/下降时间， 5 pF负载
切换率，高阻抗负载
切换率， 50
负载
输出周期至周期抖动
4
比较器窄带SFDR
4
10兆赫（±1 MHz）的
10兆赫（ ± 250千赫）
10兆赫（ ± 50千赫）
41兆赫（±1 MHz）的
41兆赫（ ± 250千赫）
41兆赫（ ± 50千赫）
119兆赫（±1 MHz）的
119兆赫（ ± 250千赫）
119兆赫（ ± 50千赫）
时钟发生器的输出抖动
5
5兆赫
OUT
40 MHz的
OUT
100 MHz的
OUT
并行I / O时序特性
T
亚利桑那州立大学
（地址建立时间
WR
信号有效）
T
ADHW
（地址保持时间
WR
信号无效）
T
DSU
（数据建立时间
WR
信号无效）
T
DHD
（数据保持时间
WR
信号无效）
T
WRLOW
（ WR信号的最小低电平时间）
T
WRHIGH
（ WR信号的最小高电平时间）
T
WR
（ WR信号的最小周期）
T
ADV
（地址到数据有效时间）
T
ADHR
（地址保持时间
RD
信号无效）
T
RDLOV
（ RD低到输出有效）
T
RDHOZ
（ RD高到数据三态）
串行I / O时序特性
T
PRE
（ CS建立时间）
T
SCLK
（串行数据时钟周期）
T
DSU
（串行数据建立时间）
T
SCLKPWH
（串行数据时钟脉冲宽度高）
T
SCLKPWL
（串行数据时钟脉冲宽度低）
T
DHLD
（串行数据保持时间）
T
DV
（数据有效时间）
CMOS逻辑输入
逻辑“1”的电压
逻辑“0”电压
逻辑“1”的当前
逻辑“0”的当前
输入电容
温度
25°C
25°C
25°C
25°C
25°C
满
满
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
满
满
满
满
满
满
满
满
满
满
满
满
满
满
满
满
满
满
25°C
25°C
25°C
25°C
25°C
TEST
水平
IV
V
IV
I
IV
VI
VI
I
IV
I
V
IV
IV
IV
V
V
V
V
V
V
V
V
V
V
V
V
IV
IV
IV
IV
IV
IV
IV
V
IV
IV
IV
IV
IV
IV
IV
IV
IV
V
I
I
IV
IV
V
8.2
0
2.1
0
2.2
7
10
15
5
3.1
0.16
9
–10
300
375
11
3
±
1
2
350
400
9
+10
–10
300
375
4.0
84
84
92
76
82
89
73
73
83
23
12
7
7.8
1.6
1.8
8.2
0
2.1
0
2.2
7
10
15
5
84
84
92
76
82
89
73
73
83
23
12
7
7.8
1.6
1.8
11
3
±
1
2
350
400
AD9854ASQ
民
典型值
最大
10
3
500
±
1
10
AD9854AST
民
典型值
最大
10
3
500
±
1
10
3.1
0.16
单位
系统时钟周期
pF
k
A
mV的P-P
V
V
DBM
ns
%
ns
兆赫
兆赫
ps的均方根
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
ps的均方根
ps的均方根
ps的均方根
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
V
V
A
A
pF
±
5
20
±
5
20
+10
4.0
15
15
10
15
15
10
30
100
30
40
40
0
30
2.7
0.4
±
5
±
5
3
30
100
30
40
40
0
30
2.7
0.4
±
12
±
12
3
第0版
–3–
AD9854–SPECIFICATIONS
参数
电源
6
+V
S
当前
7
+V
S
当前
8
+V
S
当前
9
P
DISS7
P
DISS8
P
DISS9
P
DISS
掉电模式
温度
25°C
25°C
25°C
25°C
25°C
25°C
25°C
TEST
水平
I
I
I
I
I
I
I
民
AD9854ASQ
典型值
最大
1050
710
600
3.475
2.345
1.975
1
1210
816
685
4.190
2.825
2.375
50
民
AD9854AST
典型值
最大
755
515
435
2.490
1.700
1.435
1
865
585
495
3.000
2.025
1.715
50
单位
mA
mA
mA
W
W
W
mW
笔记
1
参考时钟输入是CON组fi gured接受一个1 V pp的（最小）直流偏移的正弦波集中在二分之一施加V
DD
或3 V TTL电平脉冲输入。
2
I和Q增益不平衡是数字调节到小于0.01分贝。
3
从1 MHz到100 MHz的1 V pp的正弦波输入， 0.5 V阈值改变占空比。
4
表示比较的固有周期到周期抖动的贡献。输入信号是1伏， 40 MHz的方波。测量装置韦夫克雷斯特DTS - 2075 。
5
比较器的输入来源于外部，通过7针椭圆低通滤波器的模拟输出部分。单端输入， 0.5 V P-P 。比较器的输出端接在50
.
6
在85最高环境温度同时操作
°C
和200兆赫的80引脚LQFP或300 MHz的最高内部时钟频率
对于耐热增强型80引脚LQFP可能导致150的最高管芯结温
°C
被超过。请参阅章节功耗
和散热考虑降容和热管理的信息。
7
所有功能订婚。
8
除了反Sinc所有功能订婚。
9
除了反Sinc和数字乘法器的所有功能订婚。
特定网络阳离子如有更改，恕不另行通知。
说明测试级别
考试级别
绝对最大额定值*
I
- 100 ％生产测试。
III - 只样品进行测试。
四 - 参数是通过设计和特性保证
测试。
V - 此参数只在一个典型值。
VI - 设备都100 ％的产品在25 ℃的测试，
通过设计和特性保证测试
用于工业的操作温度范围。
最高结温。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 150℃
V
S
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4 V
数字输入。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.7 V至+ V
S
数字输出电流。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 5毫安
储存温度。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ° C至+ 150°C
工作温度。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -40 ° C至+ 85°C
引线温度（焊接， 10秒） 。 。 。 。 。 。 。 。 。 。 。 。 300℃
最大时钟频率。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 300兆赫
*绝对
最大额定值的限制值，可以单独应用，
超出该电路的适用性可能受到损害。实用
在任何这些条件的可操作性不一定暗示。曝光
绝对最大额定值条件下，时间会影响器件的长期
可靠性。
订购指南
模型
AD9854ASQ
AD9854AST
AD9854/PCB
温度范围
-40 ° C至+ 85°C
-40 ° C至+ 85°C
0 ° C至70℃
包装说明
热增强型80引脚LQFP
80引脚LQFP
评估板
封装选项
SQ-80
ST-80
小心
ESD （静电放电）敏感器件。静电荷高达4000 V容易
积聚在人体和测试设备，可排出而不被发现。虽然
在AD9854具有专用ESD保护电路，永久性的损害可能发生
设备受到高能静电放电。因此，适当的ESD防范措施
建议避免性能下降或功能丧失。
警告！
ESD敏感器件
–4–
第0版
AD9854
引脚功能描述
针
号
1–8
9, 10, 23,
24, 25, 73,
74, 79, 80
11, 12, 26,
27, 28, 72,
75, 76, 77,
78
13, 35, 57,
58, 63
14–19
(17)
引脚名称
D7–D0
DVDD
功能
八位双向并行编程数据输入。仅在并行编程模式。
对于数字电路电源电压的连接。标称3.3 V超过AGND积极
和DGND 。
对于数字电路接地回路的连接。相同的电位AGND 。
DGND
NC
A5–A0
A2 / RESET IO
无内部连接。
六位并行地址输入程序寄存器。仅在并行编程模式。 A0，A1
和A2具有第二功能被选择时在串行编程模式。见下面。
允许串行通信总线的RESET是反应迟钝，因不良的编程
明协议。重置的串行总线以这种方式不影响先前编程也不
它调用看出，在表五，高电平有效的“默认”的编程值。
单向串行数据输出用于3线串行通信模式。
双向串行数据输入/输出用于2线串行通信模式。
双向频率更新信号。方向选择控制寄存器。如果设置为输入，
一个上升沿将使编程寄存器的内容传送到IC的内部作品
处理。如果I / O UD被选择为八个系统时钟周期的输出时，输出脉冲（低到高）
持续时间表示已发生的内部频率更新。
写并行数据到寄存器编程。共享功能与SCLK 。串行时钟信号
与串行总线编程相关的。数据被登记在上升沿。该引脚与共享
WRB在并行模式选择。
读寄存器编程并行数据。共享功能与公务员事务局。片选信号
与串行总线编程相关的。低电平有效。该引脚与RDB时共享
并行模式被选择。
多功能引脚根据操作的编程控制寄存器选择的模式。
如果在FSK模式逻辑低电平选择F1 ，逻辑高电平选择F2 。如果在BPSK方式，逻辑低电平选择
第1阶段，逻辑高电平选择阶段2.如果在调频模式，逻辑高电平从事HOLD功能
导致频率累加器停止在其当前位置。要恢复或开始啁啾，
逻辑低电平有效。
首先必须在编程控制寄存器功能中选择。逻辑高电平将使
I和Q DAC输出斜坡从零刻度到满刻度的幅度在一个预先设置的速度。
逻辑低电平使满量程输出为斜坡下降至零刻度在预编程的速度。
为模拟电路供电电压的连接。标称3.3 V超过AGND积极
和DGND
对于模拟电路接地回路的连接。相同的电位DGND 。
(18)
(19)
20
A1/SDO
A0/SDIO
I / O UD
21
WRB / SCLK
22
RDB / CSB
29
FSK / BPSK /
HOLD
30
形
键控
AVDD
31, 32, 37,
38, 44, 50,
54, 60, 65
33, 34, 39,
40, 41, 45,
46, 47, 53,
59, 62, 66,
67
36
42
43
48
49
51
52
AGND
VOUT
VINP
VINN
IOUT1
IOUT1B
IOUT2B
IOUT2
内部高速比较器的同相输出引脚。设计用于驱动10 dBm至50
负载
以及标准的CMOS逻辑电平。
电压输入正。内部高速比较器的同相输入端。
电压输入负。内部高速比较器的反相输入端。
单极电流I或余弦DAC输出。
在I或余弦DAC的互补单极电流输出。
在Q或正弦或DAC的互补单极电流输出。
单极电流的Q或正弦DAC的输出。该DAC可以被编程为接受
代替内部正弦数据的外部12位数据。这允许AD9854效仿AD9852
控制DAC功能。
第0版
–5–
CMOS 300 MSPS正交
完整的DDS
AD9854
特点
300 MHz的内部时钟频率
FSK ， BPSK ， PSK ，调频，调幅操作
双集成的12位数字 - 模拟转换器（DAC ）
超高速比较器， 3 ps的均方根抖动
出色的动力性能
80分贝SFDR频率为100 MHz （ ± 1 MHz）的一
OUT
4 ×至20 ×可编程参考时钟倍频器
两个48位可编程频率寄存器
双14位可编程相位偏移寄存器
12位可编程振幅调制和
开/关输出形键控功能
单引脚FSK和BPSK数据接口
通过输入/输出接口的PSK能力
线性或非线性调频的线性调频脉冲函数与单针
频率保持功能
频率斜坡FSK
<25的ps RMS总抖动时钟发生器模式
双向自动频率扫描
的sin（x ）/ x内修正
简化的控制接口
10MHz的串行2线或3线SPI兼容
100MHz的并行8位的编程
3.3 V单电源供电
多重省电功能
单端或差分输入参考时钟
小型， 80引脚LQFP或TQFP封装，带有裸焊盘
应用
雅居乐，正交本振频率合成
可编程时钟发生器
FM调频源雷达和扫描系统
测试和测量设备
商业和业余RF激励
功能框图
系统时钟
频率
累加器
ACC 1
相
累加器
ACC 2
48
48
17
17
相 -
振幅
变流器
MUX
参考
CLOCK IN
REF
CLK
卜FF器
4至20倍
REF CLK
倍增器
DDS内核
I
MUX
12
INV
SINC
滤波器
数字乘法器
12
12-BIT
I
DAC
类似物
OUT
器R
SET
12-BIT
Q DAC或
控制
DAC
类似物
OUT
DIFF /单
SELECT
系统
时钟
Q
解复用
FSK / BPSK / HOLD
DATA IN
3
MUX
DELTA
频率
率计时器
2
48系统
时钟
DELTA
频率
字
48
48
14
MUX
MUX
系统
时钟
14
12
12
可编程
振幅和
速率控制
12
12
比较
时钟
OUT
类似物
IN
频率
调音
WORD 1
I和Q 12位
频率
前14位
第二14位
12位DC
调音
相/相OFFSET / OFFSET AM调制控制
WORD 2
字
字
编程寄存器
双向
内部/外部
I / O更新时钟
模式选择
系统
CK
时钟
Q
D
INT
EXT
MUX
48
14
MUX
系统
时钟
MUX
12
INV
SINC
滤波器
12
OSK
公共汽车
I / O端口缓冲器
GND
+V
S
÷2
系统
时钟
AD9854
国内
可编程
更新时钟
读
写
串行/
并行
SELECT
图1 。
英文内容
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www.analog.com
传真： 781.461.3113 2002-2007 ADI公司保留所有权利。
00636-001
6比特的地址
或串行
程序设计
线
8-BIT
并行
负载
主
RESET
AD9854
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
功能框图............................................... ............... 1
修订历史................................................ ............................... 3
概述................................................ ......................... 4
规格................................................. .................................... 5
绝对最大额定值............................................... ............. 8
热阻................................................ ...................... 8
测试等级说明.............................................. ............. 8
ESD注意事项................................................ .................................. 8
引脚配置和功能说明............................. 9
典型性能特征........................................... 12
典型应用................................................ ....................... 16
工作原理............................................... ....................... 19
操作模式............................................... .................... 19
利用AD9854 ............................................... ........................... 29
内部和外部时钟更新........................................ 29
ON / OFF输出形键控（ OSK ） .................................... 29
I和Q DAC的.............................................. ................................ 30
控制DAC ................................................ ............................... 30
反正弦函数............................................... ................. 31
REFCLK乘法器................................................ .................... 31
编程AD9854 ............................................... ............. 32
MASTER RESET ................................................ ........................ 32
并行I / O操作............................................. .................. 34
串行端口I / O操作............................................ .............. 34
串行接口的一般操作................................... 36
指令字节................................................ .......................... 37
串行接口端口引脚说明..................................... 37
串行端口操作的注意事项............................................. ... 37
MSB / LSB传输.............................................. ........................... 38
控制寄存器说明............................................... ..... 38
功耗和散热考虑....................... 40
热阻抗................................................ ................... 40
结温事项.................................... 40
评估工作条件的........................................ 41
热增强型封装安装指南................ 41
评估板................................................ ............................ 42
评估板说明............................................... ... 42
常规操作说明............................................... 42
用随附的软件.............................................. ...... 44
支持................................................. ....................................... 44
外形尺寸................................................ ....................... 52
订购指南................................................ .......................... 52
修订版E |页52 2
AD9854
修订历史
7月7日 - 修订版。 D钮英文内容
改变了AD9854ASQ到AD9854ASVZ .......................通用
改变了AD9854AST到AD9854ASTZ .........................通用
更改概述.............................................. 4 .......
更改表1尾注............................................. .............. 7
更改绝对最大额定值部分.......................... 8
更改功耗第......................................... 40
更改耐热增强型封装的安装
准则第................................................ ...................... 41
图64 ..............................................变化........................ 47
更改外形尺寸.............................................. ..... 52
更改订购指南.............................................. ............. 52
11月6日 - 修订版。 C到Rev. D的
更改概述第....................................... 4
在电源参数................. 7更改为尾注
更改绝对最大额定值部分.......................... 8
增加了尾注表2 ............................................. ................. 8
图50 ..............................................变化........................ 29
更改功耗第......................................... 39
图68 ..............................................变化........................ 45
更新的外形尺寸............................................... ......... 51
更改订购指南.............................................. ............. 51
9月4日 - 修订版。 B到C版
更新格式................................................ ..................通用
更改表1 .............................................. .............................. 4
更改脚注2 .............................................. ........................ 7
更改考试级别段说明............................. 8
更改工作组.................................... 17理论
更改单音（模式000）第............................... 17
更改渐变FSK （模式010 ）第............................ 18
更改基本FM调频编程步骤第......... 23
图50 ..............................................变化........................ 27
更改评估板使用说明书Section.40
更改过滤IOUT1和滤波IOUT2科... 41
更改使用所提供的软件部分....................... 42
图68 ..............................................变化........................ 45
图69 ..............................................变化........................ 46
更新的外形尺寸............................................... ......... 50
更改订购指南.............................................. ............. 50
3月2日 - 修订版。 A到版本B
更新格式................................................ .................通用
重编图和表......................................通用
更改概述第....................................... 1
更改功能框图.......................................... 1
更改规格第.............................................. 4 ....
更改绝对最大额定值部分......................... 7
更改引脚功能描述.......................................... 8
变化图3 .............................................. .......................... 10
删除的两个典型性能特性图........ 11
更改反正弦函数部分................................ 28
更改差分参考时钟使能部分....................... 28
图52 ..............................................变化........................ 30
更改并行I / O操作部分................................. 32
变化的串行接口部分0.33至一般操作
图57 ..............................................变化........................ 34
更换使用说明书第.................................... 40
图68 ..............................................变化........................ 44
图69 ..............................................变化........................ 45
更改客户评估板表............................ 46
修订版E |第52 3
AD9854
概述
该AD9854数字频率合成器是一种高度集成的器件
采用先进的DDS技术，加上两个内部
高速，高性能正交数模转换器以形成数字
可编程的I和Q合成的功能。当引用
以精密时钟源时， AD9854产生高度稳定，
频率 - 相位，振幅可编程正弦和余弦
输出可以用来作为一种敏捷的LO通信，雷达，
和许多其他应用。该创新型高速DDS内核
的AD9854提供48位的频率分辨率（ 1 μHz的调整
分辨率为300 MHz的系统时钟） 。维护17位确保可靠
卓越的SFDR 。
在AD9854的电路架构允许产生
频率高达同步正交输出信号
150 MHz时，其可以被数字调谐在高达的速率
每秒100万个新的频率。正弦波输出
（外部滤波）可通过转换为方波
内部比较敏捷时钟发生器应用。
该装置提供两个14位相位寄存器和一个单独的销
用于BPSK操作。
对于更高阶的PSK操作中， I / O接口可用于
相变化。 12位I和Q DAC的，再加上
创新的DDS架构，提供出色的宽带和
窄带SFDR输出。在Q的DAC还可以配置
作为一个用户可编程控制DAC ，如果正交函数
是不希望的。当用比较器配置中， 12位
控制DAC有助于在高速静态占空比控制
时钟发生器应用。
两个12位数字乘法器允许可编程振幅
调制，开/关输出形键控，和精确的振幅
控制正交输出。调频功能也
包括以方便宽带扫频
应用程序。可编程4 ×至20 × REFCLK乘法器
在AD9854的内部电路产生300 MHz系统
从外部低频参考时钟的时钟。这
节省了用户的成本和实现的难度
300 MHz的系统时钟源。
直接300 MHz的时钟也容纳与任何单
端或差分输入。单针传统FSK和
斜坡FSK的提高频谱质量的支持。
在AD9854采用先进的0.35微米CMOS技术
提供的功能，在3.3 V单电源高的水平。
该AD9854是引脚对引脚与AD9852兼容单
音合成器。它可工作在扩展级
工业温度范围-40℃至+ 85℃ 。
修订版E |第52 4
AD9854
特定网络阳离子
V
S
= 3.3V ±5％ ，R
SET
= 3.9 kΩ的外部参考时钟频率为30 MHz与REFCLK乘法器，在10 ×的AD9854ASVZ启用
在10×对AD9854ASTZ外部参考时钟频率= 20兆赫与REFCLK乘法器使能，除非另有说明。
表1中。
参数
参考时钟输入特性
1
内部系统时钟频率范围
REFCLK乘法器启用
REFCLK乘法器残疾人
外部参考时钟频率范围
REFCLK乘法器启用
REFCLK乘法器残疾人
占空比
输入电容
输入阻抗
差模共模电压范围
最小信号幅度
2
共模电压范围
V
IH
（单端模式）
V
IL
（单端模式）
DAC静态输出特性
输出更新速度
决议
I和Q满量程输出电流
I和Q DAC， DC增益不平衡
3
增益误差
输出失调
微分非线性
积分非线性
输出阻抗
顺从电压范围
DAC的动态输出特性
I和Q DAC正交相位误差
DAC宽带SFDR
1 MHz至20 MHz的
OUT
20 MHz至40 MHz的
OUT
40 MHz至60 MHz的
OUT
60 MHz到80 MHz的
OUT
80 MHz到100 MHz的
OUT
100 MHz至120 MHz的
OUT
DAC窄带SFDR
10 MHz的
OUT
（±1 MHz）的
10 MHz的
OUT
（ ± 250千赫）
10 MHz的
OUT
（ ± 50千赫）
41 MHz的
OUT
（±1 MHz）的
41 MHz的
OUT
（ ± 250千赫）
41 MHz的
OUT
（ ± 50千赫）
119 MHz的
OUT
（±1 MHz）的
119 MHz的
OUT
（ ± 250千赫）
119 MHz的
OUT
（ ± 50千赫）
温度
TEST
水平
AD9854ASVZ
最小值典型值
最大
AD9854ASTZ
最小值典型值
最大
单位
满
满
满
满
25°C
25°C
25°C
25°C
25°C
25°C
25°C
满
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
25°C
VI
VI
VI
VI
IV
IV
IV
IV
IV
IV
IV
I
IV
IV
I
I
I
I
I
IV
I
IV
V
V
V
V
V
V
V
V
V
V
V
V
V
V
V
20
DC
5
DC
45
300
300
75
300
55
20
DC
5
DC
45
200
200
50
200
55
兆赫
兆赫
兆赫
兆赫
%
pF
kΩ
mV的P-P
V
V
V
MSPS
位
mA
dB
％ FS
μA
最低位
最低位
kΩ
V
度
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
dBc的
50
3
100
50
3
100
400
1.6
2.3
1.75
1.9
1
300
400
1.6
2.3
1.75
1.9
1
200
5
0.5
6
12
10
+0.15
0.3
0.6
100
0.5
0.2
58
56
52
48
48
48
83
83
91
82
84
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77
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+0.5
+2.25
2
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1.66
+1.0
1
5
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+0.15
0.3
0.6
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