AD974
引脚功能描述
PIN号
1
2–5, 25–28
6
7
8
助记符
AGND1
VXA , VXB
BIP
帽
REF
描述
模拟地。用作REF引脚的接地参考点。
模拟输入。请参考表一输入范围配置。
双极偏移。连接VXA输入提供双极性输入范围。
基准缓冲输出。连接2.2
F
CAP和模拟之间的钽电容
地面上。
基准输入/输出。内部+2.5 V基准电压可在此引脚。另外一个
外部参考可以被用于覆盖内部参考。在任一情况下,连接一个2.2
F
REF和模拟地之间的钽电容。
模拟地。
读/转换输入。用于控制转换和读模式。同
CS
低,下降
上的R / C的边缘保持模拟输入信号,并在内部启动转换;上升沿使
的转换结果的传输。
数字电源。名义上+5 V.
关断输入。当设置为逻辑高电平时,功率消耗减小和转化
被禁止。从以前的转换,转换结果存储在板载移
注册。
数字选择选择内部或外部数据时钟输入。与EXT / INT连接到低电平,
启动转换后, 16 DATACLK脉冲发射之前的转换结果
在图3中采用的EXT显示/ INT设定为逻辑高电平时,输出数据被同步到一个
连接到DATACLK输入外部时钟信号。数据被输出,如图4所示
通过图9中。
数字地。
与外部数据时钟使用数字输出帧同步( EXT / INT =逻辑
HIGH ) 。当启动一个读序列,脉冲1 DATACLK周期宽的输出
同步到所述外部数据时钟。
串行数据时钟输入或输出,取决于EXT / INT引脚的逻辑状态。当
使用内部数据时钟( EXT / INT =逻辑低)时,转换启动序列会启动
传输16 DATACLK周期。输出数据是同步到该时钟,并且是有效的
既其上升沿和下降沿(图3) 。当使用外部数据时钟( EXT / INT =逻辑
高) ,在
CS
和R / C信号控制如何转换数据访问。
串行数据输出同步到DATACLK 。转换结果存储在一个片
片内寄存器。该AD974提供转换结果, MSB首先,从它的内部移位寄存器
之三。当使用内部数据时钟( EXT / INT =逻辑低电平),数据是在两个有效
上升和DATACLK的下降沿。使用外部数据时钟( EXT / INT =逻辑高电平)
允许先前转换的数据到一个转换过程中被访问( 9图5,7和)或
转换结果可以在完成转换后,被访问(图4,图6和图8 ) 。
多路复用器的写输入。这些输入在内部或运算,产生多路锁存输入。
锁存器是透明的,当
WR1
和
WR2
绑低。
片选输入。随着R / C低,在下降沿
CS
将启动转换。与R / C
高,下降边缘
CS
将使该串行数据输出序列。
忙碌的输出。变为低电平时,转换开始,并保持低电平直到转换
完成,该数据被锁存到芯片上的移位寄存器。
地址多路复用器输入锁存与
WR1 , WR2
输入。
A1
0
0
1
1
A0
0
1
0
1
从可用信道数据
AIN 1
AIN 2
AIN 3
AIN 4
9
10
AGND2
的R / C
11
12
V
DIG
PWRD
13
EXT / INT
14
15
DGND
SYNC
16
DATACLK
17
数据
18, 19
20
21
22, 23
WR1 , WR2
CS
忙
A1, A0
24
V
ANA
模拟电源。名义上+5 V.
REV 。一
–5–