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多时钟发生器
AD9551
特点
任何两个标准的网络速度之间的转换
双基准输入和双时钟输出
引脚可编程为标准的网络速率转换
SPI可编程任意合理的速度翻译
从10MHz到900MHz的输出频率
从19.44 MHz到806 MHz的输入频率
片内VCO
满足OC -192高频抖动产生要求
支持标准的前向纠错( FEC)率
支持缓缴操作
支持无中断切换和相位构建(即使有
不平等的参考频率)
SPI兼容的3线编程接口
单电源供电( 3.3 V )
参考调节和转换电路在内部
这样,如果一个参考失败同步两个引用,
因此几乎在输出端无相扰动。
在AD9551使用外部晶振和内部DCXO来
提供缓缴操作。如果两个引用失败,该设备
保持一个稳定的输出信号。
该AD9551提供引脚可选,预置分频器值
标准( FEC和调整后)网络频率。该引脚
可选频率包括15种可能的组合
输入频率和16个可能的输出频率。一个SPI
接口通过使得可以提供进一步的灵活性
节目几乎任何合理的输入/输出频率比。
的AD9551是,采用了一种时钟发生器小数N分系
锁相环(PLL)使用的sigma-delta ( Σ - Δ )调制器
( SDMS ) 。小数频率合成能力,使
该装置以满足对频率和功能要求
多业务交换机的应用程序。在AD9551产生精确
使用这些中的任何一个时,各种各样的标准频率
相同的标准频率为定时基(供参考)。该
这个功能的主要挑战是精确代
所需的输出频率,因为即使有轻微的输出频率
错误可能会导致下游时钟电路问题
位或周跳的形式。为精确的频率要求
翻译在这种应用中需要使用一个压裂的
tional -N类PLL架构变模量。
应用
多业务交换机
多业务路由器
确切的网络时钟频率转换
通用频率转换
概述
的AD9551接受一个或两个参考输入信号synthe-
大小的一个或两个输出信号。该AD9551采用小数N分
PLL,它精确地转换基准频率到所需
输出频率。输入接收器和输出驱动器提供
两个单端和差分工作模式。
基本框图
水晶
(26MHz)
REFA
REFB
参考
空调
与SWITCH-
过度
缓缴
PLL
产量
电路
OUT1
OUT2
引脚定义和串行
程序设计
AD9551
07805-001
图1 。
版本B
信息ADI公司提供的被认为是准确和可靠。然而,没有
责任承担ADI公司供其使用,也为专利或其他任何侵权行为
第三方可能导致其使用的权利。规格如有变更,恕不另行通知。没有
获发牌照以暗示或其他方式ADI公司的任何专利或专利权。
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www.analog.com
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2009 ADI公司保留所有权利。
AD9551
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
概述................................................ ......................... 1
基本框图............................................... ......................... 1
修订历史................................................ ............................... 2
功能框图............................................... ............... 3
规格................................................. .................................... 4
参考时钟输入特性...................................... 4
输出特性................................................ ................. 4
抖动特性( 180 Hz的环路带宽) ...................... 5
晶体振荡器特性...............................................五
功耗................................................ .................... 5
逻辑输入引脚............................................... ............................. 6
RESET引脚................................................ ..................................... 6
逻辑输出引脚............................................... .......................... 6
串行控制端口............................................... ........................ 6
串行控制端口时序.............................................. ........... 7
绝对最大额定值............................................... ............. 8
ESD注意事项................................................ .................................. 8
引脚配置和功能说明............................. 9
典型性能特征........................................... 11
预设频率比............................................... .................. 14
工作原理............................................... ....................... 16
操作模式................................................ ........................ 16
组件模块................................................ ..................... 16
保持模式................................................ ........................... 21
抖动容限................................................ ............................ 21
外部环路滤波器电容.............................................. ... 21
输出/输入频率的关系.................................... 21
计算分频值............................................... ........ 22
低压降( LDO )稳压器............................................ 24 ..
应用信息................................................ .............. 25
热性能................................................ ................ 25
串行控制端口............................................... .......................... 26
串行控制端口引脚说明....................................... 26
串行控制端口的操作....................................... 26
指令字(16位) ............................................ ............ 27
MSB / LSB优先传输............................................. .............. 27
注册地图................................................ ................................... 29
寄存器映射说明............................................... ......... 32
外形尺寸................................................ ....................... 40
订购指南................................................ .......................... 40
修订历史
9月9日 - 修订版。 A到版本B
更改表25 .............................................. .......................... 33
6月9日 - 修订版。 0到版本A
图23 ..............................................变化........................ 23
4月9日 - 修订版0 :初始版
版本B |第40 2
AD9551
在AD9551采用外部控制引脚容易配置
(A [3:0 ],B [ 3:0]和Y [3: 0])。这些引脚的逻辑状态设置预
即建立一个特定的输入 - 输出定义的分频器值
频率比。对于需要其他频率比应用程序,
用户可以覆盖任何的预分频器设置
通过串行端口,它使一个非常广泛的
应用程序。
在AD9551架构由两个级联PLL阶段。
第一阶段包括小数除法(通过SDM ),其次
通过利用晶体谐振器为基础的DCXO数字PLL 。该
DCXO依靠外部晶体的谐振频率
19.44 MHz至52 MHz范围内。该DCXO构成
第一PLL ,其较窄的频率范围内工作
( ± 50ppm的)周围的晶体谐振频率。该PLL具有
大约180赫兹的环路带宽,提供初始抖动
清理的输入参考信号的。第二个阶段是一个频
昆西乘法PLL的转换第一级的输出
频率( 19.44兆赫至104兆赫的范围内)到
3.7 GHz的。这PLL集成了一个基于SDM的分数
反馈分频器,使分数倍频。
在这第二个PLL的输出的可编程分频器整数
建立一个最终输出高达900MHz的频率。
它以了解是重要的AD9551的结构
产生的输出频率是最可能不连贯
与输入参考频率。其原因是,在输入
和晶振频率通常不会谐波相关
既不是输出和晶振频率。其结果,
有通常的输入的相位之间没有关系
和输出信号。
输入锁相环
锁定
XTAL1 XTAL0
的AD9551包括参考信号处理块
能在两个参考平滑切换过渡
输入。该电路自动检测的存在下
参考输入信号。如果只有一个输入的场合,该设备
使用它作为有效参考。如果两个输入端都存在, 1
成为活动的参考,另外成为替代方案
内特参考。该电路边缘对齐参考备份
与有效参考。如果活动参考发生故障,电路
自动切换到备份的参考(如果可用) ,
使之成为新的有效参考。同时,如果失败
参照再次可用,则成为新的备份
参考,边沿对齐新活动参考
(一对新的有效参考的故障预防措施) 。
如果可以使用既不参考, AD9551支持的保持
模式。请注意,外部晶体是必要的,以提供
切换和保持功能。它也是时钟源
为基准的同步和监控功能。
的AD9551依靠一个外部电容器的输出
PLL的环路滤波器。用适当的终止,输出是兼容
与LVPECL ,LVDS或CMOS逻辑电平,虽然AD9551
在严格的CMOS工艺中实现的。
在AD9551工作在扩展工业级温度
范围为-40 ° C至+ 85°C 。
功能框图
输出PLL
锁定
LF
TEST
MUX
REFA , REFA
2
f
REFA
AD9551
LOCK
检测
N
A
SDM
A
同步
切换控制
19.44MHz模式
P DIG 。
F闭环
FILTER
f
IF
DCXO
CON组fi guration
P
F
D
收费
3350MHz TO
4050MHz
VCO
4
11
P
0
1
63
P
1
f
OUT1
2
OUT1 , OUT1
REFB , REFB
2
f
REFB
N
B
SDM
B
N = 4N
1
+ N
0
参考
MONITOR
N1
4/5
1
63
P
2
N
f
OUT2
2
OUT2 , OUT2
采样率
控制
SCLK ,SDIO
CS
3
SDM
注册银行
N
B
, MOD
B
, FRAC
B
A[3:0]
B[3:0]
Y[3:0]
4
4
4
分频器值
19.44MHz模式
N, MOD ,压裂,P
0
, P
1
, P
2
FRAC , MOD
N
A
, MOD
A
, FRAC
A
P
2
, P
1
, P
0
07805-002
图2中。
版本B |第40 3
AD9551
特定网络阳离子
最低和最高值适用于全系列电源电压和工作温度的变化。典型值适用于VDD = 3.3 V ,
T
A
= 25 ℃,除非另有说明。
参考时钟输入特性
表1中。
参数
频带
输入电容
输入阻抗
占空比
参考时钟输入电压摆幅
迪FF erential
单端
1
19
1
典型值
3
6
最大
806
40
60
单位
兆赫
pF
%
测试条件/评论
测量单端
测量跨越差分探头
输入引脚
跨引脚对最大震级
峰 - 峰值
250
250
mV
mV
在19 MHz的下限仅适用于19.44 MHz的运行模式。
输出特性
表2中。
参数
LVPECL模式
差分输出电压摆幅
共模输出电压
频带
占空比
上升/下降时间
1
(20%至80%)
LVDS模式
差分输出电压摆幅
平衡,V
OD
不平衡, ΔV
OD
690
VDD - 1.77
0
40
典型值
765
VDD - 1.66
最大
889
VDD - 1.20
900
60
305
单位
mV
V
兆赫
%
ps
测试条件/评论
输出驱动器的静态
输出驱动器的静态
高达805 MHz的输出频率
这两个引脚之间的100 Ω终端
输出驱动器
255
247
454
25
mV
mV
输出引脚之间的电压摆幅;
输出驱动器的静态
电压之间的绝对差值
正常的脚和脚倒立摆;
输出驱动器的静态
输出驱动器的静态
输出引脚之间的电压差;
输出驱动器的静态
失调电压
普通模式,V
OS
共模差ΔV
OS
输出短路电流
频带
占空比
上升/下降时间
1
(20%至80%)
CMOS模式
输出电压高,V
OH
I
OH
= 10毫安
I
OH
= 1毫安
输出电压低,V
OL
I
OL
= 10毫安
I
OL
= 1毫安
频带
1.125
1.375
25
17
24
900
60
355
V
mV
mA
兆赫
%
ps
0
40
285
高达805 MHz的输出频率
这两个引脚之间的100 Ω终端
输出驱动器
输出驱动器静电;标准的驱动器
强度设置
2.8
2.8
V
V
输出驱动器静电;标准的驱动器
强度设置
0.5
0.3
200
版本B |第40 4
0
V
V
兆赫
3.3 V CMOS ;标准驱动力
环境
AD9551
参数
占空比
上升/下降时间
1
(20%至80%)
1
45
典型值
500
最大
55
745
单位
%
ps
测试条件/评论
在最大输出频率
3.3 V CMOS ;标准驱动力
设置; 10 pF负载
列出的数值是较慢的边缘(上升或下降) 。
抖动特性( 180 HZ环路带宽)
表3中。
参数
抖动产生
12千赫至20兆赫
50 kHz至80 MHz的
4 MHz到80 MHz
抖动传输带宽
抖动传输峰值
典型值
1.3
0.8
0.5
0.6
0.1
180
0.1
最大
单位
ps的均方根
ps的均方根
ps的均方根
ps的均方根
ps的均方根
Hz
dB
测试条件/评论
f
IN
= 19.44兆赫,女
OUT
= 622.08兆赫
f
IN
= 622.08兆赫,女
OUT
= 622.08兆赫
f
IN
= 19.44兆赫,女
OUT
= 622.08兆赫
f
IN
= 622.08兆赫,女
OUT
= 622.08兆赫
f
IN
= 622.08兆赫,女
OUT
= 622.08兆赫
见典型性能
特性一节
见典型性能
特性一节
晶体振荡器特性
表4 。
参数
晶振频率
范围
公差
水晶动态电阻
DCXO负载电容控制
范围
19
典型值
26
最大
52
20
100
单位
兆赫
PPM
Ω
pF
测试条件/评论
3至21
需要与10 pF负载晶体
规范
耗电量
表5 。
参数
总电流
VDD电流PIN
9针
23针
27针
引脚34
LVPECL输出驱动器
典型值
169
最大
195
单位
mA
测试条件/评论
在最大输出频率与两个
输出通道激活
24
78
36
36
38
27
84
42
42
mA
mA
mA
mA
mA
900兆赫与100之间的Ω终端
输出驱动器的两个引脚
版本B |第40个5
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电话:13910052844(微信同步)
联系人:刘先生
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