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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1216页 > AD9549ABCPZ-REEL7
双输入网络时钟
发生器/同步器
AD9549
特点
灵活的参考输入
输入频率: 8 kHz至750 MHz的
两个参考输入端
参考指标损失
自动和手动模式缓缴
自动和手动切换模式
在输出平滑A到B相变
出色的稳定性在保持模式
可编程的16 + 1个比特的输入分频器,R
差分HSTL时钟输出
输出频率为750 MHz的
低抖动时钟倍频为>400 MHz的频率
单端CMOS输出为<150 MHz的频率
可编程数字环路滤波器( <1 Hz至 100千赫)
高速数字控制振荡器(DCO)芯
直接数字频率合成器(DDS )集成了14位DAC
出色的动力性能
可编程的16 + 1位反馈分频器,S
软件控制断电
提供64引脚LFCSP封装
应用
网络同步
参考时钟抖动清除
SONET / SDH的时钟,直到OC -192 ,包括前向纠错
地层3 / 3E基准时钟
无线基站控制器
有线基础设施
数据通信
概述
该AD9549提供了许多系统同步,
包括同步光纤网络( SONET / SDH) 。该
AD9549产生一个输出时钟,同步的两个一
外部输入的参考。外部引用可能包含
显著时间抖动,也指定为相位噪声。利用
数字控制环路和保持电路,在AD9549
持续的期间,产生一个干净(低抖动) ,有效的输出时钟
损失的参考条件,即使当两个引用都失败了。
在AD9549工作在一个工业级温度范围
-40 ° C至+ 85°C 。
基本框图
AD9549
FDBK_IN
S1至S4
DAC_OUT
滤波器
REFA_IN
REFB_IN
参考
MONITORS
开关
R
数字PLL
R,S DIVIDERS
缓缴
时钟
产量
DRIVERS
OUT
OUT_CMOS
串口,
I / O逻辑
系统时钟
倍增器
06744-001
数字接口
图1 。
Rev. D的
信息ADI公司提供的被认为是准确和可靠。然而,没有
责任承担ADI公司供其使用,也为专利或其他任何侵权行为
第三方可能导致其使用的权利。规格如有变更,恕不另行通知。没有
获发牌照以暗示或其他方式ADI公司的任何专利或专利权。
商标和注册商标均为其各自所有者的财产。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
www.analog.com
联系电话: 781.329.4700
传真: 781.461.3113 2007-2010 ADI公司保留所有权利。
AD9549
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
概述................................................ ......................... 1
基本框图............................................... ......................... 1
修订历史................................................ ............................... 3
规格................................................. .................................... 4
直流规范................................................ ......................... 4
交流规范................................................ .......................... 6
绝对最大额定值............................................... ............. 9
热阻................................................ ...................... 9
ESD注意事项................................................ .................................. 9
引脚配置和功能描述........................... 10
典型性能特征........................................... 13
输入/输出端接建议.......................... 16
工作原理............................................... ....................... 17
概述................................................. ..................................... 17
数字PLL内核( DPLLC ) ............................................ ............ 17
鉴相器................................................ ............................ 21
数字环路滤波器系数.............................................. .. 22
闭环相位偏移............................................. ............ 24
锁定检测................................................ ............................ 24
参考监视器................................................ .................... 26
参考切换................................................ ................. 27
缓缴................................................. ..................................... 29
输出频率范围控制............................................ 32
重建滤波器................................................ ................. 32
FDBK_IN输入................................................ ........................ 33
参考输入................................................ ......................... 33
系统时钟输入................................................ ........................... 33
谐波杂散降低............................................... ......... 35
输出时钟驱动器和2 ×倍频............. 36
频率回转限制器............................................... .............. 37
频率估计................................................ .................. 37
状态和警告............................................... .................... 39
热性能................................................ .................... 41
上电............................................... .......................................... 42
上电复位.............................................. ............................ 42
编程序列................................................ ............ 42
供电分区............................................... .............. 43
3.3 V电源............................................... ............................... 43
1.8 V电源............................................... ............................... 43
串行控制端口............................................... .......................... 44
串行控制端口引脚说明....................................... 44
串行控制端口的操作............................................. 44
指令字( 16位) ........................................... ..... 45
MSB / LSB优先传输............................................. .............. 45
I / O寄存器映射............................................. ............................... 48
I / O寄存器说明............................................. ................. 53
串行端口配置(寄存器0x0000到注册
0x0005) ........................................................................................ 53
掉电复位(寄存器0×0010到寄存器0x0013 )
....................................................................................................... 53
系统时钟(寄存器为0x0020至寄存器0x0023 ) ............. 54
数字锁相环控制和分频器(寄存器0100到
注册0x0130 ) .............................. .......................... 55
自由运行(单频)模式(注册0x01A0来注册
0x01AD ) ................................................ ...................................... 61
参考选择/缓缴(注册0x01C0到注册
0x01C3 ) ................................................ ........................................ 62
倍频器和输出驱动器(寄存器0x0200至寄存器
0x0201) ........................................................................................ 63
监控(寄存器0x0300至寄存器0x0335 ) ....................... 64
校准(用户可访问的修剪) (注册的0x0400到
注册0x0410 ) .............................. .......................... 70
谐波杂散抑制(寄存器0x0500至寄存器
0x0509) ........................................................................................ 71
应用信息................................................ .............. 73
示例应用电路............................................... ...... 73
外形尺寸................................................ ....................... 74
订购指南................................................ .......................... 74
修订版D |页76 2
AD9549
修订历史
12月10日 - 修订版。 C到Rev. D的
更改我
AVDD
(引脚19 ,引脚23与引脚26 ,引脚29 ,引脚30 ,
Pin44 ,引脚45 )参数............................................ ..................... 4
更改总功耗参数和添加
尾4 ................................................ ........................................... 5
更改销59说明............................................. ......... 11
更改直接数字频率合成器( DDS )第............... 20
更改加电科............................................ ........... 42
更改地址为0x0002默认值(见表13 ) ........... 48
更改地址的0x0400和地址0x40E默认值
(表13 ) ............................................. ........................................ 52
5/10 -REV 。 B到C版
删除的64引脚LFCSP封装( CP- 64-1 ) .................................通用
更改系统时钟使能PLL /最小差分输入
Level参数,表2 ............................................. ...................... 6
更新的外形尺寸............................................... ......... 74
更改订购指南.............................................. ............. 74
1月10日 - 修订版。 A到版本B
更改I / O寄存器映射部分,介绍和
表13 ................................................ ............................................. 48
更改寄存器0x0405至寄存器0x0408 ,并保留
部分................................................. ............................................. 70
新增注册0x0406 ,部分版本部分........................... 71
12/09 -REV 。 0到版本A
添加了64引脚LFCSP ( CP- 64-7 ) ...................................通用
更改总功耗参数............................ 5
更改串行端口时序规范和
传播延迟参数............................................... ......... 8
添加裸露焊盘符号图2 ;更改
表4 ................................................ ............................................... 10
纠正DDS相位偏移分辨率从16位到
14位整;改图25 .................................... 20
更改锁相检测组.................................. 24
变化图30 .............................................. .......................... 25
更改的借鉴和参考频率损耗
Monitor部分................................................ ............................. 26
改变输出频率范围控制部............... 32
变化图46 .............................................. .......................... 36
更改频率估计第.................................... 37
更改编程序列第.............................. 42
更改电源分区段........................... 43
切换到串行控制端口部分......................................... 44
图54 ..............................................变化........................ 46
添加裸露焊盘符号来外形尺寸和
更改订购指南.............................................. ............. 74
8月7日 - 修订版0 :初始版
修订版D |第76 3
AD9549
特定网络阳离子
DC特定网络阳离子
AVDD = 1.8 V± 5 % , AVDD3 = 3.3 V± 5 % , DVDD = 1.8 V± 5 % , DVDD_I / O = 3.3 V± 5 % 。 AVSS = 0V , DVSS = 0V时,除非另有说明。
表1中。
参数
电源电压
DVDD_I / O(引脚1 )
DVDD (引脚3 ,引脚5 ,引脚7 )
AVDD3 ( 14脚, 46脚, 47脚, 49脚)
AVDD3 (引脚37 )
AVDD (引脚11 ,引脚19 ,引脚23与引脚26 ,引脚29 ,
30针, 36针, 42针, 44针, 45针, 53针)
电源电流
I
AVDD3
(引脚14)的
I
AVDD3
(引脚37 )
I
AVDD3
(引脚46 ,引脚47 ,引脚49 )
I
AVDD
(引脚36 ,引脚42 )
I
AVDD
(引脚11 )
I
AVDD
(引脚19 ,引脚23与引脚26 ,引脚29 ,
引脚30 ,引脚44 ,引脚45)
I
AVDD
(引脚53 )
I
DVDD
( 3针, 5针, 7针)
I
DVDD_I / O
(引脚1)
逻辑输入(除了引脚32 )
输入高电压(V
IH
)
低输入电压(V
IL
)
输入电流(I
INH
, I
INL
)
最大输入容量(C
IN
)
CLKMODESEL (引脚32 )逻辑输入
输入高电压(V
IH
)
低输入电压(V
IL
)
输入电流(I
INH
, I
INL
)
最大输入容量(C
IN
)
逻辑输出
输出高电压(V
OH
)
输出低电压(V
OL
)
参考输入
输入电容
输入阻抗
微分运算
共模输入电压
1
(适用时直流耦合)
差分输入电压摆幅
1
单端工作
输入高电压( V
IH
)
输入电压低(V
IL
)
阈值电压
输入电流
FDBK_IN输入
输入电容
输入阻抗
差分输入电压摆幅
2
3.135
1.71
3.135
1.71
1.71
典型值
3.30
1.80
3.30
3.30
1.80
最大
3.465
1.89
3.465
3.465
1.89
单位
V
V
V
V
V
测试条件/评论
销37通常是3.3V,但也可以设定为1.8伏
4.7
3.8
26
21
12
215
41
254
4
2.0
DVSS
±60
3
1.4
AVSS
18
3
5.6
4.5
29
26
15
281
49
265
6
DVDD_I / O
0.8
±200
mA
mA
mA
mA
mA
mA
mA
mA
mA
V
V
A
pF
V
V
A
pF
REFA , REFB缓冲区
在3.3 V CMOS输出时钟驱动器
DAC输出电流源,女
S
= 1 GSPS
FDBK_IN输入, HSTL输出时钟驱动器
(输出倍增接通)
REFA和REFB输入缓冲区1.8 V电源
总结模拟电源,包括系统
时钟PLL
DAC电源
数字内核
数字I / O(动态变化)
9针, 10针, 54针到61针, 63针, 64针
在V
IN
= 0 V和V
IN
= DVDD_I / O
引脚32只
AVDD
0.4
50
在V
IN
= 0 V和V
IN
- AVDD
引脚62和以下的双向引脚:
9针, 10针, 54针, 55针, 63针
I
OH
= 1毫安
I
OL
= 1毫安
12脚, 13脚, 15脚, 16脚
差是在注册0x040F [1: 0] = 00
差异化经营;注意, LVDS信号
必须是交流耦合
微分运算
寄存器0x040F [1:0 ] = 10
2.7
DVSS
3
11.5
DVDD_I / O
0.4
V
V
pF
k
V
mV的P-P
8.5
1.5
500
2.0
AVSS
AVDD3 -
0.66
14.5
AVDD3 -
0.2
AVDD3 -
0.82
AVDD3
0.8
AVDD3 -
0.98
1
V
V
V
mA
pF
k
mV的P-P
寄存器0x040F [1:0 ] = 10 (其他设定
可能的话)
单端工作
40针, 41针
迪FF erential
-12 dBm的50Ω ;必须是交流耦合
18
225
3
22
26
修订版D |第76 4
AD9549
参数
系统时钟输入
系统时钟PLL旁路
输入电容
输入阻抗
内部产生的直流偏置电压
2
差分输入电压摆幅
3
系统时钟PLL使能
输入电容
输入阻抗
内部产生的直流偏置电压
2
差分输入电压摆幅
3
晶体谐振器与系统时钟使能PLL
串联电阻
时钟输出驱动
HSTL输出驱动器
差分输出电压摆幅
共模输出电压
2
CMOS输出驱动器
输出电压高(V
OH
)
输出电压低(V
OL
)
输出电压高(V
OH
)
输出电压低(V
OL
)
总功耗
所有模块运行
4
掉电模式
数字掉电模式
默认情况下与系统时钟使能PLL
默认情况下与系统时钟PLL禁用
与REFA或REFB掉电
与HSTL时钟驱动器掉电
随着CMOS时钟驱动器掉电
必须是
≤0
V相对于AVDD3 (引脚14 )和
≥0
V相对于AVSS (引脚33 ,引脚43 ) 。
相对于AVSS (引脚33 ,引脚43 ) 。
3
必须是
≤0
V相对于AVDD (引脚36)和≥0 V相对于AVSS (引脚33 ,引脚43 ) 。
4
典型的测量,只有REFA和HSTL输出的倍频进行关闭。
1
2
典型值
最大
单位
测试条件/评论
系统时钟输入端应始终AC-
加上(包括单端和差分)
单端,每个引脚
迪FF erential
0 dBm的50Ω
单端,每个引脚
迪FF erential
0 dBm的50Ω
25兆赫, 3.2毫米×2.5毫米,切
2.4
0.93
632
1.5
2.6
1.17
2.8
1.38
pF
k
V
mV的P-P
pF
k
V
mV的P-P
2.4
0.93
632
3
2.6
1.17
2.8
1.38
9
100
1080
0.7
1280
0.88
1480
1.06
mV
V
输出驱动器静电;看
图12
输出
摆动与频率的关系
输出驱动器静电;看
图13
图14
输出摆幅与频率的关系
2.7
0.4
1.4
0.4
1060
24
565
955
945
1310
70
713
V
V
V
V
mW
mW
mW
mW
mW
mW
mW
mW
I
OH
= 1毫安, (引脚37 )= 3.3 V
I
OL
= 1毫安, (引脚37 )= 3.3 V
I
OH
= 1毫安, (引脚37 )= 1.8 V
I
OL
= 1毫安, (引脚37 )= 1.8 V
最坏的情况下在电源,温度,工艺
无论使用哪种电源关闭,并启用
寄存器(寄存器0×0010 )或PWRDOWN销
复位或上电时使用f后
S
= 1 GHz的,
S4 = 0, S1至S3 = 1中,f
系统时钟
= 25 MHz的
复位或上电时使用f后
S
= 1 GHz的,
S1至S4 = 1
一个参考还是电
1115
1105
1095
1107
修订版D |第76 5
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    -
    -
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