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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1705页 > AD9523BCPZ
数据表
特点
抖动消除器和时钟发生器,
14差分或29路LVCMOS输出
AD9523
功能框图
OSC_IN , OSC_IN
REFA ,
REFA
REFB ,
REFB
REF_TEST
PLL1
PLL2
输出频率: <1 MHz至1 GHz
启动频率精度: < ± 100 ppm的(由下式确定
VCXO参考精度)
零延迟操作
输入至输出边沿时序: <150 PS
14输出:可配置的LVPECL , LVDS ,HSTL和LVCMOS
14专用输出分频器与无抖动可调延迟
可调延时: 63分辨率的步骤和frac12 ; VCO期
输出分频器
输出至输出偏斜: <50 PS
占空比校正奇数分频器设置
上电时所有输出自动同步
绝对输出抖动: <200 FS在122.88兆赫
积分范围: 12 kHz至20MHz的
分布相位噪声地板: -160 dBc的/赫兹
数字锁定检测
非易失性EEPROM存储配置设置
支持SPI和IC兼容的串行控制端口
双PLL架构
PLL1
低带宽参考输入时钟与清理
外置VCXO
300 kHz至75 MHz的相位检测率
冗余参考输入
自动和手动参考切换模式
回切和nonrevertive开关
参考检测与保持模式的损失
从VCXO低噪声输出LVCMOS用于RF / IF
合成
PLL2
高达250 MHz的相位检测率
集成低噪声VCO
AD9523
OUT0,
OUT0
OUT1,
OUT1
SCLK / SCL
SDIO / SDA
SDO
控制
接口
( SPI和I
2
C)
延迟
EEPROM
14-CLOCK
分配
OUT12,
OUT12
OUT13,
OUT13
ZD_IN , ZD_IN
图1 。
概述
该AD9523提供了一个低功耗,多路输出,时钟分配
函数具有低抖动性能,以及一个片内PLL
和VCO 。片内VCO调谐从3.6 GHz到4.0 GHz的。
在AD9523被定义为支持的时钟要求
长期演进( LTE)和多载波GSM基站
设计。它依靠外部VCXO ,以提供参考
抖动清除,以达到严格的低相位噪声要求一
必要时可接受的数据转换器的SNR性能求。
输入接收器,振荡器和零延迟接收器提供
两个单端和差分工作模式。当连接
到恢复的系统参考时钟和VCXO时,器件
产生14的低噪声输出,射程达1 MHz至1 GHz ,
和一个专用的输入PLL ( PLL1 )输出缓冲。
的频率和一个时钟输出相的相到另一
时钟输出可以通过一个分频器相位选择的装置来改变
功能,它充当一个无抖动的粗定时调整
增量是等于信号的半个周期
走出VCO的。
一个封装内EEPROM可以通过串行编程
接口的电存储用户定义寄存器设置
和芯片复位。
应用
LTE和多载波GSM基站
无线和宽带基础设施
医疗器械
时钟高速ADC , DAC的, DDS中, DDC的,公爵, MxFEs
低抖动,低相位噪声时钟分配
时钟产生和转换为SONET , 10GE , 10G FC ,
和其它10 Gbps协议
前向纠错( G.710 )
高性能无线收发器
ATE和高性能仪器仪表
版本C
文档反馈
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
电话: 781.329.4700 2010-2013 ADI公司保留所有权利。
技术支援
www.analog.com
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第三方可能导致其使用的权利。规格如有变更,恕不另行通知。没有
获发牌照以暗示或其他方式ADI公司的任何专利或专利权。
商标和注册商标均为其各自所有者的财产。
08439-001
AD9523
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
功能框图............................................... ............... 1
概述................................................ ......................... 1
修订历史................................................ ............................... 3
规格................................................. .................................... 4
情况................................................. .................................... 4
电源电流................................................ .............................. 4
功耗................................................ ......................... 5
REFA , REFA , REFB , REFB , OSC_IN , OSC_IN和ZD_IN ,
ZD_IN输入特性............................................... 5 .......
OSC_CTRL输出特性.......................................... 6
REF_TEST输入特性............................................... 6
PLL1特征................................................ .................... 6
PLL1输出特性............................................... 6 .......
分配输出特性( OUT0 , OUT0到
OUT13 , OUT13 ) .............................................. ............................ 7
定时校准特性............................................ 8
抖动和噪声特性.............................................. 8 ....
PLL2特征................................................ .................... 8
逻辑输入引脚-PD , EEPROM_SEL , REF_SEL , RESET ,
SYNC ................................................. ............................................. 9
状态输出引脚, STATUS1 , STATUS0 ............................... 9
串行控制端口, SPI模式............................................ ...... 9
串行控制端口, IC模式............................................ .... 10
绝对最大额定值............................................... ........... 12
热阻................................................ .................... 12
ESD注意事项................................................ ................................ 12
引脚配置和功能描述........................... 13
典型性能特征........................................... 16
输入/输出端接建议.......................... 18
数据表
术语................................................. ................................... 19
工作原理............................................... ....................... 20
详细框图............................................... ............. 20
概述................................................. .................................... 20
组件模块,输入PLL ( PLL1 ) ................................. 21
组件模块输出PLL ( PLL2 ) .............................. 22
时钟分配................................................ ..................... 24
零延迟操作............................................... ................. 26
复位方式................................................ ................................ 26
掉电模式.............................................. ...................... 27
串行控制端口............................................... .......................... 28
SPI / IC端口选择............................................. ................... 28
IC串行口工作.............................................. ............ 28
SPI串行端口操作.............................................. ............ 31
SPI指令字(16位) ........................................... ...... 32
SPI MSB / LSB优先传输............................................ ........ 32
EEPROM的操作................................................ ..................... 35
写EEPROM .............................................. ............. 35
从EEPROM中读取.............................................. ....... 35
编程EEPROM缓冲段......................... 36
功耗和散热考虑....................... 38
时钟速度和驱动程序模式............................................. .... 38
评估工作条件的........................................ 38
热增强型封装安装指南............ 39
控制寄存器................................................ ............................ 40
控制寄存器映射............................................... ................. 40
控制寄存器映射位说明................................... 45
外形尺寸................................................ ....................... 57
订购指南................................................ .......................... 57
版本C | 60页2
数据表
修订历史
2/13 -REV 。 B到C版
删除VDD1.8_PLL2 ..............................................纵观
更改数据表标题............................................. ................ 1
加入叔
J
115 ° C,表1 ........................................... ................... 4
改变了VDD3_PLL1 ,电源电压为典型PLL1
参数从22毫安至37 mA和更改VDD3_PLL1 ,
电源电压为PLL1最大参数25.2 mA至
43毫安,表2 ............................................. ...................................... 4
更改表3 .............................................. .............................. 5
新增PLL1特性部分和表7 ;重新编号
依次................................................. ....................................... 6
更改表9汇总表........................................ 7
更改引脚7说明,表19 ....................................... 13
改销69从VDD1.8_PLL2到NC ,表19 .............. 15
图23 ..............................................变化........................ 21
更改时钟分配同步部分.......... 25
图29 ..............................................变化........................ 26
增加了复位模式科和锁定检测科.............. 26
加入掉电模式第............................................ ..27
更改引脚说明部分和阅读部分............ 31
加入图38 ;重新编号,按顺序............................... 33
更改寄存器段定义组第............ 36
切换到功耗和散热考虑
部分................................................. ............................................. 38
更改表31 .............................................. .......................... 40
改变位[1: 0 ]说明,表40和第2位
说明,表41 .............................................. ........................ 46
更改位[7 : 6 ]说明,表42 .................................. 47
更改位[ 1 : 0 ]说明,表43 .................................. 48
切换到第4位,位[ 3 : 2 ]说明,表47 ..................... 49
从状态PLL2反馈时钟到状态改变bit 6名
PLL1反馈时钟,表54 ............................................ ........... 52
3月11日 - 修订版。 A到版本B
AD9523
添加汇总表,表8 ............................................ ........... 7
更改EEPROM的操作部分和写作的
EEPROM部分................................................ ............................ 34
更改0x01A位[ 4 : 3 ] ,表30 ..................................... ..... 39
更改位[ 4 : 3 ] ,表....................................... 40 ................ 46
更改表47 ,第1位........................................... ................... 48
11/10 -REV 。 0到版本A
更改为一般说明.............................................. ......... 1
更改汇总表,表1 ........................................... 3 ....
切换到输入高电压和输入低电压
参数和添加输入阈值电压参数,
表4 ................................................ ................................................. 4
更改为结温额定值,表16 ;变化
以热阻第.............................................. ........ 11
更改表18 .............................................. .......................... 12
补充图14 ,重新编号按顺序............................... 16
编辑图15,图17,图19 ................................ 17
更改VCO校准部分........................................... 22
改变后的输出模式前往多模输出
驱动程序;切换到多模输出驱动部分;
补充图26 ............................................... ............................... 23
增加功耗和散热考虑
部分;添加表29 ,按顺序重新编号.................. 35
更改表34 ,表35 ,表36 ,表38 ............... 43
更改地址0x192 ,表50 ........................................... 。 48
更改表52 .............................................. .......................... 49
更改表54 .............................................. .......................... 50
7月10日 - 修订版0 :初始版
版本C | 60页3
AD9523
特定网络阳离子
数据表
f
VCXO
= 122.88 MHz的单端, REFA和REFB上的差异,在30.72兆赫,女
VCO
= 3932.16兆赫,倍频为关闭,通道控制低
功率模式关闭,分频相位= 1,除非另有说明。典型给出了VDD = 3.3V ± 5 % ,而T
A
= 25 ℃,除非另有
指出。的最大值和最小值,给出整个VDD和T
A
(-40 ℃至+ 85 ℃)的变化,如表1所列。
条件
表1中。
参数
电源电压
VDD3_PLL1 ,电源电压为PLL1
VDD3_PLL2 ,电源电压为PLL2
VDD3_REF ,电源电压时钟输出驱动器参考
VDD3_OUT [X :Y ]
1
电源电压时钟输出驱动器
VDD1.8_OUT [X :Y ]
1
电源电压时钟分频器
温度
环境温度范围,T
A
结温,T
J
1
典型值
3.3
3.3
3.3
3.3
1.8
最大
单位
V
V
V
V
V
测试条件/评论
3.3 V ± 5%
3.3 V ± 5%
3.3 V ± 5%
3.3 V ± 5%
1.8 V ± 5%
40
+25
+85
115
°C
°C
x和y是在对共享相同的电源差分输出。例如, VDD3_OUT [ 0 : 1 ]为电源电压时钟输出OUT0 , OUT0 (引脚68和引脚67 ,
分别)和电源电压时钟输出OUT1 , OUT1 (引脚65和引脚64 ,分别) 。
电源电流
表2中。
参数
耗材除外时钟输出驱动
VDD3_PLL1 ,电源电压为PLL1
VDD3_PLL2 ,电源电压为PLL2
VDD3_REF ,电源电压时钟输出驱动器参考
LVPECL模式
典型值
37
67
5
最大
43
77.7
6
单位
mA
mA
mA
测试条件/评论
9 mA典型,如果REFB关闭减少
LVDS模式
4
4.8
mA
HSTL模式
CMOS模式
VDD1.8_OUT [X :Y ]
1
电源电压时钟分频器
2
时钟输出驱动
LVDS模式, 7毫安
VDD3_OUT [X :Y ]
1
电源电压时钟输出驱动器
LVDS模式下, 3.5毫安
VDD3_OUT [X :Y ]
1
电源电压时钟输出驱动器
LVPECL模式
VDD3_OUT [X :Y ]
1
电源电压时钟输出驱动器
HSTL模式, 16毫安
VDD3_OUT [X :Y ]
1
电源电压时钟输出驱动器
HSTL模式, 8毫安
VDD3_OUT [X :Y ]
1
电源电压时钟输出驱动器
CMOS模式(单端)
VDD3_OUT [X :Y ]
1
电源电压时钟输出驱动器
1
3
3
3.5
3.6
3.6
4.2
mA
mA
mA
只有一个输出驱动器导通;每个
即接通附加的输出,该
1.2 mA(最大值)电流增量
只有一个输出驱动器导通;每个
即接通附加的输出,该
1.2 mA(最大值)电流增量
值是独立的数目
输出开启
值是独立的数目
输出开启
目前每个分: F = 245.76兆赫
16
5
17
21
14
2
17.4
6.2
18.9
24.0
16.3
2.4
mA
mA
mA
mA
mA
mA
F = 61.44 MHz的
F = 245.76兆赫
F = 122.88兆赫
F = 122.88兆赫
F = 122.88兆赫
F = 15.36兆赫, 10 pF负载
x和y是在对共享相同的电源差分输出。例如, VDD3_OUT [ 0 : 1 ]为电源电压时钟输出OUT0 , OUT0 (引脚68和引脚67 ,
分别)和电源电压时钟输出OUT1 , OUT1 (引脚65和引脚64 ,分别) 。
2
目前对于引脚63 ( VDD1_OUT [0: 3])为2×的其他VDD11.8_OUT [X : Y]的对。
版本C | 60页4
数据表
功耗
表3中。
参数
功耗
典型配置
典型值
876
最大
970
单位
mW
AD9523
PD ,掉电
增量功耗
低功耗典型配置
输出分配,驱动器上
LVDS
LVPECL
HSTL
CMOS
101
389
132.2
450
mW
mW
测试条件/评论
不包括电力消耗在终端电阻
运行时钟分配输出如下: 7 LVPECL输出
在122.88兆赫, 3路LVDS输出(3.5 mA)的在61.44 MHz的三
LVDS输出(3.5 mA)的在245.76兆赫,一是CMOS 10pF的负载
122.88兆赫,并在30.72 MHz的一路差分输入参考;
f
VCXO
= 122.88兆赫,女
VCO
= 3932.16兆赫; PLL2 BW = 530 kHz时,
倍频已关闭
PD引脚拉低,具有典型的配置情况
绝对总功率时钟分配; 1 LVPECL输出
在122.88 MHz的运行;在一个差分输入参考
30.72 MHz的; F
VCXO
= 122.88兆赫,女
VCO
= 3932.16兆赫;倍频已关闭
增量动力增长( OUT1)从低功率的典型
单3.5毫安LVDS输出, 245.76 MHz的
单7毫安LVDS输出61.44 MHz的
单LVPECL输出122.88兆赫
在122.88 MHz单通道8毫安HSTL输出
在122.88 MHz单通道16毫安HSTL输出
在15.36 MHz单通道3.3 V CMOS输出
在122.88 MHz双通道互补的3.3 V CMOS输出
双列相3.3 V CMOS ,在122.88 MHz的输出
15.3
47.8
50.1
40.2
43.7
6.6
9.9
9.9
18.4
55.4
54.9
46.3
50.3
7.9
11.9
11.9
mW
mW
mW
mW
mW
mW
mW
mW
REFA , REFA , REFB , REFB , OSC_IN , OSC_IN ,和ZD_IN , ZD_IN输入特性
表4 。
参数
差模
输入频率范围
输入压摆率( OSC_IN )
共模内部
产生的输入电压
输入共模范围
差分输入电压,
灵敏度频率< 250兆赫
差分输入电压,
灵敏度频率> 250兆赫
差分输入电阻
差分输入电容
占空比
脉冲宽度低
脉冲宽度高
CMOS模式单端输入
输入频率范围
输入高电压
输入低电压
输入阈值电压
输入电容
占空比
脉冲宽度低
脉冲宽度高
典型值
最大
400
400
0.6
1.025
100
200
4.8
1
1
1
250
1.62
0.52
1.0
1
1.6
1.6
0.7
0.8
1.475
单位
兆赫
V / μs的
V
V
mV的P-P
mV的P-P
k
pF
占空比范围是由脉冲宽度和高脉冲宽度设定低
ns
ns
兆赫
V
V
V
pF
占空比范围是由脉冲宽度和高脉冲宽度设定低
ns
ns
版本C | 60页5
测试条件/评论
征收抖动性能的最低限额
对于直流耦合LVDS (最大摆幅)
所需的电容耦合;可容纳单端
未使用的输入交流电的接地输入;瞬时电压
无论引脚上不得超过1.8 V直流电源轨
所需的电容耦合;可容纳单端
未使用的输入交流电的接地输入;瞬时电压
无论引脚上不得超过1.8 V直流电源轨
当交流耦合到输入接收器时,用户必须直流偏置的
输入1 V ;单端CMOS输入为3.3 V兼容
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    -
    -
    -
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22+
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QFN
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