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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1686页 > AD9517-3ABCPZ
数据表
特点
低相位噪声,锁相环(PLL)的
片内VCO调谐从1.75 GHz到2.25 GHz的
外部VCO / VCXO至2.4 GHz的可选
1路差分或2路单端基准输入
参考监控能力
返回式自动和手动参考
切换/缓缴模式
接受LVPECL , LVDS或CMOS的参考频率为250 MHz
在路径PFD可编程延迟
数字或模拟锁定检测,可选
2双1.6 GHz的LVPECL输出
每对输出共用一个1至32分频器用粗
相位延迟
添加剂输出抖动: 225 fs的有效值
通道至通道偏移配对的<10 ps的输出
2双800MHz的LVDS时钟输出
每对输出共用两个级联的1至32分频器
粗相位延迟
添加剂输出抖动: 275 fs的有效值
精延时每个LVDS输出调节( ΔT)
每个LVDS输出可重新配置为两路250 MHz
CMOS输出
上电时所有输出自动同步
手动输出同步提供
采用48引脚LFCSP封装
12路输出时钟发生器,
集成2.0 GHz的VCO
AD9517-3
功能框图
CP
LF
切换
和监控
REF1
REFIN
REF2
状态
MONITOR
PLL
VCO
CLK
分频器
及的MUX
DIV / Φ
DIV / Φ
DIV / Φ
DIV / Φ
DIV / Φ
DIV / Φ
Δt
Δt
Δt
Δt
LVPECL
LVPECL
LVDS / CMOS
LVDS / CMOS
OUT0
OUT1
OUT2
OUT3
OUT4
OUT5
OUT6
OUT7
图1 。
AD9517-3
具有四个LVPECL输出(两对)
和4路LVDS输出(两对) 。每个LVDS输出可
重新配置为两个CMOS输出。 LVPECL输出
操作以1.6 GHz时, LVDS输出工作于800 MHz和
在CMOS输出工作频率为250 MHz 。
对于需要额外的输出应用中,晶体参考
输入,零延迟,或EEPROM用于在自动配置
启动时,该
AD9520
AD9522
是可用的。此外,
AD9516
AD9518
类似于
AD9517
但有
不同组合的输出。
每对输出都有分频器,使两者的鸿沟
比和粗调延迟(或相位)进行设置。划分范围
对于LVPECL输出为1至32。 LVDS / CMOS输出
允许的范围内分割最多1024 。
AD9517-3
在一个48引脚LFCSP封装,可以是
从3.3 V单电源供电。外部VCO ,这
需要更大的电压范围内,可以容纳
通过将电荷泵电源(VCP )至5伏的单独
LVPECL电源可以为2.5 V至3.3 V (标称值) 。
AD9517-3
是在工业中指定的操作
范围为-40 ° C至+ 85°C 。
1
应用
低抖动,低相位噪声时钟分配
10/40/100 Gb /秒的网络线卡,包括SONET ,
同步以太网, OTU2 / 3/4
前向纠错( G.710 )
时钟高速ADC , DAC的, DDS中, DDC的,公爵, MxFEs
高性能无线收发器
ATE和高性能仪器仪表
概述
AD9517-3
1
提供多路输出时钟分配
功能与亚皮秒级抖动性能,以及一个
片上PLL和VCO 。从1.75 GHz的片上VCO调谐
以2.25千兆赫。任选的,最多的一个外部VCO / VCXO
2.4GHz的都可以使用。
AD9517-3
强调低抖动和相位噪声
最大化数据转换器的性能,并且它可以有益于其他
应用苛刻的相位噪声和抖动要求。
AD9517是用于整个数据表来引用的所有成员
AD9517系列。然而,当AD9517-3时,它指的是特定
在AD9517家庭成员。
英文内容
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责任承担ADI公司供其使用,也为专利或其他任何侵权行为
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技术支援
www.analog.com
06427-001
串行控制端口
数字逻辑
AD9517-3
AD9517-3
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
概述................................................ ......................... 1
功能框图............................................... ............... 1
修订历史................................................ ............................... 3
规格................................................. .................................... 4
电源要求............................................... 4 ........
PLL特征................................................ ...................... 4
时钟输入................................................ .................................. 6
时钟输出................................................ ............................... 6
时序特性................................................ ................ 8
时钟输出添加剂相位噪声(仅分发;
VCO分频器未使用) ............................................. ................. 9
时钟输出绝对相位噪声( VCO内部使用) .. 10
时钟输出绝对时间抖动(时钟发生器
使用内部VCO ) .............................................. .................... 11
时钟输出绝对时间抖动(时钟清理
使用内部VCO ) .............................................. .................... 11
时钟输出绝对时间抖动(时钟发生器
使用外部VCXO ) .............................................. ................ 11
时钟输出添加剂时抖动( VCO分频器
未使用) .............................. ...................................... 12
时钟输出添加剂时抖动( VCO分频器使用) ..... 12
延迟块加时间抖动............................................. 13
串行控制端口............................................... ...................... 13
PD , SYNC ,和RESET引脚........................................... .......... 14
LD ,状态和REFMON销........................................... 14
功耗................................................ ....................... 15
时序图................................................ ............................ 16
绝对最大额定值............................................... ........... 17
热阻................................................ .................... 17
数据表
ESD注意事项................................................ ................................ 17
引脚配置和功能描述........................... 18
典型性能特征........................................... 20
术语................................................. ................................... 26
详细框图............................................... ................. 27
工作原理............................................... ....................... 28
操作配置................................................ ...... 28
数字锁定检测( DLD ) ............................................ ........... 37
时钟分配................................................ ..................... 41
复位方式................................................ ................................ 49
掉电模式.............................................. .................... 50
串行控制端口............................................... .......................... 51
串行控制端口引脚说明....................................... 51
串行控制端口的一般操作............................... 51
指令字( 16位) ........................................... ..... 52
MSB / LSB优先传输............................................. .............. 52
热性能................................................ .................... 55
控制寄存器................................................ ............................ 56
控制寄存器映射概述.............................................. 56
控制寄存器映射说明......................................... 59
应用信息................................................ .............. 76
频率规划使用AD9517 .................................. 76
利用AD9517输出的ADC时钟应用.... 76
LVPECL时钟分配............................................... ...... 77
LVDS时钟分配............................................... ........... 77
CMOS时钟分配............................................... ......... 78
外形尺寸................................................ ....................... 79
订购指南................................................ .......................... 79
修订版E |页80 2
数据表
修订历史
3月13日 - 修订版。 D钮英文内容
更改表52 .............................................. .......................... 57
更改表57 .............................................. .......................... 70
1月12日 - 修订版。 C到Rev. D的
更改表62 .............................................. .......................... 75
5月11日 - 修订版。 B到C版
更改功能,应用程序,并概述
部分................................................. 1 ..............................................
切换到CPRSET引脚电阻参数,表1 .................... 4
更改表2 .............................................. .............................. 4
更改表4 .............................................. .............................. 6
更改为逻辑1电流和逻辑0当前
参数表15 .............................................. ......................... 14
更改表20 .............................................. .......................... 18
更改为标题,图8 ............................................ .............. 20
更改为标题,图15 ............................................ ............ 21
更改为标题,图25和图26 ............................. 23
加入图41 ;重新编号,按顺序............................... 25
更改片内VCO第........................................... .... 34
更改参考切换章节................................... 35
更改预分频,然后变化到
评论/条件列,表28 ................................... 36
更改为自动/内部保持模式科
和频率状态监控科....................................... 39
更改VCO校准部分........................................... 40
更改时钟分配部分........................................ 41
更改写第.............................................. ................. 51
改变指令字( 16位)第.................... 52
变化图65 .............................................. .......................... 53
切换到热性能第.................................... 55
更改注册地址量0x01C位[ 4 : 3 ] ,表52 ............ 56
更改地址0x017的位[ 1 : 0 ]和地址为0x018 ,
位[ 2:0] ,如表54 ......................................... ................................... 62
更改注册地址量0x01C位[ 5 : 1 ] ,表54 ............ 64
更改为LVPECL时钟分配部分......................... 77
5/10 -REV 。 A到版本B
更改默认LVDS / CMOS输出的价值观
表52节.............................................. ............................ 56
更改注册量0x140的位0 ;寄存器0x142的位0 ;
寄存器0x143的位0表57 .......................................... ......... 69
更新的外形尺寸,更改订购指南..... 78
1月10日 - 修订版。 0到版本A
AD9517-3
增加了48引脚LFCSP封装( CP- 48-8 ) ....................通用
更改功能,应用程序,并概述1 .....
更改为CPRSET引脚电阻参数.................................. 4
更改表4 .............................................. .............................. 6
更改V
CP
电源参数................................................ 14
更改表19 .............................................. .......................... 16
添加裸露焊盘符号图6 ;更改
表20 ................................................ ............................................. 17
切换到高频时钟分配-CLK或
外部VCO > 1600 MHz的部分;更改表22 .......... 27
更改表24 .............................................. .......................... 29
改变配置和寄存器设置部分........... 31
改变相位频率检测器( PFD )第................ 32
更改电荷泵( CP ) ,片上VCO , PLL
外部环路滤波器和PLL参考输入部分......... 33
切换到图46 ;补充图47 ......................................... 33
更改参考切换和VCXO / VCO
反馈分频器N-P , A, B,R第.................................... 34
更改表28 .............................................. .......................... 35
更改为缓缴部分.............................................. ............ 37
更改VCO校准部分........................................... 39
更改时钟分配部分........................................ 40
改变时钟频率分割单元;
更改为表34 .............................................. ............................ 41
更改通道分频器- LVDS / CMOS输出
部分;更改为表39 .............................................. ............. 43
更改写第.............................................. .................. 50
更改为MSB / LSB优先传输........................................... .. 51
变化图64 .............................................. .......................... 52
添加了散热性能部分.......................................... 54
更改0x003寄存器地址............................................. 。 55
更改表53 .............................................. .......................... 58
更改表54 .............................................. .......................... 59
更改表55 .............................................. .......................... 65
更改表56 .............................................. .......................... 67
更改表57 .............................................. .......................... 69
更改表58 .............................................. .......................... 71
更改表59 .............................................. .......................... 72
更改表60和表61 ........................................... ...... 74
增加了频率规划使用AD9517科............ 75
变化图70和图72 ;增加了图71 .............. 76
更改LVDS时钟分配部分............................ 76
添加裸露焊盘的符号来外形尺寸......... 78
更改订购指南.............................................. ............. 78
7月7日 - 修订版0 :初始版
修订版E |第80 3
AD9517-3
特定网络阳离子
数据表
典型给出了V
S
= V
S_LVPECL
= 3.3 V ± 5%; V
S
≤ V
CP
= 5.25 V ;牛逼
A
= 25°C ; RSET = 4.12 kΩ的; CPRSET = 5.1千欧,除非另有说明。
的最大值和最小值,给出了整个V
S
和T
A
( -40 ° C至+ 85°C )的变化。
电源要求
表1中。
参数
V
S
V
S_LVPECL
V
CP
RSET引脚电阻
CPRSET引脚电阻
旁路引脚电容
3.135
2.375
V
S
2.7
典型值
3.3
最大
3.465
V
S
5.25
10
单位
V
V
V
k
k
nF
测试条件/评论
3.3 V ± 5%
标称2.5 V至3.3 V± 5 %
标称3.3 V至5.0 V± 5 %
设置内部偏置电流;连接到接地
设置内部CP电流范围,名义上4.8毫安( CP_lsb = 600 μA) ;
实际的电流可以通过CP_lsb = 3.06 / CPRSET计算;
连接到接地
旁路内部LDO稳压器;必要LDO的稳定性;
连接到接地
4.12
5.1
220
PLL特性
表2中。
参数
VCO ( ON- CHIP)
频带
VCO增益(K
VCO
)
调谐电压(V
T
)
频推(开环)
相位噪声在100 kHz偏置
在1 MHz的相位噪声抵消
参考输入
差模( REFIN , REFIN )
输入频率
输入灵敏度
自偏压, REFIN
自偏压, REFIN
输入电阻, REFIN
输入电阻, REFIN
双通道单端模式( REF1 , REF2 )
输入频率(交流耦合)
输入频率(直流耦合)
输入灵敏度(交流耦合)
输入逻辑高
输入逻辑低电平
输入电流
脉冲宽度高/低
输入电容
相位/频率检测器( PFD )
PFD输入频率
反冲脉冲宽度
1.3
2.9
6.0
1.35
1.30
4.0
4.4
20
0
0.8
2.0
100
1.8
2
100
45
0.8
+100
0
250
1.60
1.50
4.8
5.3
1.75
1.60
5.9
6.4
250
250
1750
50
0.5
1
108
126
V
CP
0.5
典型值
最大
2250
单位
兆赫
兆赫/ V
V
兆赫/ V
dBc的/赫兹
dBc的/赫兹
测试条件/评论
参见图15
见图10
V
CP
≤ V
S
使用内部VCO时;此范围之外,
在CP杂散可能会增加由于CP的向上/向下的不匹配
F = 2000 MHz的
F = 2000 MHz的
差模(可容纳单端输入
通过交流接地无驱动输入)
低于约1兆赫的频率应该是直流耦合;
小心匹配V
CM
(自偏压)
PLL品质因数( FOM )的随压摆率提高
(参见图14) ;输入灵敏度是足够的交流耦合
LVDS和LVPECL信号
REFIN的自偏压
1
REFIN的自偏压
1
自偏置
1
自偏置
1
两个单端CMOS兼容输入
压摆率> 50 V / μs的
压摆率> 50 V / μs的; CMOS电平
不应超过V
S
p-p
250
兆赫
mV的P-P
V
V
k
k
兆赫
兆赫
V P-P
V
V
A
ns
pF
兆赫
兆赫
ns
ns
ns
此值确定的允许输入的占空比,并且是
的时间,一个方波高/低
每个引脚, REFIN / REFIN ( REF1 / REF2 )
反冲脉冲宽度= 1.3纳秒, 2.9纳秒
反冲脉冲宽度= 6.0纳秒
寄存器0x017 [1:0 ]条件= 01b
寄存器0x017 [1:0 ] = 00B ;寄存器0x017 [1:0 ] = 11b时
寄存器0x017 [1:0 ] = 10b的
修订版E |第80 4
数据表
参数
电荷泵( CP )
I
CP
吸入/源
高价值
低价值
绝对精度
CP
RSET
范围
I
CP
高阻抗模式泄漏
下沉和源电流匹配
I
CP
与CP
V
I
CP
与温度的关系
预分频器( N部分频器)
预分频器输入频率
P = 1 FD
P = 2 FD
P = 3 FD
P = 2的DM (2/3)
P = 4的DM (4/5)
P = 8 DM ( 8/9 )
P = 16 DM ( 16/17 )
P = 32 DM ( 32/33 )
预分频器输出频率
PLL分频延误
000
001
010
011
100
101
110
111
噪声特性
在带内相位噪声的电荷
泵/相位频率检测器
( In-Band这是在PLL的LBW)
频率为500 kHz PFD频率
在1 MHz PFD频率
在10 MHz PFD频率
在50 MHz的PFD频率
PLL品质因数( FOM )
典型值
最大
单位
AD9517-3
测试条件/评论
CP
V
是CP引脚电压; V
CP
是电荷泵电源电压
可编程
与CP
RSET
= 5.1 k
CP
V
= V
CP
/2 V
4.8
0.60
2.5
2.7/10
1
2
1.5
2
mA
mA
%
k
nA
%
%
%
0.5 < CP
V
& LT ; V
CP
0.5 V
0.5 < CP
V
& LT ; V
CP
0.5 V
CP
V
= V
CP
/2 V
VCXO / VCO反馈分频器N-P , A,B ,R
部分
300
600
900
200
1000
2400
3000
3000
300
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
兆赫
A, B计数器输入频率(预分频器输入频率
除以P )
注册0x019 : R,位[5 : 3 ] ; N,位[ 2 : 0 ] ;请参阅表54
关闭
330
440
550
660
770
880
990
ps
ps
ps
ps
ps
ps
ps
ps
锁相环的带内相位噪声基底估计通过测量
在VCO的输出端的带内相位噪声和
减去20的日志(N) (N为N分频器的值)
165
162
151
143
220
dBc的/赫兹
dBc的/赫兹
dBc的/赫兹
dBc的/赫兹
dBc的/赫兹
PLL数字锁定检测窗口
2
需要锁(边重合)
低量程( ABP 1.3纳秒, 2.9纳秒)
高量程( ABP 1.3纳秒, 2.9纳秒)
高量程( ABP 6.0纳秒)
解锁锁定后(滞后)
2
低量程( ABP 1.3纳秒, 2.9纳秒)
高量程( ABP 1.3纳秒, 2.9纳秒)
高量程( ABP 6.0纳秒)
1
2
3.5
7.5
3.5
7
15
11
ns
ns
ns
ns
ns
ns
参考转换速率> 0.25 V / ns的; FOM +10日志(F
PFD
)是一个近似
在PFD / CP的带内相位噪声的形变(在平区)
内部PLL环路带宽;运行闭环时,该
相位噪声,因为在VCO输出观测,增加
20日志(N )
信号可在LD ,状态和REFMON销
当通过相应的寄存器设置选择
通过寄存器0x017 [1: 0]和注册量0x018 [ 4 ]
寄存器0x017 [1:0 ] = 00b,那么的01b , 11b中;注册量0x018 [4] = 1b中
寄存器0x017 [1:0 ] = 00b,那么的01b , 11b中;注册量0x018 [4] = 0B
寄存器0x017 [1:0 ] = 10b中;注册量0x018 [4] = 0B
寄存器0x017 [1:0 ] = 00b,那么的01b , 11b中;注册量0x018 [4] = 1b中
寄存器0x017 [1:0 ] = 00b,那么的01b , 11b中;注册量0x018 [4] = 0B
寄存器0x017 [1:0 ] = 10b中;注册量0x018 [4] = 0B
REFIN REFIN和自偏置点略微偏移,以避免在一个开放的输入条件喋喋不休。
用于数字锁的可靠操作检测, PFD频率的周期必须大于向解锁后的锁定时间。
修订版E |第80 5
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