a
特点
单片12位， 40 MSPS A / D转换器
低功耗： 415毫瓦
+5 V单电源
保证无失码
微分非线性误差： 0.33 LSB
完整的片内采样保持放大器和
参考电压
信号与噪声和失真比： 68.3分贝
无杂散动态范围： 81分贝
超出范围指示器
直接二进制输出数据
28引线SSOP封装
兼容3 V逻辑
VINA
VINB
CML
CAPT
CAPB
VREF
SENSE
完整的12位， 40 MSPS
单片机A / D转换器
AD9224
功能框图
CLK
SHA
MDAC1
增益= 16
A / D
MDAC2
增益= 4
A / D
MDAC3
增益= 4
A / D
AVDD
DRVDD
5
3
3
A / D
5
3
3
4
数字校正逻辑
12
输出缓冲器
模式
SELECT
1V
OTR
第1位
（MSB）
12位
（ LSB ）
AD9224
REFCOM
AVSS
DRVSS
产品说明
该AD9224是一款单芯片，单电源， 12位， 40 MSPS ，
模拟 - 数字转换器，具有一个片，高性能
采样和保持放大器和基准电压源。在AD9224
采用多级差分流水线架构与输出
纠错逻辑，可提供12位精度， 40 MSPS
数据传输速率，并保证无失码全operat-
荷兰国际集团温度范围。
在AD9224结合了低成本高速度的CMOS工艺
及新颖的体系结构来实现的分辨率和速度
现有双极实现在功率的一小部分
消耗和成本。
在AD9224的输入允许方便地实现这两个
成像和通信系统。一个真正的差分
输入结构，用户可以选择各种输入范围和
偏移量，包括单端应用程序。动态per-
性能会受到极好。
采样和保持（SHA ）放大器非常适合于既
切换满量程电平的suc-多路复用系统
cessive渠道， frequen-采样单通道输入
连锁商店直到并远远超过奈奎斯特速率。
在AD9224的宽带输入，结合力和
节约成本比以前提供的定型产品，适用于
应用在通信，成像和医疗超声等。
在AD9224具有一个板载可编程参考。一
外部基准，也可以选择以适应直流精度
和温度漂移的应用程序的要求。
一个单时钟输入来控制所有内部转换
周期。数字输出数据格式为标准二进制
输出格式。超出范围的信号表示溢出
条件可以用最显著位要使用的
确定是下溢还是上溢。
产品亮点
在AD9224上制造一个非常具有成本效益的CMOS
流程。现在，高速精密模拟电路相结合
用高密度的逻辑电路。
该AD9224提供了一个完整的单芯片采样12位，
40 MSPS的模拟 - 数字变换功能的28引线
SSOP封装。
低功耗的
AD9224在415毫瓦功耗的一小部分
在现有的单片解决方案，目前可用的功率。
片上采样和保持（ SHA ） -The
多功能SHA
输入可以是单端或差分配置
输入。
超出范围（ OTR ） -The
OTR输出位指示
输入信号超出了AD9224的输入范围。
单电源，该
AD9224采用+5 V单电源
简化了系统电源设计。它还采用了另行
率数字驱动电源线，以适应3 V和5 V逻辑
家庭。
引脚兼容性，该
AD9224是引脚兼容
AD9220 ， AD9221 ， AD9223和AD9225 ADC的。
REV 。一
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ADI公司， 1999
AD9224–SPECIFICATIONS
DC特定网络阳离子
（ AVDD = 5 V， DRVDD = 3 V，F
参数
决议
最大转换速率
输入参考噪声
VREF = 1.0 V
VREF = 2.0 V
准确性
积分非线性（ INL ）
微分非线性（ DNL ）
保证无失码
零误差（ @ + 25 ° C）
增益误差（ @ + 25 ° C）
1
增益误差（ @ + 25 ° C）
2
温度漂移
零误差
增益误差
1
增益误差
2
电源抑制
AVDD （ +5 V
±
0.25 V)
模拟量输入
输入范围（ VREF = 1 V）
（ VREF = 2V）
输入（ VINA或VINB ）范围
输入电容
内部参考电压
输出电压（1V模式）
输出电压容差（ 1 V模式）
输出电压（ 2.0V的模式）
输出电压容差（ 2.0 V模式）
输出电流（可外部载荷）
负载调整率
3
参考输入电阻
电源
电源电压
AVDD
DRVDD
电源电流
IAVDD
IDRVDD
耗电量
笔记
1
包括内部参考电压误差。
2
不包括内部参考电压误差。
3
负载调整为1 mA负载电流（除了那个由AD9224需要）。
特定网络阳离子如有更改，恕不另行通知。
样品
= 40 MSPS ， VREF = 2.0 V， VINB = 2.5 V DC ，T
民
给T
最大
除非另有说明）
民
12
40
0.35
0.17
±
1.5
±
0.33
12
±
0.12
±
0.3
±
0.4
±
2
±
26
±
0.4
±
0.07
2
4
0
10
1.0
±
5
2.0
±
10
1.0
±
1.0
5
AVDD
±
0.24
±
2.5
±
1.0
±
0.3
±
2.2
±
1.6
典型值
最大
单位
位
兆赫
LSB RMS
LSB RMS
最低位
最低位
位
％ FSR
％ FSR
％ FSR
PPM /°C的
PPM /°C的
PPM /°C的
％ FSR
V P-P
V P-P
V
pF
V
mV
V
mV
mA
mV
k
±
17
±
35
±
3.4
4.75
2.85
5
5.25
5.25
87
5
445
450
V（ ± 5 ％ AVDD工作）
V（ ± 5 ％ DRVDD工作）
MA（ 2 V内部VREF ）
MA（ 2 V内部VREF ）
毫瓦（ 1 V内部参考）
毫瓦（ 2 V内部参考）
82
4.3
415
425
–2–
REV 。一
AC规格
（ AVDD = 5 V， DRVDD = 3 V，F
参数
AD9224
民
65
63.5
65.3
64.6
典型值
68.3
68.0
69.1
68.4
–80
–78
71.1
67.9
81
79
120
120
1
4
–71
–67.4
最大
单位
dB
dB
dB
dB
dB
dB
dB
dB
兆赫
兆赫
ns
ps的均方根
样品
= 40 MSPS ， VREF = 2.0 V，T
民
给T
最大
，差分输入除非另有说明）
信号与噪声和失真比（S / N + D ）
f
输入
= 2.5兆赫
f
输入
= 10 MHz的
信号 - 噪声比（ SNR）的
f
输入
= 2.5兆赫
f
输入
= 10 MHz的
总谐波失真（ THD ）
f
输入
= 2.5兆赫
f
输入
= 10 MHz的
无杂散动态范围
f
输入
= 2.5兆赫
f
输入
= 10 MHz的
全功率带宽
小信号带宽
孔径延迟
孔径抖动
特定网络阳离子如有更改，恕不另行通知。
数码特定网络阳离子
（ AVDD = 5 V， DRVDD = + 5V ，除非另有说明）
参数
逻辑输入
高电平输入电压
低电平输入电压
高电平输入电流（V
IN
= DRVDD ）
低电平输入电流（V
IN
= 0 V)
输入电容
逻辑输出（与DRVDD = 5 V）
高电平输出电压（I
OH
= 50
A)
高电平输出电压（I
OH
= 0.5 mA）的
低电平输出电压（I
OL
= 1.6 mA）的
低电平输出电压（I
OL
= 50
A)
输出电容
逻辑输出（与DRVDD = 3V）
高电平输出电压（I
OH
= 50
A)
高电平输出电压（I
OH
= 0.5 mA）的
低电平输出电压（I
OL
= 1.6 mA）的
低电平输出电压（I
OL
= 50
A)
特定网络阳离子如有更改，恕不另行通知。
符号
V
IH
V
IL
I
IH
I
IL
C
IN
V
OH
V
OH
V
OL
V
OL
C
OUT
V
OH
V
OH
V
OL
V
OL
民
+3.5
–10
–10
典型值
最大
单位
V
V
A
A
pF
V
V
V
V
pF
V
V
V
V
+1.0
+10
+10
5
+4.5
+2.4
+0.4
+0.1
5
+2.95
+2.80
+0.4
+0.05
交换特定网络阳离子
(T
参数
时钟周期
1
时钟脉冲宽度高
2
时钟脉冲宽度低
输出延迟
流水线延迟（延迟）
民
给T
最大
与AVDD = + 5 V ， DRVDD = +5 V ，C
L
= 20 pF的）
符号
t
C
t
CH
t
CL
t
OD
民
25
12.37
12.37
13
典型值
最大
单位
ns
ns
ns
ns
时钟周期
3
笔记
1
时钟的周期可以延长至1毫秒，而不会降低在指定的性能@ 25
°C.
2
运行在40 MHz时，时钟必须保持为70％的占空比。查看时钟整形文本部分。
特定网络阳离子如有更改，恕不另行通知。
REV 。一
–3–
AD9224
绝对最大额定值*
引脚名称
同
对于
引脚配置
28引脚SSOP
民
–0.3
–0.3
–0.3
–6.5
–0.3
–0.3
–0.3
–0.3
–0.3
–0.3
–0.3
–65
最大
+6.5
+6.5
+0.3
+6.5
+0.3
AVDD + 0.3
DRVDD + 0.3
AVDD + 0.3
AVDD + 0.3
AVDD + 0.3
AVDD + 0.3
+150
+150
+300
单位
V
V
V
V
V
V
V
V
V
V
V
°C
°C
°C
CLK
（ LSB ）位12
11位
10位
9位
8位
第7位
第6位
第5位
1
2
3
4
5
6
7
28
DRVDD
27
DRVSS
26
AVDD
25
AVSS
24
VINB
AVDD
AVSS
DRVDD
DRVSS
AVSS
DRVSS
AVDD
DRVDD
REFCOM
AVSS
CLK
AVSS
数字输出DRVSS
VINA ， VINB
AVSS
VREF
AVSS
SENSE
AVSS
CAPB ， CAPT AVSS
结温
储存温度
焊接温度（ 10秒）
AD9224
23
VINA
顶视图
22
CML
（不按比例）
21
CAPT
8
9
20
CAPB
19
REFCOM （ AVSS ）
18
VREF
17
SENSE
16
AVSS
15
AVDD
4位
10
第3位
11
第2位
12
（MSB ）位1
13
OTR
14
*注意，超出上述绝对最大额定值可能会导致perma-
新界东北损坏设备。这是一个压力只有额定值。的功能操作
器件在这些或以上的任何其他条件，在操作说明
本规范的部分将得不到保证。暴露在绝对最大
收视率长时间可能会影响器件的可靠性。
S1
类似物
输入
S2
引脚功能描述
针
数
1
2
3–12
13
14
15, 26
16, 25
17
18
19
20
21
22
23
24
27
28
名字
CLK
12位
BIT 11-2
第1位
OTR
AVDD
AVSS
SENSE
VREF
REFCOM
（ AVSS ）
CAPB
CAPT
CML
VINA
VINB
DRVSS
DRVDD
描述
时钟输入引脚
最低有效位（ LSB ）
数据输出位
最高有效位（ MSB ）
超出范围
+ 5V模拟电源
模拟地
参考选择
输入范围选择（参考I / O）
参考通用
降噪引脚
降噪引脚
共模电平（中间电源电压）
模拟输入引脚（ + ）
模拟输入引脚（ - ）
数字输出驱动器接地
+3 V至+5 V数字输出
驱动器电源
t
C
t
CH
t
CL
S4
S3
输入
时钟
t
OD
数据
产量
数据1
图1.时序图
订购指南
模型
AD9224ARS
AD9224-EB
温度范围
-40 ° C至+ 85°C
包装说明
28引脚小外形封装（ SSOP ）
评估板
封装选项
RS-28
小心
ESD （静电放电）敏感器件。静电荷高达4000 V容易
积聚在人体和测试设备，可排出而不被发现。
虽然AD9224具有专用ESD保护电路，可能永久的损坏
发生在受到高能静电放电设备。因此，适当的ESD
预防措施建议，以避免性能下降或功能丧失。
警告！
ESD敏感器件
–4–
REV 。一
AD9224
规范的定义
积分非线性（ INL ）
孔径抖动
INL是指每个码的偏移由线
从“负满量程”，通过绘制“正满量程。 ”
作为“负满量程”点发生1/2 LSB前
在网络连接第一个代码转换。 “正满”是德网络定义为一个级别
1 1/2 LSB超出最后一个码转换。的偏差是
从每个特定的代码，中间测量到真
直线。
微分非线性（ DNL ，无失
代码）
孔径抖动是在孔径延迟的连续变化
样品，并表现为对输入到A / D转换噪声。
孔径延迟
孔径延迟是所述采样和保持放大器的量度
（ SHA）的性能，并且从的上升沿测量的
时钟输入，当输入信号被保持为转换。
信号与噪声和失真（S / N + D ， SINAD ）
比
理想的ADC码转换是完全1 LSB
分开。 DNL是从这个理想值的偏差。保证
无失码，以12位分辨率显示，所有4096
码，分别必须存在于所有操作范围。
零误差
的S / N + D是测量的输入信号的均方根值之比
下面的所有其它频谱分量的均方根和
奈奎斯特频率，包括谐波但不包括直流。该
值的S / N + D是用分贝表示。
有效位数（ ENOB ）
在主进位跃迁应该发生的模拟值
1/2 LSB以下VINA = VINB 。零误差被定义为
偏离该点的实际过渡。
增益误差
对于一个正弦波， SINAD可以表示在num-方面
BER位。使用下面的公式，
N
= （ SINAD - 1.76 ） /6.02
能够得到性能测量表示为
N,
的有效位数。
因此，对于一种用于正弦波输入的有效位数
在一个给定的输入频率可以直接从计算其
SINAD测量。
总谐波失真（ THD ）
第一个代码转换应该发生在一个模拟值
1/2 LSB以上负的满量程。最后要过渡
出现在模拟值1 1/2 LSB低于标称满刻度。
增益误差之间的第一实际差值的偏差
和最后一个代码转换之间的第一理想差
和最后一个代码转换。
温度漂移
THD是第6次谐波的COM的均方根和之比
ponents于所测量的输入信号的均方根值，并
表示为百分比或以分贝为单位。
信号 - 噪声比（ SNR）的
温度漂移的零误差和增益误差指定
从最初的（ + 25 ℃）的值的值，在最大变化
T
民
或T
最大
.
电源抑制
该规范显示，从满量程的最大变化
与在最低限度的值与供给的值
在其最大极限的供给。
信噪比的测量的输入信号的均方根值之比
低于奈奎斯特所有其它频谱分量的均方根和
频率，不包括前六个谐波和直流。值
对于信噪比用分贝表示。
无杂散动态范围（ SFDR ）
SFDR是的均方根幅度之间的分贝差
输入信号与峰值杂散信号。
REV 。一
–5–
QQ：800888908 复制
