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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第160页 > AD9148-M5375-EBZ
初步的技术数据
特点
单载波W-CDMA ACLR = 80 dBc的@ 150兆赫中频
通道至通道隔离> 90分贝
模拟输出
可调8.7毫安到31.7毫安
R
L
= 25 Ω 50 Ω
新颖的2× , 4 ×和8 ×插值器简化了数据接口
片上精细复杂的NCO允许载波位置
在DAC带宽中的任意位置
高性能,低噪声PLL时钟乘法器
多芯片同步接口
可编程数字反sinc滤波器
辅助DAC允许偏移控制
增益的DAC允许I和Q增益匹配
可编程的I和Q相位补偿
数字增益控制
灵活的LVDS数字I / F支持32位或16位总线宽度
196球CSP_BGA , 12毫米×12平方毫米
四通道16位, 1 GSPS ,
通道TxDAC +数位类比转换器
AD9148
概述
该AD9148是一款四通道, 16位,高动态范围,数字 -
模拟转换器(DAC ),提供1000 MSPS的采样速率。
这些设备包括具有针对直接变频优化
传输应用,包括增益,相位和失调compen-
偿。 DAC输出经过优化,以实现无缝对接
模拟正交调制器,如
ADL5371 / ADL5372 /
ADL5373/ADL5374/ADL5375.
串行外设接口( SPI )
提供了一种用于在内部器件参数的编程。
满量程输出电流可以被编程在一定范围为10mA
到30毫安。该器件采用1.8 V和3.3 V电源工作
的3瓦的最大采样率的总功率消耗。
它们被封闭在196 -球芯片规模封装的球栅阵列
与一个附加的散热器的选项。
产品亮点
1.
低噪声和交调失真( IMD )启用
高品质合成从基带宽带信号
高中频。
专有的DAC输出开关技术可增强
动态性能。
电流输出配置简便,可以用于各种
单端或差分电路拓扑结构。
LVDS数据输入接口包括FIFO ,以减轻输入时间。
应用
无线基础设施
LTE中, TD-SCDMA, WiMAX等的W-CDMA ,CDMA2000, GSM
MIMO /发射分集
数字高或低中频合成
2.
3.
4.
典型的信号链
复数基带
复IF
RF
DC
f
IF
数字插补滤波器
↑2
↑2
↑2
DAC1
POST DAC
模拟滤波器
↑2
↑2
↑2
DAC2
AQM
LO
LO =
f
IF
PA
FPGA / ASIC / DSP
↑2
↑2
↑2
DAC3
POST DAC
LO
AQM
PA
08910-001
↑2
↑2
↑2
DAC4
笔记
1. AQM =模拟正交调制。
图1 。
REV 。 A蛋白
信息ADI公司提供的被认为是准确和可靠。然而,没有
责任承担ADI公司供其使用,也为专利或其他任何侵权行为
第三方可能导致其使用的权利。规格如有变更,恕不另行通知。没有
获发牌照以暗示或其他方式ADI公司的任何专利或专利权。
商标和注册商标均为其各自所有者的财产。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781.329.4700
www.analog.com
传真: 781.461.3113
2010 ADI公司保留所有权利。
AD9148
目录
特点................................................. ............................................. 1
应用................................................. ...................................... 1
概述................................................ ......................... 1
产品亮点................................................ ........................... 1
典型的信号链............................................... .......................... 1
修订历史................................................ ............................... 2
功能框图............................................... ............... 3
规格................................................. .................................... 4
直流规范................................................ ......................... 4
输入/输出信号规格............................................ 5
数字输入数据时序规范................................. 6
交流规范................................................ .......................... 7
绝对最大额定值............................................... ............. 8
热阻................................................ ...................... 8
最大安全功耗............................................. 8
ESD注意事项................................................ .................................. 8
引脚配置和功能说明......................... 10
典型性能特征........................................... 14
术语................................................. ................................... 20
串行外设接口............................................... .............. 21
串行接口的一般操作............................... 21
数据格式................................................ ................................ 21
SPI引脚说明............................................... ................... 21
SPI选项................................................ ................................. 22
SPI寄存器映射............................................... .............................. 23
SPI寄存器说明............................................... ........... 25
输入数据端口............................................... ............................... 39
双端口模式.............................................. ............................ 39
单端口模式.............................................. .......................... 39
字节模式................................................ .................................... 40
数据接口选项............................................... ............... 40
FIFO操作................................................ .............................. 41
同步和复位FIFO ................................... 42
监测的FIFO状态.............................................. ........ 43
设备同步................................................ ................. 44
初步的技术数据
同步多个设备.............................................. 44
同步时钟倍频............................... 44
同步直接时钟.................................... 46
其他同步功能...................................... 47
接口时序................................................ ............................. 49
数字数据路径............................................... ............................. 50
预调制................................................. ........................... 50
可编程逆SINC滤波器............................................ 50
内插滤波器................................................ ................... 51
精调制................................................ ......................... 54
时钟产生................................................ ........................... 56
DAC输入时钟配置............................................ 56
驾驶CLK_X和REFCLK_x输入............................ 56
直接时钟................................................ .......................... 56
时钟倍频................................................ .................. 57
模拟输出................................................ ............................... 59
发射DAC操作............................................... ........... 59
辅助DAC操作............................................... .......... 60
接口为调制器............................................... .......... 61
器件的功耗............................................... ............... 63
温度传感器................................................ ....................... 65
中断请求操作............................................... ......... 66
中断服务程序............................................... ........... 66
接口时序验证............................................... ........... 67
SED操作................................................ ............................ 67
SED示例................................................ .............................. 67
测试访问端口............................................... ............................... 68
例如启动例行程序............................................. ............... 71
衍生PLL设置............................................... .................. 71
衍生NCO设置............................................... ................ 71
启动时序.............................................. ........................ 71
设备的验证序列............................................... .... 71
外形尺寸................................................ ....................... 72
订购指南................................................ .......................... 73
修订历史
4月10日 - 修订版A蛋白:初步版本
牧师PRA |页73 2
初步的技术数据
功能框图
310MHz
MOD
1.2GHz
FIFO
DCIA_P /
DCIA_N
FRAMEA_P /
FRAMEA_N
A [ 15 : 0 ] _P /
A [ 15 : 0 ] _N
16
数据接收
310MHz
SINC
–1
我OFFSET我收获
Q偏移Q增益
MOD
更正
收益
AUX1
310MHz/620MHz
500MHz/1GHz
500MHz/1GHz
1GHz
16-BIT
DAC1
AD9148
f
S
/2
IOUT1_P
IOUT1_N
AUX1_P
AUX1_N
IOUT2_P
IOUT2_N
f
S
/2
SINC
–1
COS
32-BIT
NCO罪
16-BIT
DAC2
收益
AUX2
AUX2_P
AUX2_N
IOUT3_P
IOUT3_N
B [ 15:0] _P /
B [ 15:0] _N
FRAMEB_P /
FRAMEB_N
DCIB_P /
DCIB_N
16
f
S
/2
MOD
SINC
–1
我OFFSET我收获
Q偏移Q增益
收益
16-BIT
DAC3
FIFO
AUX3
AUX3_P
AUX3_N
MOD
PREMOD_CLK
PREMOD_EN
f
S
/2
SINC
–1
收益
滤波器
系数
INVSINE_EN
16-BIT
DAC4
IOUT4_P
IOUT4_N
AUX4
HB1_CLK
HB2_CLK
HB3_CLK
HB1_EN
HB2_EN
HB3_EN
AUX4_P
AUX4_N
模式
GAIN /
offset_ctrl
PLL_CTRL
参考
BIAS
VREF
I120
CLK_P
内部时钟时序和控制逻辑
程序设计
注册
串行
IN / OUT端口
DAC_CLK
POWER- ON
RESET
多芯片
SYNC
SYNC
时钟
倍增器
(2× – 16×)
CLK_N
REFCLK_P /
SYNC P
REFCLK_N /
SYNC_N
08910-002
SDO
SDIO
SCLK
CSB
IRQ
RESET
图2中。
牧师PRA |第73 3
AD9148
特定网络阳离子
DC特定网络阳离子
初步的技术数据
T
给T
最大
, AVDD33 = 3.3 V , IOVDD = 3.3 V , DVDD18 = 1.8 V , CVDD18 = 1.8 V,I
OUTFS
= 20毫安,最大采样速率,除非
另有说明。
表1中。
参数
决议
准确性
微分非线性( DNL )
积分非线性( INL )
主DAC输出
偏移误差
增益误差(带内部参考)
满量程输出电流
1
输出顺从电压范围
输出电阻
DAC增益单调性
建立时间不超过± 0.5 LSB
温度漂移
主DAC失调
主DAC增益
参考电压
参考
内部参考电压
输出电阻
模拟电源电压
AVDD33
CVDD18
数字电源电压
IOVDD
DVDD18
功耗( NCO关闭, PLL禁用, SINC
1
绕过过滤器,
除非另有说明)
1 ×模式中,f
DAC
= 300 MSPS ,女
接口
= 600 MSPS
2 ×模式中,f
DAC
= 500 Msps的,女
接口
= 500 Msps的
4 ×模式中,f
DAC
= 800 MSPS ,女
接口
= 400 MSPS
4 ×模式中,f
DAC
= 800 MSPS ,女
接口
= 400 MSPS ,士官在
4 ×模式中,f
DAC
= 800 MSPS ,女
接口
= 400 MSPS ,使能PLL
4 ×模式中,f
DAC
= 800 MSPS ,女
接口
= 400 MSPS , Sinc函数
1
启用过滤器
8 ×模式中,f
DAC
= 1000 MSPS ,女
接口
= 250 MSPS
掉电模式
工作范围
1
典型值
16
±2.1
±3.7
±0.001
±2
20.2
10
保证
20
0.04
100
30
1.2
5
最大
单位
最低位
最低位
% FSR
% FSR
mA
V
ns
PPM /°C的
PPM /°C的
PPM /°C的
V
8.66
1.0
31.66
+1.0
3.13
1.71
1.71
1.71
3.3
1.8
1.8/3.3
1.8
3.47
1.89
3.47
1.89
V
V
V
V
40
0.79
1.49
2.18
2.47
2.23
2.44
2.48
0.03
+25
待定
+85
W
W
W
W
W
W
W
W
°C
基于一个10 kΩ的外部电阻。
牧师PRA |第73 4
初步的技术数据
输入/输出信号规格
AD9148
T
给T
最大
, AVDD33 = 3.3 V , IOVDD = 3.3 V , DVDD18 = 1.8 V , CVDD18 = 1.8 V,I
OUTFS
= 20毫安,最大采样速率,除非
另有说明。 LVDS驱动器和接收器是符合IEEE -1596减小链接范围,除非另有说明。
表2中。
参数
CMOS输入逻辑电平( SCLK , SDIO , CSB , RESET , TMS , TDI , TCK )
输入V
IN
逻辑高电平( IOVDD = 1.8 V )
输入V
IN
逻辑高电平( IOVDD = 3.3 V )
输入V
IN
逻辑低电平( IOVDD = 1.8 V )
输入V
IN
逻辑低电平( IOVDD = 3.3 V )
CMOS输出逻辑电平( SDIO , SDO , IRQ , PLL_LOCK , TDO )
输出电压V
OUT
逻辑高电平( IOVDD = 1.8 V )
输出电压V
OUT
逻辑高电平( IOVDD = 3.3 V )
输出电压V
OUT
逻辑低电平( IOVDD = 1.8 V )
输出电压V
OUT
逻辑低电平( IOVDD = 3.3 V )
LVDS接收器输入端( A [ 15 : 0 ] _x , B [ 15 : 0 ] _x , DCIA_x , DCIB_x , FRAMEA_x , FRAMEB_x )
输入电压范围,V
IA
或V
IB
差分输入阈值,V
ID
输入差分滞后,V
IDTHH
到V
IDTHL
接收器差分输入阻抗,R
IN
LVDS输入速率,女
接口
(见表4)
DAC时钟输入( CLK_P , CLK_N )
差分峰 - 峰值电压
共模电压(自偏置, AC耦合)
最大时钟速率
参考时钟输入( REFCLK_P / SYNC_P和REFCLK_N / SYNC_N )
差分峰 - 峰值电压
共模电压(自偏置, AC耦合)
最大时钟速率
最低时钟速率(使能PLL )
环分频器= / 2
环路分频器= / 4
环路分频器= / 8
环路分频器= / 16
串行外设接口
最大时钟速率( SCLK )
最小脉冲宽度高(T
威尔斯亲王医院
)
最小脉冲宽度低(T
PWL
)
建立时间, SDI到SCLK (T
DS
)
保持时间, SDI到SCLK (T
DH
)
数据有效, SDO到SCLK (T
DV
)
建立时间, CSB到SCLK (T
DCSB
)
E
E
1.2
2.0
典型值
最大
单位
V
V
V
V
V
V
V
V
mV
mV
mV
Ω
MSPS
mV
V
MSPS
mV
V
MSPS
MSPS
MSPS
MSPS
MSPS
兆赫
ns
ns
ns
ns
ns
ns
0.6
0.8
1.4
2.4
0.4
0.4
825
100
20
80
120
1200
500
1.25
2000
1575
+100
100
1000
100
500
500
1.25
2000
125
62.5
31.25
15.625
40
12.5
12.5
1.9
0.2
23
1.4
牧师PRA |第73 5
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    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

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地址:美驻深办公室:深圳市福田区华强北上步工业区201栋4楼A18室/ 分公司:深圳华强北深纺大厦C座西7楼/ 市场部:华强北新亚洲电子市场3B047展销柜
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联系人:销售部1部
地址:美驻深办公室:广东省深圳市福田区上步工业区201栋4楼A18室/分公司:深圳市福田区华强北深纺大厦C座西7楼,展销柜:深圳市福田区华强北新亚洲电子城3B047柜,分展销柜:湖南省桂阳和平杉林下展销柜
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地址:深圳市福田区红荔路3013-5号上航大厦西座4层(总部) 柜台地址:深圳市华强北华强三店(佳和)三楼3C013室
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联系人:陈先生
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联系人:李
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电话:0755-83223003
联系人:朱
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