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特点

快速的14位ADC， 5秒转换时间

8引脚SOIC封装

采用5 V单电源供电

高速，易于使用，串行接口

片内采样/保持放大器

选择输入范围

10 V的AD7894-10

2.5 V的AD7894-3

0 V至+ 2.5V为AD7894-2

高输入阻抗

低功耗： 20 mW的典型值

12位AD7895引脚兼容升级

5 V ， 14位串行， 5秒

ADC在SO- 8封装

AD7894

功能框图

在REF

AD7894

TRACK /

HOLD

14-BIT

ADC

信号

缩放*

CONVST

产量

GND

* AD7894-10 ， AD7894-3

忙

SCLK

SDATA

概述

该AD7894是一款快速， 14位ADC，采用单

+ 5V电源供电，装在一个小的8引脚SOIC封装。部分

包含5

逐次逼近式A / D转换器，一个片

片内采样/保持放大器，一个片内时钟和一个高速

串行接口。

来自AD7894的输出数据通过一个高速，

串行接口端口。此双线串行接口具有一个串行

时钟输入和一个串行数据输出，通过外部串行时钟

从访问该器件中的串行数据。

除了传统直流精度规格，如

线性度，满量程和失调误差时， AD7894还试样

田间的动态性能参数，包括谐波

失真和信号 - 噪声比。

该器件可接受的模拟输入范围

10 V （ AD7894-10 ），

2.5 V （ AD7894-3 ）， 0 V至+2.5 V（ AD7894-2 ），并经营

从+5 V单电源功耗仅为20 mW的典型。

的AD7894具有高采样速率模式，并且对于低

功耗应用的专有自动省电模式

其中部分自动进入省电一次转换

锡安已经完成，下一次转换前“唤醒”

周期。

该部分是在小外形集成电路（ SOIC ）提供。

产品亮点

1.快速， 14位ADC，采用8引脚封装

该AD7894包含一个5

ADC，一个采样/保持放大器，

控制逻辑和一个高速串行接口，所有在8引线

封装。这提供了相当大的空间节省了alterna-

略去的解决方案。

2.低功耗，单电源供电

在AD7894从+5 V单电源和反对工作

sumes只有20毫瓦。自动电源关闭模式，

其中一部分进入掉电一次转换

完成和下一个转换周期开始前“唤醒” ，

使得AD7894非常适合电池供电或便携式

应用程序。

3.高速串行接口

该部分提供了高速串行数据和串行时钟线

允许一个简单的两线串行接口的安排。

第0版

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一个技术的方式， P.O. 9106箱，诺伍德，MA 02062-9106 ， U.S.A.

联系电话： 781 / 329-4700

万维网网站： http://www.analog.com

传真： 781 / 326-8703

ADI公司， 1998年

AD7894–SPECIFICATIONS

参数

动态性能

信号（噪声+失真）比

@ +25°C

民

给T

最大

总谐波失真（ THD ）

峰值谐波或杂散噪声

互调失真（ IMD ）

二阶条款

三阶条款

DC精度

决议

最小分辨率为哪

无失码的保证

相对精度

微分非线性

AD7894-2

正增益误差

单极性偏移误差

AD7894-10 ， AD7894-3只有

正增益误差

负增益误差

双极性零误差

模拟量输入

AD7894-10

输入电压范围

输入电流

AD7894-3

输入电压范围

输入电流

AD7894-2

输入电压范围

输入电流

参考输入

REF IN输入电压范围

输入电流

输入电容

逻辑输入

输入高电压，V

INH

输入低电压，V

INL

输入电流I

输入电容，C

IN4

逻辑输出

输出高电压，V

输出低电压，V

输出编码

AD7894-10 ， AD7894-3

AD7894-2

转化率

转换时间

模式1操作

模式2操作

采样/保持捕获时间

采样和保持

-3 dB的小信号带宽

孔径抖动

一个版本

–86

–92

-1至+1.5

= + 5V 5 ％， GND = 0 V ， REF IN = 2.5 V.所有规格牛逼

民

给T

最大

除非

另有说明）。

B版本

单位

测试条件/评论

–86

–92

1.5

-1至+1.5

分贝分钟

最大分贝

dB典型值

位

LSB（最大值）

= 70 kHz正弦波，女

样品

= 160千赫

见图14

= 10 kHz正弦波，女

样品

= 160千赫，

典型的-87分贝。见图15

= 10 kHz正弦波，女

样品

= 160千赫

FA = 9千赫， FB

9.5千赫，女

样品

= 160千赫

2.5

1.5

0至+2.5

500

2.375/2.625

2.4

0.8

4.0

0.4

2.5

1.5

0至+2.5

500

2.375/2.625

2.4

0.8

4.0

0.4

最大mA

nA的最大

V MIN / V最大

最大

pF的最大

V分钟

V最大

最大

pF的最大

V分钟

V最大

见模拟输入部分

2.5 V

= 5 V

= 0 V到V

来源

= 400

SINK

= 1.6毫安

二进制补码

直（自然科学）二进制

0.35

7.5

0.35

7.5

最大

兆赫（典型值）

ps的典型值

–2–

第0版

AD7894

参数

电源要求

功耗

掉电模式

@ T

民

给T

最大

功率耗散T

民

给T

最大

一个版本

5.5

27.5

100

B版本

单位

5.5

27.5

100

V NOM

最大mA

毫瓦MAX

最大

测试条件/评论

对于指定的性能5 ％

数字输入@ V

, V

= 5 V

通常情况下为20 mW

数字输入@ GND ，V

= 5 V

典型值15

笔记

温度范围如下： A，B版本： -40 ° C至+ 85°C 。

适用于模式1操作。见操作模式部分。

参见术语。

样品测试@ + 25°C ，以确保合规性。

这10

包括从待机状态“唤醒”的时间。这种“唤醒”时间是从上升沿定时

CONVST ，

而转换从下落定时

边缘

CONVST ，

窄

CONVST

脉宽转换时间是有效的“唤醒”时间加上转换时间，因此10

这可以从可见

图3.注意，如果

CONVST

脉冲宽度大于5

有效的转换时间将增加超过10

特定网络阳离子如有更改，恕不另行通知。

时序特性

1, 2

参数

A，B版本

31.25

= +5 V

5 ％， GND = 0 V ， REF IN = + 2.5V ）

单位

ns（最小值）

ns（最大值）

ns（最小值）

ns（最大值）

测试条件/评论

CONVST

脉宽

SCLK高脉冲宽度

SCLK低脉冲宽度

数据访问时间下降SCLK的上升沿后

= 5 V

数据保持时间下降SCLK的上升沿后

落SCLK的上升沿后的总线释放时间

笔记

在+ 25 ° C样品测试，以确保合规性。所有的输入信号被测量与指定tR = tF = 1纳秒（10％至90％的+ 5V）和定时从1.6 V的电压电平

在SCLK最大频率为16兆赫。当接口以考虑数据访问时间必须小心，叔

及所要求的用户的设置时间

处理器。这两个时间将决定SCLK最高频率与该用户的系统可以操作。有关更多信息，请参见串行接口部分。

测得的与图1的负载电路并且被定义为所需的输出时间跨越0.8V或2.0V。

从采取的数据输出改变0.5 V的测量时间衍生当载有图1中的电路测量的数目，然后外推回

以除去的充电或放电的50 pF电容的影响。这意味着该时间t

在时序特性所是真正的总线释放时间

的部分的，因此是独立的外部总线负载电容。

特定网络阳离子如有更改，恕不另行通知。

绝对最大额定值*

= + 25 ° C除非另有说明）

到GND 。。。。。。。。。。。。。。。。。。。。。。。。。。 -0.3 V至+7 V

模拟输入电压至GND

AD7894-10 。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。

17 V

AD7894-3 。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。

7 V

AD7894-2 。。。。。。。。。。。。。。。。。。。。。。。。。。。 -5 V至+10 V

基准输入电压至GND 。。。。 0.3 V到V

+ 0.3 V

数字输入电压至GND 。。。。。。。 0.3 V到V

+ 0.3 V

数字输出电压至GND 。。。。。 0.3 V到V

+ 0.3 V

工作温度范围

商业（ A，B版本）。。。。。。。。。。。 -40 ° C至+ 85°C

存储温度范围。。。。。。。。。。。 -65 ° C至+ 150°C

结温。。。。。。。。。。。。。。。。。。。。。。。。 + 150°C

SOIC封装，功率耗散。。。。。。。。。。。。。。。 450毫瓦

热阻抗。。。。。。。。。。。。。。。。。。。。。 170 ° C / W

焊接温度，焊接

气相（60秒）。。。。。。。。。。。。。。。。。。。。。。。 + 215℃

红外（ 15秒）。。。。。。。。。。。。。。。。。。。。。。。。。。。 + 220℃

*注意，超出上述绝对最大额定值可能会导致perma-

新界东北损坏设备。这是一个压力只有额定值。的功能操作

器件在这些或以上的运作中列出的任何其他条件

本规范的部分将得不到保证。暴露在绝对最大额定值

长时间条件下可能影响器件的可靠性。

小心

ESD （静电放电）敏感器件。静电荷高达4000 V容易

积聚在人体和测试设备，可排出而不被发现。

虽然AD7894具有专用ESD保护电路，可能永久的损坏

发生在受到高能静电放电设备。因此，适当的ESD

预防措施建议，以避免性能下降或功能丧失。

警告！

ESD敏感器件

第0版

–3–

AD7894

订购指南

模型

AD7894AR-10

AD7894BR-10

AD7894AR-3

AD7894BR-3

AD7894AR-2

温度

范围

-40 ° C至+ 85°C

INL

2 LSB

1.5 LSB

2 LSB

1.5 LSB

2 LSB

输入范围

10 V

2.5 V

0 V至+2.5 V

SNR

77分贝

包

描述

8引脚窄体SOIC

包

选项

SO-8

引脚功能描述

针

号

针

助记符

在REF

描述

参考电压输入。外部参考源应连接到该引脚提供

参考电压为AD7894的转换过程。 IN输入裁判缓冲芯片。该

标称基准电压为AD7894的正确操作是2.5 V.

模拟量输入通道。模拟输入范围是

10 V （ AD7894-10 ），

2.5 V （ AD7894-3 ）和0 V至

+2.5 V（ AD7894-2 ）。

模拟地。对于采样/保持，比较器，数字电路和DAC的参考地。

串行时钟输入。外部串行时钟被施加到该输入，以从AD7894获得的串行数据。

一种新的串行数据位同步输出这个串行时钟的下降沿。数据保证有效

这个下降沿使数据可以在下降沿被接受时，快速串行时钟用于后10纳秒。

串行时钟输入端，应采取低在串行数据传输的结束。

串行数据输出。来自AD7894的串行数据，在该输出被提供。串行数据的时钟

通过SCLK的下降沿，但数据也可以读在SCLK的下降沿。这是POS-

sible因为数据位的N是有效的SCLK （数据保持时间）的下降沿之后在规定的时间（见

图5）。十六位串行数据被设置为两个前导零然后进行转换的14位

锡永的数据。在SCLK的第16个下降沿时， SDATA线保持的数据保持时间，然后

禁用（三态）。输出数据编码为二进制补码的AD7894-10和AD7894-3和

直接二进制为AD7894-2 。

在BUSY引脚用于指示何时部件是做一个转换。在BUSY引脚将继续高位

下降沿

CONVST

并且将返回低电平时，转换完成。

转换开始。边沿触发逻辑输入。在这个输入的下降沿，跟踪/保持器进入其

保持模式和转换启动。如果

CONVST

是低的转换结束时，该部分进入

掉电模式。在这种情况下，上升的边缘

CONVST

将导致部分开始醒来。

正电源电压， + 5V

5%.

GND

SCLK

SDATA

忙

CONVST

1.6mA

引脚配置

SOIC （ SO - 8 ）

+1.6V

产量

针

50pF

在REF

400 A

CONVST

AD7894

顶视图

GND

（不按比例）

忙

IN 2

图1.负载电路的访问时间和客车

放弃时间

SCLK

SDATA

–4–

第0版

AD7894

术语

信号（噪声+失真）比

相对精度

这是信号与（噪声+失真）在测量比

输出A / D转换器的。该信号的均方根值

的根本。噪音是所有非基波的均方根和

信号到一半的采样频率（f

/ 2 ），但不包括直流。

的比率取决于量化电平数

在数字化过程;的多个级别的，较小的quan-

tization噪音。该理论信号（噪声+失真）比

对于一个理想的N位转换器和一个正弦波输入由下式给出：

信号

（噪声+

失真）

= (6.02

+ 1.76)

因此，对于一个14位的转换器，这是86.04分贝。

总谐波失真

相对精度或端点非线性是最大

从一个直线穿过的端点的偏差

ADC的传递函数。

微分非线性

这是所测量的和理想的1之间的差的LSB

ADC中任意两个相邻码之间变化。

正增益误差（ AD7894-10 ）

这是最后一个码转换的偏差（ 01 。 110

01 。。。 111）与理想（4-

VREF - 1 LSB ）后，

双极性零误差已经调整了。

正增益误差（ AD7894-3 ）

总谐波失真（ THD ）是均方根和之比

谐波与基波。为AD7894 ，它被定义为：

THD

(

)

20日志

这是最后一个码转换的偏差（ 01 。 110

01 。。。 111 ）与理想（ VREF - 1 LSB ）的双极后

零误差已经调整了。

正增益误差（ AD7894-2 ）

哪里

是基波幅值的均方根值和

和

是的第二幅度的均方根值通过

第六次谐波。

峰值谐波或杂散噪声

这是最后一个码转换的偏差（ 11 。 110

11 。。。 111 ）与理想（ VREF - 1 LSB ）的单极后

偏移误差已经调整了。

双极性零误差（ AD7894-10 ， AD7894-3 ）

这是跳变的偏差（全0至全1 ）

从理想的0V（ GND）。

单极性偏移误差（ AD7894-2 ）

峰值谐波或杂散噪声德网络定义为的比率

下一个最大分量的均方根值在ADC输出值

频谱（最多到f

/ 2 ，不包括直流）到的均方根值

根本。本说明书中的数值通常为阻止 -

通过在频谱内的最大谐波开采，但对于部件

其中谐波淹没在噪声基底，这将是一

噪声峰值。

互调失真

这是第一个码转换的偏差（ 00 。 000

00 。。。 001 ）与理想的1 LSB 。

负增益误差（ AD7894-10 ）

这是第一个码转换的偏差（ 10 。 000

10 。。。 001）与理想（-4

VREF + 1 LSB ）后的双极

零误差已经调整了。

负增益误差（ AD7894-3 ）

当输入由正弦波的两个频率， FA和

FB ，任何非线性有源器件都会产生失真

产品MFA的和与差频

NFB在哪里

米中，n = 0， 1，2， 3等互术语是指那些

也不

NOR

等于零。例如，第二阶

术语包括（发+ fb的）和（发 - fb的），而第三次项

有（ 2 FA + FB），（ 2 FA - FB），（ FA + FB 2 ）和（ FA - 2 FB ）。

在AD7894使用两个输入频率进行测试。在这种情况下，

在第二和第三阶项是不同的意义。

二阶术语通常相距频率

原始的正弦波，而三阶项通常是在

一频率接近的输入频率。其结果是，第二

和三阶条款另行规定。计算

互调失真是因为每THD规范

其中，它是单独的失真的rms总和的比值

产品与基波幅值的均方根值表示

在分贝。

这是第一个码转换的偏差（ 10 。 000

10 。。。 001 ）与理想（ - VREF + 1 LSB ）后的双极

零误差已经调整了。

采样/保持捕获时间

采样/保持采集时间是需要的输出时间

在采样/保持放大器，以达到最终值，内

1/2 LSB ，转换结束后（在该点的

采样/保持返回跟踪模式）。它也适用于情况

其中有对输入电压阶跃输入变化施加

于V

在AD7894的输入。这意味着用户必须

等待磁道的持续时间/后保持采集时间

转换或阶跃输入变化到V后结束

前

开始另一次转换，以确保该部分进行操作以

特定连接的阳离子。

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