【16位500 kSPS时的PulSARTM与参考单极性ADCAD7652特点吞吐量： 500 kSP】,IC型号AD7652AST,AD7652AST PDF资料,AD7652AST经销商,ic,电子元器件-51电子网

16位500 kSPS时的PulSAR

与参考单极性ADC

AD7652

特点

吞吐量： 500 kSPS时

16位分辨率

模拟输入电压范围： 0 V至2.5 V

无流水线延迟

并行和串行5 V / 3 V接口

SPI

/ QSPI / MICROWIRE / DSP兼容

采用5 V单电源供电

功耗

65 mW的典型值， 130 μW @ 1 kSPS时没有REF

80毫瓦（典型值）与REF

48引脚LQFP封装和48引脚LFCSP封装

引脚对引脚PulSAR系列ADC的兼容

功能框图

REFBUFIN REF REFGND

AGND

AVDD

REF

交换的

CAP DAC

并行

接口

时钟

控制逻辑和

校准电路

DVDD

DGND

OVDD

串行

PORT

OGND

AD7652

INGND

PDREF

PDBUF

RESET

DATA [ 15：0]

忙

SER / PAR

OB/2C

BYTESWAP

CNVST

02965-0-001

应用

数据采集

仪器仪表

数字信号处理

频谱分析

医疗器械

电池供电系统

过程控制

图1.功能框图

表1.选择的PulSAR

类型/ kSPS时

伪

迪FF erential

真双极性

真

迪FF erential

18-Bit

多通道/

同时

100–250

AD7651

AD7660/AD7661

AD7663

AD7675

AD7678

500–570

AD7650/AD7652

AD7664/AD7666

AD7665

AD7676

AD7679

AD7654

AD7655

800–

1000

AD7653

AD7667

AD7671

AD7677

AD7674

概述

该AD7652是一款16位， 500 kSPS时，电荷再分配SAR

模拟 - 数字转换器，其工作在5 V单

电源。该器件内置一个高速16位采样

ADC，一个内部转换时钟，一个内部基准电压源，误差

校正电路，以及串行和并行系统接口

端口。

在AD7652采用ADI公司的高perform-制造

ANCE ， 0.6微米CMOS工艺，具有成本相对较低，

并且是在一个48引脚LQFP和一个微小的48引脚LFCSP封装

从-40 ° C至+ 85 ° C温度范围操作。

产品亮点

快速的吞吐量。

该AD7652是一个500 kSPS时，电荷再分配， 16位

SAR ADC具有内部误差校正电路。

内部参考。

在AD7652具有典型的内部参考

7 PPM / ° C的温度漂移。

单电源工作。

在AD7652采用单5V电源。其动力

吞吐量损耗减小。

串行或并行接口。

通用的并行或2线串行接口安排

既3 V和5 V逻辑兼容。

第0版

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AD7652

规格................................................. .................................... 3

时序规格................................................ ....................... 5

绝对最大额定值............................................... ............. 7

引脚配置和功能说明............................. 8

规格说明............................................... .......... 11

典型性能特征........................................... 12

电路信息................................................ ........................ 15

转换器操作................................................ .................. 15

典型的连接图............................................... ..... 17

功耗与吞吐量.................................... 19

转换控制................................................ .................... 19

数字接口................................................ .......................... 20

并行接口................................................ ......................... 20

串行接口................................................ ............................ 20

掌握串行接口............................................... ................ 21

从串行接口............................................... ................... 22

微处理器接口................................................ ....... 24

应用提示................................................ ............................ 25

双极性和更宽的输入范围............................................. 25

布局................................................. ......................................... 25

评估AD7652的性能.................................... 25

外形尺寸................................................ ....................... 26

订购指南................................................ ........................... 26

修订历史

修订版0 ，初始版本。

第0版|第28 2

AD7652

特定网络阳离子

表2. -40 ° C至+ 85°C ， AVDD = DVDD = 5 V ， OVDD = 2.7 V至5.25 V ，除非另有说明

参数

决议

模拟量输入

电压范围

工作输入电压

模拟输入CMRR

输入电流

输入阻抗

吞吐速度

完整的周期

吞吐率

DC精度

积分非线性误差

无失码

微分线性误差

过渡噪声

单极零误差，T

民

给T

MAX3

单极零误差温度漂移

满量程误差，T

民

给T

最多3

满量程误差温度漂移

电源灵敏度

AC精度

信号 - 噪声

无杂散动态范围

总谐波失真

信号与（噪声+失真）

-3 dB的输入带宽

采样动态

孔径延迟

孔径抖动

瞬态响应

参考

内部参考电压

内部基准电压温度漂移

线路调整

开启建立时间

温度PIN

电压输出@ 25°C

温度灵敏度

输出电阻

外部参考电压范围

外部参考电流消耗

条件

民

–0.1

6.1

典型值

最大

单位

位

– V

INGND

= 10千赫

500 kSPS的吞吐

REF

+0.5

–6

–2

0.7

500

±5

±0.24

kSPS时

最低位

位

最低位

PPM /°C的

％ FSR的

PPM /°C的

最低位

兆赫

ps的均方根

PPM /°C的

PPM / V

毫伏/°C的

REF = 2.5 V

AVDD = 5 V± 5 ％

= 100千赫

= 45千赫

= 100千赫

-60 dB输入，女

= 100千赫

±0.5

±2

–98

–96

满量程步骤

REF

@ 25°C

-40 ° C至+ 85°C

AVDD = 5 V± 5 ％

REF

= 10 F

2.48

2.5

±7

±24

300

4.3

2.5

110

±0.12

750

2.52

2.3

500 kSPS的吞吐

AVDD - 1.85

第0版|第28 3

AD7652

参数

数字输入

逻辑电平

数字输出

数据格式

流水线延迟

电源

指定的性能

AVDD

DVDD

OVDD

工作电流

AVDD

DVDD

OVDD

没有REF功耗

功耗与REF

温度范围

指定的性能

条件

民

典型值

最大

单位

–0.3

2.0

–1

+0.8

DVDD + 0.3

SINK

= 1.6毫安

来源

= –500 A

0.4

OVDD - 0.6

4.75

2.7

500 kSPS的吞吐

有了参考和缓冲器

参考文献和缓冲当家

5.25

°C

500 kSPS的吞吐

1 kSPS的吞吐

500 kSPS的吞吐

民

给T

最大

–40

12.2

3.8

102

130

+85

见模拟输入部分。

LSB是指至少有显著位。与0 V至2.5 V输入范围， 1 LSB为38.15 μV 。

见规格部分定义。这些规范不包括从外部引用错误的贡献。

以dB为单位，所有规格均参考满量程输入FS 。测试用的输入信号，在0.5分贝以下满刻度，除非另有说明。

并行或串行16位。

转换结果可立即完成后转换。

最大应该是最低的5.25 V至DVDD + 0.3 V.

随着REF ， PDREF和PDBUF都较低;无REF ， PDREF和PDBUF是HIGH 。

随着PDREF ， PDBUF LOW和HIGH PD 。

经过测试，在平行阅读模式

咨询工厂的扩展级温度范围。

第0版|第28 4

AD7652

时序特定网络阳离子

表3 -40 ° C至+ 85°C ， AVDD = DVDD = 5 V ， OVDD = 2.7 V至5.25 V ，除非另有说明

参数

参阅图26和图27

脉宽转换

转换之间的时间

CNVST低到高BUSY延迟

繁忙的所有模式除了主串转换后阅读

孔径延迟

转换结束繁忙的低延迟

转换时间

采集时间

复位脉冲宽度

请参考图28 ，图29 ，图30 （并行接口模式）

CNVST低到数据有效延迟

数据有效繁忙低延迟

总线访问请求到数据有效

总线释放时间

请参考图32和图33 （主串行接口模式）

CS低电平到SYNC有效延迟

CS低到内部SCLK有效延迟

CS低电平到SDOUT延迟

CNVST低电平到SYNC延迟

SYNC断言到SCLK第一边沿延迟

内部SCLK周期

内部SCLK高

内部SCLK LOW

SDOUT有效建立时间

SDOUT有效保持时间

SCLK最后一个边沿来同步延迟

CS高到SYNC HI -Z

CS高到内部SCLK HI -Z

CS高到SDOUT HI -Z

在主串繁忙的转换后阅读

CNVST低到SYNC断言延迟

SYNC拉高繁忙低延迟

请参考图34和图35 （从串行接口模式）

外部SCLK建立时间

外部SCLK有效沿到SDOUT延迟

SDIN建立时间

SDIN保持时间

外部SCLK周期

外部SCLK高

外部SCLK LOW

符号

民

1.25

750

1.25

525

典型值

最大

单位

见表4

1.25

在串行接口模式时，SYNC ，SCLK和SDOUT的时序与最大载荷C定义

10 pF的;否则，负载为60 pF的最大值。

在串行主在转换模式下读取。参见表4转换后串行主机读取模式。

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