a
特点
8位A / D转换器
2个8位D / A转换器
两个8位串行D / A转换器
采用+5 V单电源供电
片内基准
掉电模式
52引脚PQFP封装
5 V集成高速ADC /四核
DAC系统
AD7339
功能框图
DVDD1
ADCPDB
艾因
ADCCLK
DA0
DA7
DACCLK
DB0
DB7
DACPDB
SDATA
SCLK
串行
控制
逻辑
DAC 0
注册
DAC 1
注册
串行
DAC 0
串行
DAC 1
DAC B
注册
并行
DAC B
DACB
DAC A
注册
并行
DAC A
T / H
ADC
DGND1
AGND1
D0
D7
DACA
SDAC0F
SDAC0S
SDAC1F
SDAC1S
VREF
LATCH
SDACPDB
概述
2.5V
参考
AVDD
的AD7339是包含两个DAC和一个复合集成电路
ADC功能。该装置包括一个8位并行A模 - 数
转换器。两个8位并行的DAC还包括为两个
串行控制的DAC 。这些串行DAC的8位DAC 。
的AD7339 ，它工作于5 V单电源供电，
在船上带隙基准为2.5 V的标称值
为了降低该部分的功耗，每个部分
除基准，可以单独断电时
未在使用。
在AD7339可在一个52引脚PQFP封装。
VREFA
AD7339
VREFB
DVDD2
DVDD3
DGND2
DGND3
AGND2
AGND3
第0版
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传真： 781 / 326-8703
ADI公司，1997
AD7339–SPECIFICATIONS
参数
ADC
决议
微分非线性
积分非线性
零输入偏移错误
信号范围
B版本
8
±
1
±
1
±
3
±
1
1
（ AVDD = DVDD = + 5V
明智的说明）
单位
位
LSB（最大值）
LSB（最大值）
最低位
V最大
10 ％ ， AGND = DGND = 0 V ，T
A
= T
民
给T
最大
，除非另外
测试条件/评论
ADCCLK = 2.048兆赫
8位单调性
必须将输入偏置约1.4 V.因此， AC
耦合用1 nF的电容需要如果偏置
电压不等于1.4 V的输入应该是
与50的最大源阻抗驱动
.
全功率输入带宽
转化率
信号（噪声+失真）
有效NO 。比特位（ENOB ）
互调失真
错误率
输入电容
编码
并行DACS
决议
微分非线性
积分非线性
输出信号范围
V
摇摆
V
BIAS
更新率
双极性零点失调误差
增益误差
输出谐波含量
带0 MHz至1.152兆赫
DAC之间的增益匹配
相声
到B通道从通道
从B通道A通道
从通道VREFB
为了VREFA从B通道
负载电阻
负载电容
满标度稳定时间
编码
串行DACS
决议
微分非线性
积分非线性
输出范围
00H
FFH
更新率
负载电阻
负载电容
I
SINK
I
来源
满标度稳定时间
编码
1.024
2.048
42.7
6.8
48
4.7
×
10
11
5
偏移二进制码
8
±
1
±
1
V
BIAS
±
V
摇摆
14/25
×
VREFA / B
VREFA / B
2.304
±
40
±
5
50
46
0.2
兆赫
MSPS
分贝分钟
比特分
分贝分钟
pF的最大
请参阅术语
00H到FFH与80H = 0 V
DACCLK = 2.304兆赫
位
LSB（最大值）
LSB（最大值）
V NOM
V NOM
兆赫最大
毫伏最大
％ （典型值）
分贝分钟
分贝分钟
dB
8位单调性
VREFA / B指VREFA为DACA和VREFB的DACB 。
工厂修剪。不包括增益误差
对于满量程数字正弦波的波段0 kHz至76.8千赫
对于满量程数字正弦波的波段0 kHz至128 kHz的
对于其中振幅相等满量程-10分贝
1.8 kΩ的DACA和VREFA ，之间和负载
DACB和VREFB
信道具有频率128 kHz的满量程输出。
B信道具有频率128 kHz的满量程输出。
信道具有频率128 kHz的满量程输出。
B信道具有频率128 kHz的满量程输出。
连接DACA / B和VREFA / B之间
55
55
55
55
1.8
50
4
偏移二进制码
8
±
1
±
1.5
0.2
AVDD - 0.247
SCLK/10
20
100
1
100
2.5
直接二进制
分贝分钟
分贝分钟
分贝分钟
分贝分钟
kΩ的分
pF的最大
s
典型值
00H到FFH与80H =偏置电压
SCLK为选通256 kHz的时钟。
位
最低位
最低位
V最大
V分钟
kHz的最大
kΩ最大值
pF的最大
毫安（典型值）
A
典型值
s
典型值
8位单调性
相对于满刻度的
见图1
当AVDD > 5.247 V，模拟输出将等于2 VREF 。
–2–
第0版
AD7339
参数
B版本
单位
测试条件/评论
参考
电压VREF
VREFA / VREFB电压
负载电容
I
SINK
I
来源
逻辑输入
V
INH
，输入高电压
V
INL
，输入低电压
I
INH
，输入漏电流
C
IN
，输入电容
逻辑输出
V
OH
，输出电压高
V
OL
，输出低电压
C
OUT
，输出电容
电源
AVDD ， DVDD
I
DD
掉电电流
2.5
±
2%
2.5
±
5%
0.1
1
1
DVDD - 0.8
0.8
10
15
DVDD - 0.4
0.4
15
4.5/5.5
45
4.5
5
V最小/最大
V最小/最大
F
最大
各基准输出必须有一个负载电容
100 pF的最低赔偿的目的。
最大mA
最大mA
V分钟
V最大
A
最大
pF的最大
V分钟
V最大
pF的最大
|I
OUT
|
≤
1毫安
|I
OUT
|
≤
2毫安
V最小/最大
最大mA
主动模式
最大mA
+ 25°C 。在VREF空载
最大mA
-40 ° C至+ 85°C 。在VREF空载
笔记
1
工作温度范围如下： B版本; -40 ° C至+ 85°C 。
特定网络阳离子如有更改，恕不另行通知。
2VREF
+5.5V
动力
供应
输出电压 - 伏特
4.753
+5V
动力
供应
4.253
+4.5V
动力
供应
0.2
0
217
243
模拟输出电压
255
从串行DAC与电源图1的模拟输出电压
第0版
–3–
AD7339
时序特性
参数
ADC
t
1
t
2
t
3
t
4
t
5
并行DACS
t
6
t
7
t
8
t
9
t
10
t
11
t
12
串行DACS
t
13
t
14
t
15
t
16
t
17
t
18
t
19
（ AVDD = 5 V
单位
10％ ; AGND = DGND = 0 V ;牛逼
A
= T
MLN
给T
最大
中，除非另有说明）
描述
参见图3 。
ADCCLK期
ADCCLK宽度低
ADCCLK宽高
数据有效ADCCLK的下降沿后
数据有效ADCCLK随后的下降沿之前
参见图4 。
DACCLK期
DACCLK宽度低
DACCLK宽高
数据建立在DACCLK上升沿时刻
数据保持后DACCLK上升沿时刻
传播延迟
建立时间（从10％到90％）
见图5 。
SCLK周期
SCLK宽度低
SCLK宽高
数据设置SCLK上升沿之前
锁存使能设置时间SCLK下降沿后
LATCH脉宽
转换延迟
在极限
T
A
= -40°C到+ 85℃
480
210
210
100
200
430
200
200
130
50
150
250
3.9
1.94
1.94
950
950
480
100
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最大值）
ns（最大值）
s
民
s
民
s
民
ns（最小值）
ns（最小值）
ns（最小值）
s
最大
2mA
I
OL
TO
产量
针
+2.1V
C
L
15pF
1mA
I
OH
图2.负载电路的时序规范
–4–
第0版
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