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位置：首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1632页 > AD7305BN
a
特点
4个8位DAC在一个封装中
+3 V ，+ 5 V和5 V工作电压
轨到轨REF-输入电压输出摆幅
2.6 MHz参考乘法带宽
紧凑1.1毫米高度TSSOP 16 / 20引脚封装
内部上电复位
SPI串行接口兼容， AD7304
快速的并行接口， AD7305
40关闭电源
应用
汽车量程输出电压
仪器仪表，数字控制校准
引脚兼容的替代AD7226当V
DD
＆ LT ; 5.5 V
V
DD
PWR ON
RESET
3 V / + 5 V ，轨到轨
四， 8位DAC
AD7304/AD7305*
功能方框图
V
REF
B V
REF
A
输入8
注册一个
8
输入8
寄存器B
CS
SDI / SHDN
CLK
串行
REG
输入8
注册
输入8
注册
DAC B 8
REG
DAC的C 8
REG
DAC D 8
REG
DAC B
V
OUT
B
DAC A
REG
8
DAC A
V
OUT
A
DAC
V
OUT
C
DAC
V
OUT
D
AD7304
V
SS
GND
V
DD
CLR LDAC
V
REF
（C V）
REF
D
V
REF
输入8
注册一个
输入8
寄存器B
输入8
注册
8
输入8
注册
WR
A0/SHDN
A1
解码
DAC D 8
REG
DAC
V
OUT
D
DAC A 8
REG
DAC B 8
REG
DAC的C 8
REG
概述
在AD7304 / AD7305是从操作四， 8位DAC
单+3 V至+5 V电源或
±5
V电源。该AD7304具有
串行接口， AD7305则具有一个并行接口。之间
最终精密缓冲器摆动轨到轨。基准电压输入范围
包括两个供电轨允许的正或负全
量程输出电压。保证工作电源
电压范围为+ 2.7V至+ 5.5V ，功耗小于9毫瓦
从+3 V电源。
满量程电压输出由外部基准确定
ENCE输入电压的应用。轨到轨V
REF
输入到DAC
V
OUT
允许将满量程电压设置为正电源
V
DD
中，负电源V
SS
或其间的任何值。
在AD7304的双缓冲串行数据接口具有高
高速，三线， SPI和微控制器兼容的输入
在（ SDI ） ，时钟（ CLK ）和芯片选择（ CS ）引脚的使用数据。
此外，内部上电复位将输出设置为零
的规模。
并行输入AD7305采用标准地址解码
随着
WR
控制线将数据加载到输入寄存器
字符。双缓冲架构允许所有四个输入
寄存器可以用新值预装，接着是
LDAC
控制选通该副本的所有新数据到DAC寄存器
TER值从而更新模拟输出值。当操作
从不足5.5 V时， AD7305是引脚兼容的
流行的行业标准AD7226 。
PWR ON
RESET
DB0
DB1
DB2
DB3
DB4
DB5
DB6
DAC A
V
OUT
A
V
OUT
B
DAC B
DAC
V
OUT
C
AD7305
LDAC
V
SS
GND
上电复位内部电源的零刻度则以两个部分
状态开启。一名40
A
电源关断（ SHDN ）功能
通过三态的SDI / SHDN引脚上的两个部件激活
AD7304和三态上的A0 / SHDN引脚地址
AD7305.
在AD7304 / AD7305是工作在扩展工业
（ -40 ° C至+ 85° C）和汽车（ -40 ° C至+ 125°C ）
温度范围。 AD7304s在16引脚塑料可
DIP（ N-16） ，和宽体SOL- 16 （R -16）的包。该
并行输入AD7305可在20引脚塑料DIP
（ N-20） ，和SOL -20 （R- 20）的表面安装封装。为
超小型应用薄1.1毫米TSSOP -16 （ RU- 16 ）
包将是可利用的AD7304 ，而TSSOP- 20
（ RU - 20 ），将房子的AD7305 。
*受保护
根据专利号5684481 。
REV 。一
信息ADI公司提供的被认为是准确和
可靠的。但是，没有责任承担由Analog Devices其
使用，也不对第三方专利或其他权利的任何侵犯
这可能是由于它的使用。没有获发牌照以暗示或
否则，在ADI公司的任何专利或专利权。
一个技术的方式， P.O. 9106箱，诺伍德，MA 02062-9106 ， U.S.A.
联系电话： 781 / 329-4700
万维网网站： http://www.analog.com
传真： 781 / 326-8703
ADI公司， 1998年
AD7304/AD7305–SPECIFICATIONS
参数
静态性能
决议
1
积分非线性
2
微分非线性
零刻度误差
满量程电压误差
满量程温度系数
3
参考输入
V
REFIN
范围
输入电阻（ AD7304 ）
输入电阻（ AD7305 ）
输入电容
3
模拟输出
输出电压范围
输出电流驱动
关机电阻
容性负载
3
逻辑输入
逻辑输入低电压
逻辑输入高电压
输入漏电流
5
输入电容
3
AC特性
3
输出压摆率
参考倍增
总谐波失真
建立时间
6
SHUTDOWN恢复时间
时间关闭
DAC毛刺
数字馈通
穿心
电源特性
正电源电流
负电源电流
功耗
掉电
电源灵敏度
符号
N
INL
DNL
V
ZSE
V
FSE
TCV
FS
V
REFIN
R
REFIN
R
REFIN
C
REFIN
V
OUT
I
OUT
R
OUT
C
L
V
IL
V
IH
I
IL
C
IL
SR
BW
THD
t
S
t
SDR
t
SDN
Q
Q
V
OUT
/V
REF
I
DD
I
SS
P
DISS
I
DD_SD
PSS
条件
(@ V
DD
= + 3V或+ 5V ，V
SS
= 0 V ;或V
DD
= +5 V和V
SS
= –5 V, V
SS
≤
V
REF
≤
V
DD
， -40℃ <牛逼
A
< + 85°C / + 125°C ，除非另有说明。 ）
3V
8
±
1
±
1
15
±
4
5
V
SS
/V
DD
28
7.5
5
10% 5 V
8
±
1
±
1
15
±
4
5
V
SS
/V
DD
28
7.5
5
V
SS
/V
DD
±
3
120
200
0.8
2.4
±
10
8
1/3.6
10%
5V
8
±
1
±
1
±
15
±
4
5
V
SS
/V
DD
28
7.5
5
V
SS
/V
DD
±
3
120
200
0.8
2.4
±
10
8
1/3.6
2.6
0.025
1.0/2
2
15
15
2
–65
6
6
60
40
0.004
10%
单位
位
LSB（最大值）
LSB（最大值）
毫伏最大
LSB（最大值）
PPM /°C的典型值
4
V最小/最大
千欧（典型值）
千欧（典型值）
pF的典型值
V最小/最大
毫安（典型值）
千欧（典型值）
pF的典型值
V分钟
V最大
A
最大
pF的最大
V / μs最小值/典型值
兆赫（典型值）
%
s
典型值/最大值
s
最大
s
典型值
NVS （典型值）
NVS （典型值）
dB
最大mA
最大mA
毫瓦MAX
A
典型值
%/%
单调，所有的代码0至FF
H
数据= 00
H
数据= FF
H
CODE = 55
H
所有DAC编码= 55
H
V
SS
/V
DD
码= 80
H
,
V
OUT
< 1 LSB
±
3
DAC输出端置于关机状态120
无振荡
200
0.6
2.1
±
10
8
码= 00
H
到FF
H
00
H
小信号，V
SS
= –5 V
V
REF
= 4 V P-P ，V
SS
= -5 V ， F = 1千赫
To
±
满量程的0.1 ％
To
±
满量程的0.1 ％
1/2.7
1.1/2
2
15
15
2
1.0/2
2
15
15
2
码= 00
H
, V
REF
= 1 V P-P ， F = 100千赫
V
逻辑
= 0 V或V
DD
，空载
V
SS
= –5 V
V
逻辑
= 0 V或V
DD
，空载
SDI / SHDN =浮动
V
DD
=
±
10%
6
15
40
0.004
6
30
40
0.004
笔记
1
一个LSB = V
REF
/256.
2
前三个代码（ 00
H
, 01
H
, 10
H
）被排除在单电源供电+3 V或5 V的积分非线性误差测量
3
这些参数由设计保证，不受生产测试。
4
标准结构表示在+ 25°C时测得的平均读数。
5
SDI / SHDN和A0 / SHDN引脚有30
A
我最大
IL
输入漏电流。
6
建立时间规范不接地的单电源工作的最后3个LSB内提出申请的负跳变。
特定网络阳离子如有更改，恕不另行通知。
5V
V
REF
= 10V P-P
F = 20kHz的
5V
0V
0V
–5V
V
OUT
= 10V P-P
–5V
（下）
（中）
图1. AD7304 / AD7305轨到轨基准电压输入到输出为20 kHz
–2–
REV 。一
AD7304/AD7305
时序特定网络阳离子
参数
(@ V
DD
= + 3V或+ 5V ，V
SS
= 0 V ;或V
DD
= +5 V和V
SS
= –5 V, V
SS
≤
V
REF
≤
V
DD
， -40℃ <牛逼
A
＆ LT ;
+ 85℃ / 125℃ ，除非另有说明。 ）
3V
10%
5V
10%
5V
10%
单位
符号
接口时序规范
1, 2
AD7304仅
时钟宽高
t
CH
时钟宽度低
t
CL
数据设置
t
DS
数据保持
t
DH
负载脉宽
t
LDW
负载设置
t
LD1
负载保持
t
LD2
清除脉宽
t
CLWR
SELECT
t
CSS
DESELECT
t
CSH
AD7305仅
数据设置
t
DS
数据保持
t
DH
地址设置
t
AS
地址保持
t
AH
写宽度
t
WR
负载脉宽
t
LDW
负载设置
t
LS
负载保持
t
LH
70
70
50
30
70
40
40
60
30
60
60
30
60
30
60
60
60
30
55
55
40
20
60
30
30
60
20
40
40
20
40
20
50
50
40
20
55
55
40
20
60
30
30
60
20
40
40
20
40
20
50
50
40
20
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
笔记
1
这些参数由设计保证，不受生产测试。
2
所有的输入控制信号与T指定
R
= t
F
= 2纳秒（10％ 90 ％的V
DD
），并定时从1.6 V的电压电平
绝对最大额定值*
订购指南
V
DD
到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -0.3 V， + 8V
V
SS
到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 +0.3 V， -8 V
V
REFX
到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 V
SS
, V
DD
逻辑输入到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.3 V ，V
DD
+ 0.3 V
V
的OUTx
到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.3 V ，V
DD
+ 0.3 V
I
OUT
短路接地。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 50毫安
封装功耗。 。 。 。 。 。 。 。 。 。 。 。 。 。 （T
j max的情况
–T
A
)/θ
JA
热阻
θ
JA
16引脚塑料DIP封装（ N-16 ） 。 。 。 。 。 。 。 。 。 。 103 ° C / W
16引脚SOIC封装（ R- 16 ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 73 ° C / W
TSSOP -16封装（ RU - 16 ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 180 ° C / W
20引脚塑料DIP封装（ N-20 ） 。 。 。 。 。 。 。 。 。 。 120 ° C / W
20引脚SOIC封装（ R- 20 ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 74 ° C / W
TSSOP - 20封装（ RU - 20 ） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 155 ° C / W
最高结温（T
j max的情况
) . . . . . . . . . +150°C
工作温度范围。 。 。 。 。 。 。 。 。 。 。 -40 ° C至+ 85°C
存储温度范围。 。 。 。 。 。 。 。 。 。 。 。 -65∞C至+ 150∞C
焊接温度
N-16和N-20 （焊接， 10秒） 。 。 。 。 。 。 。 。 。 。 。 。 + 300℃
R- 16 ， R- 20 ， RU- 16 ， RU- 20 （气相， 60秒） 。 。 + 215℃
R- 16 ， R- 20 ， RU- 16 ， RU- 20 （红外， 15秒） 。 。 。 。 + 220℃
*注意，超出上述绝对最大额定值可能会导致perma-
新界东北损坏设备。这是一个压力只有额定值。的功能操作
器件在这些或以上的任何其他条件，在操作说明
本规范的部分将得不到保证。暴露在绝对最大额定值
长时间条件下可能影响器件的可靠性。
模型
AD7304BN
AD7304BR
AD7304YR
AD7304BRU
AD7305BN
AD7305BR
AD7305YR
AD7305BRU
温度
范围
–40°C/+85°C
–40°C/+85°C
–40°C/+125°C
–40°C/+85°C
–40°C/+85°C
–40°C/+85°C
–40°C/+125°C
–40°C/+85°C
包
描述
16引脚P- DIP
16引脚SOIC
16引脚SOIC
TSSOP-16
20引脚P- DIP
20引脚SOIC
20引脚SOIC
TSSOP-20
包
选项
N-16
R-16
R-16
RU-16
N-20
R-20
R-20
RU-20
在AD7304 / AD7305包含2759个晶体管。芯片尺寸： 103万
×
102万，
10506平方密耳。
小心
ESD （静电放电）敏感器件。静电荷高达4000 V容易
积聚在人体和测试设备，可排出而不被发现。
虽然AD7304 / AD7305具有专用ESD保护电路，永久性损坏
年龄可能会发生在遇到高能量静电放电设备。因此，适当的
ESD预防措施建议，以避免性能下降或功能丧失。
警告！
ESD敏感器件
REV 。一
–3–
AD7304/AD7305
SDI
SA
SI
A1
A0
D7
D6
D5
D4
D3
D2
D1
D0
CLK
t
CSS
CS
t
CSH
t
LD2
LDAC
t
LD1
SDI
t
DS
CLK
t
DH
t
CH
t
LDW
t
CLRW
1 LSB
误差带
t
CL
LDAC
CLR
FS
V
OUT
ZS
t
S
t
S
图2. AD7304时序图
t
SDN
SDI / SHDN
t
SDR
I
DD
图3. AD7304时序图
表一， AD7304控制逻辑真值表
CS
H
L
↑+
H
H
H
CLK
X
↑+
L
X
X
X
LDAC CLR
H
H
H
L
H
H
H
H
H
H
↓–
↑+
串行移位寄存器功能
无影响
高级数据位1
无影响
无影响
无影响
无影响
输入REG功能
无影响
无影响
更新了SR内容
2
锁存SR内容
2
满载00
H
锁存00
H
DAC寄存器功能
无影响
无影响
无影响
所有输入寄存器内容转移
3
满载00
H
锁存00
H
笔记
1
↑+
正逻辑转换;
↓–
负逻辑转换; X不在乎。
2
一个输入寄存器接收数据位D7-D0从SR地址位（ A1，A0）进行解码;其中， REG A = （ 0 ， 0 ） ; B = （0 ，1）; C = （1 ，0）; D = （1 ，1）。
3
LDAC
是电平敏感输入。
表II中。 AD7304串行输入寄存器的数据格式，数据加载中MSB优先格式
最高位
B11
AD7304 SAC
B10
SDC
B9
A1
B8
A0
B7
D7
B6
D6
B5
D5
B4
D4
B3
D3
B2
D2
B1
D1
最低位
B0
D0
如果B11 （ SAC ） ，
关闭所有通道，
被设置为逻辑低电平时，所有DAC均处于功耗关断模式下，所有输出电压变高阻力。如果B10 （ SDC ） ，
关闭解码的频道，
被设置为逻辑LOW时，仅由地址位A1和A0解码的DAC处于关断模式。
–4–
REV 。一
AD7304/AD7305
表Ⅲ。 AD7305控制逻辑真值表
WR
L
↑+
L
↑+
L
↑+
L
↑+
H
L
H
H
A1
L
L
L
L
H
H
H
H
X
X
X
X
A0
L
L
H
H
L
L
H
H
X
X
X
X
LDAC
输入寄存器功能
H
H
H
H
H
H
H
H
L
L
↑+
H
REG加载与DB0 - DB7
REG锁存与DB0 - DB7
REG B满载DB0 - DB7
REG B锁存DB0 - DB7
REG C的装填与DB0 - DB7
REG 锁存DB0 - DB7
REG 满载DB0 - DB7
REG 锁存DB0 - DB7
无影响
输入REG X透明至DB0 - DB7
无影响
无影响，设备未选择
DAC寄存器功能
锁存上一页目录，没有变化
锁存上一页目录，没有变化
锁存上一页目录，没有变化
锁存上一页目录，没有变化
锁存上一页目录，没有变化
锁存上一页目录，没有变化
锁存上一页目录，没有变化
锁存上一页目录，没有变化
加载的所有输入寄存器的内容，注册透明
注册透明
所有输入寄存器锁存内容
无影响，设备未选择
销刀豆网络gurations
笔记
1
↑+
正逻辑转换;
↓–
负逻辑转换; X不在乎。
2
LDAC
是一个电平敏感输入。
t
WR
WR
V
OUT
B
1
V
OUT
B
1
16
V
OUT
C
15
V
OUT
D
14
V
DD
20
V
OUT
C
19
V
OUT
D
18
V
DD
17
A0/SHDN
V
OUT
A
2
V
SS 3
V
REF 4
GND
5
LDAC
6
t
AS
A0, A1
t
AH
V
OUT
A
2
V
SS 3
V
REF
A
4
t
DS
D0–D7
t
DH
AD7304
13
V
REF
C
顶视图
V
REF
B
5
（不按比例）
12
V
REF
D
GND
6
LDAC
7
11
SDI / SHDN
10
CLK
9
AD7305
16
A1
顶视图
15
WR
（不按比例）
14
DB0
7
DB7
DB6
8
DB5
9
DB4
10
13
DB1
12
DB2
11
DB3
t
LS
LDAC
t
LH
t
LDW
CLR
8
CS
t
S
V
OUT
1 LSB
误差带
图4. AD7305时序图
t
SDN
A0/SHDN
t
SDR
I
DD
图5. AD7305时序图
REV 。一
–5–
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