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位置：首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1106页 > AD7265BCP
初步的技术数据
特点
双12位， 3通道ADC
高吞吐量： 1 MSPS
指定V
DD
2.7 V至5.25 V
低功耗：在1 MSPS 7毫瓦最多采用3 V电源
16.5毫瓦最大的1 MSPS ，5 V电源
宽输入带宽
70分贝信噪比在100 kHz的输入频率
片内基准电压： 2.5 V
-40 ° C至+ 125°C操作
灵活的功耗/呑吐量管理
同时转换/读
无流水线延迟
高速串行接口SPI / QSPI / MICROWIRE / DSP
兼容
关断模式：最大1μA
32引脚LFCSP和TQFP封装
差分输入，双通道1 MSPS ，
12位， 3通道SAR ADC
AD7265
功能框图
REF SELECT
DCAPA
AVDD
DVDD
REF
BUF
AD7265
12-BIT
连续
近似
ADC
产量
DRIVERS
DOUTA
VA1
VA2
VA3
VA4
VA5
VA6
MUX
T / H
SCLK
+5
范围
控制
逻辑
DIFF / SE
A0
A1
A2
VDRIVE
12-BIT
连续
近似
ADC
V
B1
V
B2
V
B3
V
B4
V
B5
V
B6
产量
DRIVERS
T / H
MUX
DOUTB
概述
该AD7265是一款双通道， 12位，高速，低功耗，逐次
逼近型ADC，采用2.7 V至5.25 V
电源供电，最高吞吐量可达1 MSPS 。该
器件包含两个ADC ，两者之前一个3通道的多
路转换器，以及一个低噪声，宽带宽采样和保持放大器
能超过10 MHz的处理的输入频率。
转换过程和数据采集通过控制
标准控制输入，可轻松连接到microproces-
理器或DSP 。所述输入信号进行采样，在CS的下降沿;
转换也开始在这一点上。转换时间
SCLK频率来确定。有没有流水线延迟
与所述部分相关联。
在AD7265采用先进的设计技术，以实现极低的
功耗在高吞吐量。采用5 V电源和一个
1 MSPS吞吐速率，功耗为？ mA（最大值） 。该
器件还具有灵活的功耗/吞吐量管理时，
在睡眠模式下工作。
模拟输入范围为部分可以被选择为0 V至
V
REF
范围或2V
REF
范围与标准二进制或二进制补码
补输出编码。在AD7265具有一个片上2.5 V
参考可以，如果使用外部基准是预过驱动
ferred 。这种外部参考范围为100 mV到2.5 V的
AD7265提供32引脚引脚架构芯片级（ LFCSP ）和
超薄四核平板（ TQFP ）引脚封装。
BUF
AGND AGND AGND
DCAPB
DGND
DGND
图1
产品亮点
1.
该AD7265有两个完整的ADC功能，允许
同时采样和转换两个通道。每
ADC有2个模拟输入，3个全差分对，或6单
作为编程端通道。两者的转换结果
可同时通道上独立的数据线，或
在继承上一条数据线，如果只有一个串行端口
可用。
高吞吐量，低功耗
该AD7265提供了1 MSPS吞吐速率呢？毫瓦
最大功耗为3 V时运行
灵活的功耗/呑吐量管理
的转化率是由串行时钟确定，因此
功率消耗可以减小转换时间是重新
通过SCLK频率的增加缩小一次。电源效率
能够以较低的吞吐率最大化，如果该部分电路进入
转换之间睡觉。
无流水线延迟
该器件采用两个标准逐次逼近型
型ADC，采样时刻通过CS精确控制
输入和一次性转换控制。
2.
3.
4.
REV 。 A蛋白
信息ADI公司提供的被认为是准确和可靠。
但是，没有责任承担由Analog Devices供其使用，也不对任何
侵犯第三方专利或其他权利，可能导致其使用的。
规格如有变更，恕不另行通知。没有获发牌照以暗示
或者以其他方式在ADI公司的任何专利或专利权。商标
注册商标均为其各自所有者的财产。
一个技术的方式， P.O. 9106箱，诺伍德，MA 02062-9106 ， U.S.A.
联系电话： 781.329.4700
www.analog.com
传真： 781.326.8703
2004 ADI公司保留所有权利。
AD7265
目录
AD7265 -规格............................................... ................... 3
时序规格................................................ .................. 4
绝对最大额定值............................................... ............. 5
ESD注意事项................................................ .................................. 5
引脚配置和功能说明.......................... 6
术语................................................. ..................................... 8
工作原理............................................... ....................... 10
电路信息................................................ .................... 10
转换器操作................................................ .................. 10
模拟输入................................................ ............................... 11
初步的技术数据
输出编码................................................ ............................ 11
传递函数................................................ ..................... 12
数字输入................................................ .............................. 12
V
DRIVE
............................................................................................ 12
操作模式............................................... ........................ 13
普通模式................................................ .............................. 13
部分掉电模式............................................. .......... 13
完全掉电模式............................................. ............... 14
外形尺寸................................................ ....................... 15
订购指南................................................ ............................... 16
修订历史
修订版A蛋白：初步版本
牧师PRA |第16页2
初步的技术数据
AD7265—SPECIFICATIONS
1
AD7265
表1中。T
A
= T
民
给T
最大
, V
DD
= 2.7 V至5.25 V，F
SCLK
= 16 MHz时，女
S
= 1 MSPS ，V
DRIVE
= 2.7 V至5.25 V ;参考= 2.5 V± 1 ％ ，
除非另有说明
参数
动态性能
信号与噪声+失真比（ SINAD）
2
总谐波失真（ THD ）
2
无杂散动态范围（ SFDR ）
2
互调失真（ IMD ）
2
二阶条款
三阶条款
通道间隔离
采样和保持
孔径延迟
3
孔径抖动
3
孔径延迟匹配
3
全功率带宽
DC精度
决议
积分非线性
2
微分非线性
2
0 V至V
REF
输入范围
偏移误差
偏移误差匹配
增益误差
增益误差匹配
0 V至2 ×V
REF
输入范围
正增益误差
零代码错误
零代码误差匹配
负增益误差
模拟量输入
输入电压范围
直流漏电流
输入Capactiance
参考输入/输出
参考输出电压
4
参考输入电压范围
直流漏电流
输入Capactiance
V
REF
输出阻抗
5
参考温度系数
逻辑输入
输入高电压，V
INH
输入低电压，V
INL
输入电流I
IN
输入电容，C
IN3
规范
70
–75
–76
–88
–88
–88
10
50
200
20
2.5
12
±1
±1.5
±0.95
±3
±0.5
±2
±0.6
±2
±3
±1
±1
0 V至V
REF
0 V至2× V
REF
±500
±1
30
10
2.49/2.51
0.1/2.5
±30
±160
20
25
25
10
2.8
0.4
±1
10
单位
分贝分钟
最大分贝
最大分贝
dB典型值
dB典型值
dB典型值
ns（最大值）
ps的典型值
PS最大
兆赫（典型值）
兆赫（典型值）
位
LSB（最大值）
LSB（最大值）
LSB（最大值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
LSB （典型值）
二进制补码输出编码
LSB（最大值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
V
V
nA的最大
μA（最大值）
pF的典型值
pF的典型值
V MIN / V最大
V MIN / V最大
μA（最大值）
μA（最大值）
pF的典型值
= （典型值）
PPM / ° C最大值
PPM /°C的典型值
V分钟
V最大
μA（最大值）
pF的最大
RANGE引脚为低电平时CS下降沿
在CS下降沿RANGE引脚为高电平
T
A
= -40 ° C至+ 85°C
85°C <牛逼
A
≤ 125°C
当轨道
当保持
测试条件/评论
f
IN
= 100kHz的正弦波
f
IN
= 100kHz的正弦波
f
IN
= 100kHz的正弦波
@ 3分贝
@ 0.1分贝
±0.5 LSB （典型值） ;差分配置
±0.5 LSB （典型值） ;单端配置
保证无漏码至12位
直接二进制输出编码
见典型性能曲线
V
REF
针
D
帽
A，D
帽
B引脚
通常情况下15 nA的，V
IN
= 0 V或V
DRIVE
牧师PRA |第16页3
AD7265
参数
逻辑输出
输出高电压，V
OH
输出低电压，V
OL
浮态泄漏电流
浮态输出电容
3
输出编码
转化率
转换时间
采样/保持捕获时间
3
吞吐率
电源要求
V
DD
V
DRIVE
I
DD6
正常模式（静态）
操作中，f
s
= 1 MSPS
部分掉电模式
部分掉电模式
完全关断模式
功耗
6
正常模式（工作）
部分断电（静态）
完全掉电（静态）
笔记
1
温度范围为： -40 ° C至+ 125°C
2
参见术语部分。
3
在初次发布期间样品测试，以确保合规性。
4
涉及到销
帽
A或D
帽
B.
5
请参阅参考一节
帽
A，D
帽
B输出阻抗。
6
见功率与吞吐率部分。
初步的技术数据
规范
单位
测试条件/评论
V
DRIVE
– 0.2
V分钟
0.4
V最大
±1
μA（最大值）
10
pF的最大
直（自然科学）二进制
二进制补码
14
100
待定
2.7/5.25
2.7/5.25
待定
3.3
2.3
待定
待定
待定
16.5
待定
待定
SCLK周期
ns（最大值）
MSPS最高
V MIN / V最大
V MIN / V最大
SGL / DIFF = 1与0 V至V
REF
范围内选择
SGL / DIFF = 0 ; SGL / DIFF = 1与0 V至2 ×V
REF
范围
TBD NS与SCLK = 16 MHz的
数字I / PS = 0 V或V
DRIVE
最大mA
最大mA
最大mA
最大mA
μA（最大值）
μA（最大值）
毫瓦MAX
毫瓦MAX
毫瓦MAX
V
DD
= 5 V
V
DD
= 3 V
f
s
= 200 ksps的
STATIC
V
DD
= 5 V
时序特定网络阳离子
表2. AV
DD
DV
DD
= 2.7 V至5.25 V ，V
DRIVE
= 2.7 V至5.25 V ，T
A
= T
最大
给T
民
除非另有说明
参数
f
SCLK
t
兑换
t
安静
t
2
t
3
t
4
t
5
t
6
t
7
t
8
t
9
在T限制
民
, T
最大
10
20
14 × t
SCLK
700
35
10
待定
待定
0.4t
SCLK
0.4t
SCLK
待定
25
待定
待定
单位
千赫分钟
兆赫最大
ns（最大值）
ns（最大值）
ns（最大值）
ns（最小值）
ns（最大值）
ns（最大值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最大值）
ns（最小值）
ns（最大值）
描述
t
SCLK
= 1/f
SCLK
f
SCLK
= 20兆赫，
串行读端之间，毗邻CS下降沿时间最短
CS到SCLK建立时间
延迟从CS到
OUT
A和D
OUT
B的三态禁用
SCLK下降沿后的数据访问时间。
SCLK低电平脉冲宽度
SCLK高脉冲宽度
SCLK到数据有效保持时间
CS上升沿到D
OUT
A，D
OUT
B，高阻抗
SCLK下降沿到D
OUT
A，D
OUT
B，高阻抗
SCLK下降沿到D
OUT
A，D
OUT
B，高阻抗
牧师PRA |第16页4
初步的技术数据
绝对最大额定值
表3. AD7265极限参数
参数
V
DD
到AGND
DV
DD
至DGND
V
DRIVE
至DGND
V
DRIVE
到AGND
AV
DD
以DV
DD
AGND至DGND
模拟输入电压至AGND
数字输入电压至DGND
数字输出电压至GND
V
REF
到AGND
输入电流到任何引脚除外
耗材
1
工作温度范围
存储温度范围
结温
LFCSP封装
θ
JA
热阻抗
θ
JC
热阻抗
焊接温度，焊接
回流温度（ 10 30秒）
ESD
1
AD7265
等级
-0.3 V至+7 V
-0.3 V至+7 V
-0.3 V到DV
DD
-0.3 V至AV
DD
-0.3 V至+0.3 V
-0.3 V至+0.3 V
-0.3 V至AV
DD
+0.3 V
-0.3 V至+7 V
0.3 V到V
DRIVE
+0.3 V
-0.3 V至AV
DD
+0.3 V
= 10毫安
-40 ° C至+ 125°C
-65 ° C至+ 150°C
150°C
108.2°C/W
32.71°C/W
TBD ° C / W
TBD ℃，
待定
注意，超出上述绝对最大额定值
可能对器件造成永久性损坏。这是一个应力
只有等级;该器件在这些或任何功能操作
上述其他条件下的作战指示
本规范的部分，是不是暗示。暴露在绝对
最大额定值条件下工作会影响
器件的可靠性。
高达100 mA以下的瞬态电流不会造成SCR闩锁。
ESD警告
ESD （静电放电）敏感器件。静电荷高达4000 V容易堆积在
人体和测试设备，可排出而不被发现。虽然这款产品的特点
专用ESD保护电路，永久性的损害可能在遇到高能量发生装置
静电放电。因此，适当的ESD防范措施建议，以避免性能
下降或功能丧失。
牧师PRA |第16页5
初步的技术数据
特点
双12位， 3通道ADC
高吞吐量： 1 MSPS
指定V
DD
2.7 V至5.25 V
低功耗：在1 MSPS 7毫瓦最多采用3 V电源
16.5毫瓦最大的1 MSPS ，5 V电源
宽输入带宽
70分贝信噪比在100 kHz的输入频率
片内基准电压： 2.5 V
-40 ° C至+ 125°C操作
灵活的功耗/呑吐量管理
同时转换/读
无流水线延迟
高速串行接口SPI / QSPI / MICROWIRE / DSP
兼容
关断模式：最大1μA
32引脚LFCSP和TQFP封装
差分输入，双通道1 MSPS ，
12位， 3通道SAR ADC
AD7265
功能框图
REF SELECT
DCAPA
AVDD
DVDD
REF
BUF
AD7265
12-BIT
连续
近似
ADC
产量
DRIVERS
DOUTA
VA1
VA2
VA3
VA4
VA5
VA6
MUX
T / H
SCLK
+5
范围
控制
逻辑
DIFF / SE
A0
A1
A2
VDRIVE
12-BIT
连续
近似
ADC
V
B1
V
B2
V
B3
V
B4
V
B5
V
B6
产量
DRIVERS
T / H
MUX
DOUTB
概述
该AD7265是一款双通道， 12位，高速，低功耗，逐次
逼近型ADC，采用2.7 V至5.25 V
电源供电，最高吞吐量可达1 MSPS 。该
器件包含两个ADC ，两者之前一个3通道的多
路转换器，以及一个低噪声，宽带宽采样和保持放大器
能超过10 MHz的处理的输入频率。
转换过程和数据采集通过控制
标准控制输入，可轻松连接到microproces-
理器或DSP 。所述输入信号进行采样，在CS的下降沿;
转换也开始在这一点上。转换时间
SCLK频率来确定。有没有流水线延迟
与所述部分相关联。
在AD7265采用先进的设计技术，以实现极低的
功耗在高吞吐量。采用5 V电源和一个
1 MSPS吞吐速率，功耗为？ mA（最大值） 。该
器件还具有灵活的功耗/吞吐量管理时，
在睡眠模式下工作。
模拟输入范围为部分可以被选择为0 V至
V
REF
范围或2V
REF
范围与标准二进制或二进制补码
补输出编码。在AD7265具有一个片上2.5 V
参考可以，如果使用外部基准是预过驱动
ferred 。这种外部参考范围为100 mV到2.5 V的
AD7265提供32引脚引脚架构芯片级（ LFCSP ）和
超薄四核平板（ TQFP ）引脚封装。
BUF
AGND AGND AGND
DCAPB
DGND
DGND
图1
产品亮点
1.
该AD7265有两个完整的ADC功能，允许
同时采样和转换两个通道。每
ADC有2个模拟输入，3个全差分对，或6单
作为编程端通道。两者的转换结果
可同时通道上独立的数据线，或
在继承上一条数据线，如果只有一个串行端口
可用。
高吞吐量，低功耗
该AD7265提供了1 MSPS吞吐速率呢？毫瓦
最大功耗为3 V时运行
灵活的功耗/呑吐量管理
的转化率是由串行时钟确定，因此
功率消耗可以减小转换时间是重新
通过SCLK频率的增加缩小一次。电源效率
能够以较低的吞吐率最大化，如果该部分电路进入
转换之间睡觉。
无流水线延迟
该器件采用两个标准逐次逼近型
型ADC，采样时刻通过CS精确控制
输入和一次性转换控制。
2.
3.
4.
REV 。 A蛋白
信息ADI公司提供的被认为是准确和可靠。
但是，没有责任承担由Analog Devices供其使用，也不对任何
侵犯第三方专利或其他权利，可能导致其使用的。
规格如有变更，恕不另行通知。没有获发牌照以暗示
或者以其他方式在ADI公司的任何专利或专利权。商标
注册商标均为其各自所有者的财产。
一个技术的方式， P.O. 9106箱，诺伍德，MA 02062-9106 ， U.S.A.
联系电话： 781.329.4700
www.analog.com
传真： 781.326.8703
2004 ADI公司保留所有权利。
AD7265
目录
AD7265 -规格............................................... ................... 3
时序规格................................................ .................. 4
绝对最大额定值............................................... ............. 5
ESD注意事项................................................ .................................. 5
引脚配置和功能说明.......................... 6
术语................................................. ..................................... 8
工作原理............................................... ....................... 10
电路信息................................................ .................... 10
转换器操作................................................ .................. 10
模拟输入................................................ ............................... 11
初步的技术数据
输出编码................................................ ............................ 11
传递函数................................................ ..................... 12
数字输入................................................ .............................. 12
V
DRIVE
............................................................................................ 12
操作模式............................................... ........................ 13
普通模式................................................ .............................. 13
部分掉电模式............................................. .......... 13
完全掉电模式............................................. ............... 14
外形尺寸................................................ ....................... 15
订购指南................................................ ............................... 16
修订历史
修订版A蛋白：初步版本
牧师PRA |第16页2
初步的技术数据
AD7265—SPECIFICATIONS
1
AD7265
表1中。T
A
= T
民
给T
最大
, V
DD
= 2.7 V至5.25 V，F
SCLK
= 16 MHz时，女
S
= 1 MSPS ，V
DRIVE
= 2.7 V至5.25 V ;参考= 2.5 V± 1 ％ ，
除非另有说明
参数
动态性能
信号与噪声+失真比（ SINAD）
2
总谐波失真（ THD ）
2
无杂散动态范围（ SFDR ）
2
互调失真（ IMD ）
2
二阶条款
三阶条款
通道间隔离
采样和保持
孔径延迟
3
孔径抖动
3
孔径延迟匹配
3
全功率带宽
DC精度
决议
积分非线性
2
微分非线性
2
0 V至V
REF
输入范围
偏移误差
偏移误差匹配
增益误差
增益误差匹配
0 V至2 ×V
REF
输入范围
正增益误差
零代码错误
零代码误差匹配
负增益误差
模拟量输入
输入电压范围
直流漏电流
输入Capactiance
参考输入/输出
参考输出电压
4
参考输入电压范围
直流漏电流
输入Capactiance
V
REF
输出阻抗
5
参考温度系数
逻辑输入
输入高电压，V
INH
输入低电压，V
INL
输入电流I
IN
输入电容，C
IN3
规范
70
–75
–76
–88
–88
–88
10
50
200
20
2.5
12
±1
±1.5
±0.95
±3
±0.5
±2
±0.6
±2
±3
±1
±1
0 V至V
REF
0 V至2× V
REF
±500
±1
30
10
2.49/2.51
0.1/2.5
±30
±160
20
25
25
10
2.8
0.4
±1
10
单位
分贝分钟
最大分贝
最大分贝
dB典型值
dB典型值
dB典型值
ns（最大值）
ps的典型值
PS最大
兆赫（典型值）
兆赫（典型值）
位
LSB（最大值）
LSB（最大值）
LSB（最大值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
LSB （典型值）
二进制补码输出编码
LSB（最大值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
V
V
nA的最大
μA（最大值）
pF的典型值
pF的典型值
V MIN / V最大
V MIN / V最大
μA（最大值）
μA（最大值）
pF的典型值
= （典型值）
PPM / ° C最大值
PPM /°C的典型值
V分钟
V最大
μA（最大值）
pF的最大
RANGE引脚为低电平时CS下降沿
在CS下降沿RANGE引脚为高电平
T
A
= -40 ° C至+ 85°C
85°C <牛逼
A
≤ 125°C
当轨道
当保持
测试条件/评论
f
IN
= 100kHz的正弦波
f
IN
= 100kHz的正弦波
f
IN
= 100kHz的正弦波
@ 3分贝
@ 0.1分贝
±0.5 LSB （典型值） ;差分配置
±0.5 LSB （典型值） ;单端配置
保证无漏码至12位
直接二进制输出编码
见典型性能曲线
V
REF
针
D
帽
A，D
帽
B引脚
通常情况下15 nA的，V
IN
= 0 V或V
DRIVE
牧师PRA |第16页3
AD7265
参数
逻辑输出
输出高电压，V
OH
输出低电压，V
OL
浮态泄漏电流
浮态输出电容
3
输出编码
转化率
转换时间
采样/保持捕获时间
3
吞吐率
电源要求
V
DD
V
DRIVE
I
DD6
正常模式（静态）
操作中，f
s
= 1 MSPS
部分掉电模式
部分掉电模式
完全关断模式
功耗
6
正常模式（工作）
部分断电（静态）
完全掉电（静态）
笔记
1
温度范围为： -40 ° C至+ 125°C
2
参见术语部分。
3
在初次发布期间样品测试，以确保合规性。
4
涉及到销
帽
A或D
帽
B.
5
请参阅参考一节
帽
A，D
帽
B输出阻抗。
6
见功率与吞吐率部分。
初步的技术数据
规范
单位
测试条件/评论
V
DRIVE
– 0.2
V分钟
0.4
V最大
±1
μA（最大值）
10
pF的最大
直（自然科学）二进制
二进制补码
14
100
待定
2.7/5.25
2.7/5.25
待定
3.3
2.3
待定
待定
待定
16.5
待定
待定
SCLK周期
ns（最大值）
MSPS最高
V MIN / V最大
V MIN / V最大
SGL / DIFF = 1与0 V至V
REF
范围内选择
SGL / DIFF = 0 ; SGL / DIFF = 1与0 V至2 ×V
REF
范围
TBD NS与SCLK = 16 MHz的
数字I / PS = 0 V或V
DRIVE
最大mA
最大mA
最大mA
最大mA
μA（最大值）
μA（最大值）
毫瓦MAX
毫瓦MAX
毫瓦MAX
V
DD
= 5 V
V
DD
= 3 V
f
s
= 200 ksps的
STATIC
V
DD
= 5 V
时序特定网络阳离子
表2. AV
DD
DV
DD
= 2.7 V至5.25 V ，V
DRIVE
= 2.7 V至5.25 V ，T
A
= T
最大
给T
民
除非另有说明
参数
f
SCLK
t
兑换
t
安静
t
2
t
3
t
4
t
5
t
6
t
7
t
8
t
9
在T限制
民
, T
最大
10
20
14 × t
SCLK
700
35
10
待定
待定
0.4t
SCLK
0.4t
SCLK
待定
25
待定
待定
单位
千赫分钟
兆赫最大
ns（最大值）
ns（最大值）
ns（最大值）
ns（最小值）
ns（最大值）
ns（最大值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最大值）
ns（最小值）
ns（最大值）
描述
t
SCLK
= 1/f
SCLK
f
SCLK
= 20兆赫，
串行读端之间，毗邻CS下降沿时间最短
CS到SCLK建立时间
延迟从CS到
OUT
A和D
OUT
B的三态禁用
SCLK下降沿后的数据访问时间。
SCLK低电平脉冲宽度
SCLK高脉冲宽度
SCLK到数据有效保持时间
CS上升沿到D
OUT
A，D
OUT
B，高阻抗
SCLK下降沿到D
OUT
A，D
OUT
B，高阻抗
SCLK下降沿到D
OUT
A，D
OUT
B，高阻抗
牧师PRA |第16页4
初步的技术数据
绝对最大额定值
表3. AD7265极限参数
参数
V
DD
到AGND
DV
DD
至DGND
V
DRIVE
至DGND
V
DRIVE
到AGND
AV
DD
以DV
DD
AGND至DGND
模拟输入电压至AGND
数字输入电压至DGND
数字输出电压至GND
V
REF
到AGND
输入电流到任何引脚除外
耗材
1
工作温度范围
存储温度范围
结温
LFCSP封装
θ
JA
热阻抗
θ
JC
热阻抗
焊接温度，焊接
回流温度（ 10 30秒）
ESD
1
AD7265
等级
-0.3 V至+7 V
-0.3 V至+7 V
-0.3 V到DV
DD
-0.3 V至AV
DD
-0.3 V至+0.3 V
-0.3 V至+0.3 V
-0.3 V至AV
DD
+0.3 V
-0.3 V至+7 V
0.3 V到V
DRIVE
+0.3 V
-0.3 V至AV
DD
+0.3 V
= 10毫安
-40 ° C至+ 125°C
-65 ° C至+ 150°C
150°C
108.2°C/W
32.71°C/W
TBD ° C / W
TBD ℃，
待定
注意，超出上述绝对最大额定值
可能对器件造成永久性损坏。这是一个应力
只有等级;该器件在这些或任何功能操作
上述其他条件下的作战指示
本规范的部分，是不是暗示。暴露在绝对
最大额定值条件下工作会影响
器件的可靠性。
高达100 mA以下的瞬态电流不会造成SCR闩锁。
ESD警告
ESD （静电放电）敏感器件。静电荷高达4000 V容易堆积在
人体和测试设备，可排出而不被发现。虽然这款产品的特点
专用ESD保护电路，永久性的损害可能在遇到高能量发生装置
静电放电。因此，适当的ESD防范措施建议，以避免性能
下降或功能丧失。
牧师PRA |第16页5
差分/单端输入，双
1 MSPS ， 12位， 3通道SAR ADC
AD7265
特点
双12位， 3通道ADC
吞吐量： 1 MSPS
指定V
DD
2.7 V至5.25 V
耗电量
7毫瓦，在1 MSPS采用3 V电源
17毫瓦，在1 MSPS ，5 V电源
引脚可配置的模拟输入
12通道单端输入
6通道全差分输入
6通道伪差分输入
70分贝SINAD在50 kHz的输入频率
精确的片上基准： 2.5 V
± 0.2 ％，最大25°C ， 20 PPM / ° C（最大值）
与阅读875 ns的双转换， 16 MHz的SCLK
高速串行接口
SPI- / QSPI - / MICROWIRE - / DSP兼容
-40 ° C至+ 125°C操作
关断模式： 1 μA最大
32引脚LFCSP封装， 32引脚TQFP
2 MSPS的版本，
AD7266
功能框图
REF SELECT
D
帽
A
AV
DD
DV
DD
REF
V
A1
V
A2
V
A3
V
A4
V
A5
V
A6
MUX
BUF
AD7265
T / H
12-BIT
连续
近似
ADC
产量
DRIVERS
D
OUT
A
控制
逻辑
V
B1
V
B2
V
B3
V
B4
V
B5
V
B6
BUF
MUX
T / H
12-BIT
连续
近似
ADC
SCLK
CS
范围
SGL / DIFF
A0
A1
A2
V
DRIVE
产量
DRIVERS
D
OUT
B
概述
在AD7265
1
是一款双通道， 12位，高速，低功耗，逐次
逼近型ADC，采用2.7 V至5.25 V
电源和高达1 MSPS的特征吞吐率。该
器件包含两个ADC ，两者之前一个3通道
多路转换器和一个低噪声，宽带宽采样 - 保持
放大器，可处理超过30 MHz的输入频率。
转换过程和数据采集使用标准
控制输入，可轻松连接至微处理器或
DSP的。所述输入信号进行采样，在CS的下降沿;
转换也开始在这一点上。转换时间
SCLK频率来确定。在AD7265采用先进的
设计技术，以实现在高极低的功耗
吞吐率。采用5 V电源和1 MSPS吞吐速率，
功耗为4毫安最大。该器件还具有灵活
在正常工作时的功耗/吞吐量管理
模式下，由于静态电流消耗是如此之低。
模拟输入范围为部分可以被选择为在0 V
到V
REF
（或2 ×V
REF
）范围内，可采用标准二进制或二进制补码
补输出编码。在AD7265具有一个片上2.5 V
参考可当外部引用过驱动
首选。这种外部参考范围为100 mV至V
DD
。该
AD7265是32引脚LFCSP封装， 32引脚TQFP封装。
AGND AGND AGND
帽
B
DGND
DGND
图1 。
产品亮点
1.两个完整的ADC功能，可同时进行
采样和双通道的转换。
每个ADC有三个全/伪差分对或六
单端通道，如编程。转换
这两个信道的结果是同时可用上
独立的数据线，或者在连续上，如果只有一个数据线
一个串行端口可用。
2.高吞吐量，低功耗。
该AD7265提供了1 MSPS吞吐速率与9毫瓦
最大功耗为3 V时运行
3. AD7265同时提供标准0 V至V
REF
输入范围
和一个2 ×V
REF
输入范围。
4.无流水线延迟。
该器件采用两个标准逐次逼近型
型ADC，采样时刻通过CS精确控制
输入和一次性转换控制。
1
由美国专利号6681332保护。
REV 。一
信息ADI公司提供的被认为是准确和可靠。然而，没有
责任承担ADI公司供其使用，也为专利或其他任何侵权行为
第三方可能导致其使用的权利。规格如有变更，恕不另行通知。没有
获发牌照以暗示或其他方式ADI公司的任何专利或专利权。
商标和注册商标均为其各自所有者的财产。
一个技术的方式， P.O. 9106箱，诺伍德，MA 02062-9106 ， U.S.A.
联系电话： 781.329.4700
www.analog.com
传真： 781.461.3113
2006年ADI公司保留所有权利。
04674-001
AD7265
目录
特点................................................. ............................................. 1
概述................................................ ......................... 1
功能框图............................................... ............... 1
产品亮点................................................ ........................... 1
修订历史................................................ ............................... 2
规格................................................. .................................... 3
时序规格................................................ .................. 5
绝对最大额定值............................................... ............. 6
ESD注意事项................................................ .................................. 6
引脚配置和功能描述........................... 7
典型性能特征............................................. 9
术语................................................. ................................... 11
工作原理............................................... ....................... 13
电路信息................................................ .................... 13
转换器操作................................................ .................. 13
模拟输入结构............................................... ............... 13
模拟输入................................................ .............................. 14
模拟输入选择............................................... ............... 17
输出编码................................................ ............................ 17
传递函数................................................ ...................... 18
数字输入................................................ .............................. 18
V
DRIVE
............................................................................................ 18
操作模式............................................... ........................ 19
普通模式................................................ .............................. 19
部分掉电模式............................................. .......... 19
完全掉电模式............................................. ............... 20
开机启动时间.............................................. ........................... 21
功率与吞吐量............................................. .......... 21
串行接口................................................ ................................ 22
微处理器接口................................................ ........... 23
AD7265以ADSP218X ............................................... ................ 23
AD7265以ADSP- BF53x系列............................................. .............. 24
AD7265以TMS320C541 ............................................... ........... 24
AD7265以DSP563xx产品............................................... ................. 25
应用提示................................................ ........................... 26
接地和布局............................................... ............... 26
对于LFCSP .......................................... 26 PCB设计指南
评估AD7265的性能...................................... 26
外形尺寸................................................ ....................... 27
订购指南................................................ .......................... 27
修订历史
11月6日 - 修订版。 0到版本A
更改格式............................................... ..............通用
更改参考输入/输出部分................................ 4
更改表4 .............................................. .............................. 7
更改名词科.............................................. .... 11
图24和差模第................ 15变化
图29 ..............................................变化........................ 16
更改AD7265以ADSP- BF53x系列第............................. 24
更新的外形尺寸............................................... ........ 27
更改订购指南.............................................. ............ 27
4月5日 - 修订版0 ：初始版
版本A |页28 2
AD7265
特定网络阳离子
T
A
= T
民
给T
最大
, V
DD
= 2.7 V至5.25 V，F
SCLK
= 16 MHz时，女
S
= 1 MSPS ，V
DRIVE
= 2.7 V至5.25 V ;规范适用于使用内部
参考或外部参考= 2.5 V ±1％ ，除非另有说明。
1
表1中。
参数
动态性能
信号 - 噪声比（ SNR）的
2
规范
71
69
70
68
–77
–73
–75
–88
–88
–88
11
50
200
33/26
3.5/3
12
±1
±1.5
±0.99
0.99/+1.5
±6
±2
±2.5
±0.5
±2
±0.5
±5
±1
±2
±0.5
0 V至V
REF
0 V至2 ×V
REF
0到V
REF
2 × V
REF
V
CM
± V
REF
/2
V
CM
± V
REF
单位
分贝分钟
分贝分钟
分贝分钟
分贝分钟
最大分贝
最大分贝
最大分贝
dB典型值
dB典型值
dB典型值
ns（最大值）
ps的典型值
PS最大
兆赫（典型值）
兆赫（典型值）
位
LSB（最大值）
LSB（最大值）
LSB（最大值）
LSB（最大值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
LSB （典型值）
LSB（最大值）
LSB （典型值）
V
V
V
V
V
RANGE引脚为低电平
RANGE引脚高
RANGE引脚为低电平
RANGE引脚高
V
CM
=共模电压
7
= V
REF
/2
V
CM
= V
REF
测试条件/评论
f
IN
= 50 kHz正弦波;差模
f
IN
= 50 kHz正弦波;单端和
伪差分模式
f
IN
= 50 kHz正弦波;差模
f
IN
= 50 kHz正弦波;单端和
伪差分模式
f
IN
= 50 kHz正弦波;差模
f
IN
= 50 kHz正弦波;单端和
伪差分模式
f
IN
= 50kHz的正弦波
FA = 30 kHz时， FB = 50千赫
信号与噪声+失真比（ SINAD）
2
总谐波失真（ THD ）
2
无杂散动态范围（ SFDR ）
2
互调失真（ IMD ）
2
二阶项
三阶项
通道到通道隔离
采样和保持
孔径延迟
3
孔径抖动
3
孔径延迟匹配
3
全功率带宽
DC精度
决议
积分非线性
2
@ 3分贝，V
DD
= 5 V/V
DD
= 3 V
@ 0.2分贝， V
DD
= 5 V/V
DD
= 3 V
微分非线性
2, 4
直接二进制输出编码
偏移误差
偏移误差匹配
增益误差
增益误差匹配
二进制补码输出编码
正增益误差
正增益误差匹配
零代码错误
零代码误差匹配
负增益误差
负增益误差匹配
模拟量输入
5
单端输入范围
T
±0.5 LSB （典型值） ;差模
±0.5 LSB （典型值） ;单端和伪
差分模式
差模
单端和伪差分模式
伪差分输入范围： V
IN +
V
IN- 6
全差分输入范围： V
IN +
和V
IN-
V
IN +
和V
IN-
版本A |第28 3
AD7265
参数
直流漏电流
输入电容
参考输入/输出
参考输出电压
8
长期稳定性
输出电压迟滞
2
参考输入电压范围
直流漏电流
输入电容
D
帽
A，D
帽
B输出阻抗
参考温度系数
V
REF
噪音
逻辑输入
输入高电压，V
INH
输入低电压，V
INL
输入电流I
IN
输入电容，C
IN3
逻辑输出
输出高电压，V
OH
输出低电压，V
OL
浮态泄漏电流
浮态输出电容
3
输出编码
转化率
转换时间
跟踪和保持捕获时间
3
吞吐率
电源要求
V
DD
V
DRIVE
I
DD
正常模式（静态）
操作中，f
S
= 1 MSPS
f
S
= 1 MSPS
部分掉电模式
完全掉电模式（V
DD
)
功耗
正常模式（工作）
部分断电（静态）
完全掉电（静态）
1
2
规范
±1
45
10
2.5
150
50
0.1/V
DD
±2
25
10
20
10
20
2.8
0.4
±15
5
单位
μA（最大值）
pF的典型值
pF的典型值
V MIN / V最大
PPM （典型值）
PPM （典型值）
V MIN / V最大
μA（最大值）
pF的典型值
= （典型值）
PPM / ° C最大值
PPM /°C的典型值
μV RMS （典型值）
V分钟
V最大
nA的典型值
pF的典型值
测试条件/评论
当轨道
当保持
± 0.2 ％最大25°C
1000小时
见典型性能特性部分
外部基准适用于针D
帽
A /针D
帽
B
V
IN
= 0 V或V
DRIVE
V
DRIVE
0.2
V分钟
0.4
V最大
±1
μA（最大值）
7
pF的典型值
直（自然科学）二进制
二进制补码
14
90
110
1
2.7/5.25
2.7/5.25
2.3
4
3.2
500
1
2.8
21
2.625
5.25
SCLK周期
ns（最大值）
ns（最大值）
MSPS最高
V MIN / V最大
V MIN / V最大
最大mA
最大mA
最大mA
μA（最大值）
μA（最大值）
μA（最大值）
毫瓦MAX
毫瓦MAX
μW最大
SGL / DIFF = 1与0 V至V
REF
范围内选择
SGL / DIFF = 0 ; SGL / DIFF = 1与0 V至2 ×V
REF
范围
875 NS与SCLK = 16 MHz的
满量程阶跃输入; V
DD
= 5 V
满量程阶跃输入; V
DD
= 3 V
数字I / PS = 0 V或V
DRIVE
V
DD
= 5.25 V
V
DD
= 5.25 V ; 3.5毫安（典型值）
V
DD
= 3.6 V ; 2.7毫安（典型值）
STATIC
T
A
= -40 ° C至+ 85°C
T
A
> 85 ° C至125°C
V
DD
= 5.25 V
V
DD
= 5.25 V
V
DD
≤ 5.25 V ，T
A
= -40 ° C至+ 85°C
温度范围为-40 ° C至+ 125°C 。
参见术语部分。
3
在初次发布期间样品测试，以确保合规性。
4
保证没有遗漏码为12位。
5
V
IN-
或V
IN +
必须保持在GND / V
DD
.
6
V
IN-
= 0 V的额定性能。有关V全输入范围
IN-
销，参见图28和图29 。
7
对于全共模范围，参见图24和图25 。
8
涉及到针D
帽
A或针D
帽
B.
版本A |第28 4
AD7265
时序特定网络阳离子
AV
DD
DV
DD
= 2.7 V至5.25 V ，V
DRIVE
= 2.7 V至5.25 V ，内部/外部基准= 2.5 V ，T
A
= T
最大
给T
民
除非另有说明
1
.
表
2.
参数
f
SCLK
2
在T限制
民
, T
最大
1
4
16
14 × t
SCLK
875
30
15/20
20/30
15
36
27
0.45 t
SCLK
0.45 t
SCLK
10
5
15
30
5
50
单位
兆赫分钟
兆赫分钟
兆赫最大
ns（最大值）
ns（最大值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最大值）
ns（最大值）
ns（最大值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最小值）
ns（最大值）
ns（最小值）
ns（最小值）
ns（最大值）
描述
T
A
= -40 ° C至+ 85°C
T
A
> 85 ° C至125°C
t
SCLK
= 1/f
SCLK
f
SCLK
= 16 MHz的
串行读端之间，毗邻CS下降沿时间最短
V
DD
= 5 V / 3 V ， CS到SCLK建立时间，T
A
= -40 ° C至+ 85°C
V
DD
= 5 V / 3 V ， CS到SCLK建立时间，T
A
> 85 ° C至125°C
延迟从CS到
OUT
A和D
OUT
B的三态禁用
后SCLK下降沿，V数据访问时间
DD
= 3 V
后SCLK下降沿，V数据访问时间
DD
= 5 V
SCLK低电平脉冲宽度
SCLK高脉冲宽度
SCLK到数据有效保持时间，V
DD
= 3 V
SCLK到数据有效保持时间，V
DD
= 5 V
CS上升沿到D
OUT
A，D
OUT
B，高阻抗
CS上升沿到下降沿的脉冲宽度
SCLK下降沿到D
OUT
A，D
OUT
B，高阻抗
SCLK下降沿到D
OUT
A，D
OUT
B，高阻抗
t
兑换
t
安静
t
2
t
3
t
4
3
t
5
t
6
t
7
t
8
t
9
t
10
1
在初次发布期间样品测试，以确保合规性。所有输入信号均指定tR = tF = 5 ns的10％的规定（ 90 ％V的
DD
），并定时从1.6 V的电压电平
所有给出的时序规格为25 pF负载电容。与负载电容大于该值，数字缓冲器或锁存器必须被使用。见串行
接口部分与图41和图42 。
2
最低SCLK为指定的性能;较慢的SCLK频率，性能规格适用一般。
3
所需的输出时间跨越0.4 V或2.4 V.
版本A |第28 5
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    电话：0755-82780082
    联系人：杨小姐
    地址：深圳市福田区振兴路156号上步工业区405栋3层

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