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位置:首页 > IC型号导航 > 首字符A型号页 > 首字符A的型号第1015页 > AD7226KPZ
LC MOS
四通道8位D / A转换器
AD7226
特点
4个8位DAC和输出放大器
瘦小的20引脚DIP , SOIC , SSOP和PLCC封装
微处理器兼容
TTL / CMOS兼容
没有用户修剪
扩展工作温度范围
单电源供电的可能
应用
过程控制
自动测试设备
自动校准的大型系统参数,
例如,增益/偏移
最高位
数据
(8-BIT)
最低位
2
功能框图
V
REF
V
DD
锁存器
DAC A
A
V
OUT
A
D
A
T
A
B
U
S
LATCH B
DAC B
B
V
OUT
B
锁存器C.
DAC
C
V
OUT
C
锁闩D-
WR
A1
A0
控制
逻辑
DAC
D
V
OUT
D
AD7226
V
SS
AGND
AGND
概述
产品亮点
的AD7226包含四个8位电压输出数字 -
模拟转换器,具有输出缓冲放大器和接口
逻辑的单芯片。无需外部调整便可
实现全部额定性能的一部分。
提供了四个D / A的独立的片上闩锁
转换器。数据传送到这些数据锁存器1
通过一个共用的8位TTL / CMOS (5V)兼容输入
端口。控制输入A0和A1确定哪些是DAC
加载时
WR
变低。控制逻辑是速度相容
IBLE与大多数8位微处理器。
每个D / A转换器包括一个输出缓冲放大器,能够
驾驶达5 mA的输出电流。该放大器的偏置
在制造过程中被激光调整,从而避免任何
要求偏移归零。
规定的性能保证输入参考电压
从2 V至12.5 V采用双电源供电。还指定了一部分
对于在10 V的基准单电源操作
该AD7226是制作全离子注入高速
线性兼容CMOS ( LC
2
MOS)工艺,这一直
专门开发,使高速数字逻辑电路
和精确的模拟电路被集成在同一芯片上。
1. DAC至DAC匹配
因为所有四个DAC是在制作在同一芯片上
同时, DAC之间的精确匹配和跟踪
是与生俱来的。
2.单电源供电
各DAC的电压模式结构允许
AD7226可以从单个电源轨操作。
3.微处理器兼容
的AD7226具有个体共同的8位数据总线
DAC锁存器,提供了一个通用的控制架构
简单的界面,微处理器。所有锁存使能信号
是电平触发。
4.小尺寸
结合四个DAC和四运算放大器以及接口逻辑
进入20引脚封装允许大大降低了电路板
空间要求,并提供在系统更高的可靠性
使用多个转换器。其引脚排列旨在优化
所有的模拟输入和输出在同一电路板布局
包的末尾,而在另一所有的数字输入。
启示录
D
信息ADI公司提供的被认为是准确和
可靠的。但是,没有责任承担由Analog Devices其
使用,也不对第三方专利或其他权利的任何侵犯该
可能是由于它的使用。没有获发牌照以暗示或以其他方式
在ADI公司的任何专利或专利权。商标
注册商标是其各自公司的财产。
一个技术的方式, P.O. 9106箱,诺伍德,MA 02062-9106 , U.S.A.
联系电话: 781 / 329-4700
www.analog.com
传真:
781-461-3113
20
11
ADI公司保留所有权利。
AD7226–SPECIFICATIONS
双电源
参数
静态性能
决议
总非调整误差
相对精度
微分非线性
满量程误差
满量程温度系数
零代码错误
零代码误差温度系数
参考输入
电压范围
输入阻抗
输入电容
3
数字输入
输入高电压,V
INH
输入低电压,V
INL
输入漏电流
输入电容
输入的码
动态性能
输出电压摆率
4
输出电压建立时间
4
数字串扰
最小负载电阻
电源
V
DD
范围
I
DD
I
SS
开关特性
4, 5
地址写入设置时间,t
AS
地址写入保持时间,t
AH
数据有效到写设置时间,t
DS
数据有效到写保持时间,t
DH
写脉宽,T
WR
(V
DD
= 11.4 V至16.5 V ,V
SS
= -5V 10 % , AGND = DGND = 0 V ; V
REF
= 2 V至(Ⅴ
DD
– 4 V)
1
,
除非另有说明。所有特定网络阳离子牛逼
给T
最大
除非另有说明)。
K,B版本
2
8
±
1
±
0.5
±
1
±
0.5
±
20
±
20
±
50
2至(Ⅴ
DD
– 4)
2
50
200
2.4
0.8
±
1
8
二进制
2.5
4
10
2
11.4/16.5
13
11
0
0
50
0
50
单位
LSB(最大值)
LSB(最大值)
LSB(最大值)
LSB(最大值)
PPM /°C的典型值
毫伏最大
毫伏/°C的
典型值
V MIN到V最大
千瓦分钟
pF的分
pF的最大
V分钟
V最大
mA
最大
pF的最大
条件/评论
V
DD
= 15 V
±
5%, V
REF
= 10 V
保证单调性
V
DD
= 14 V至16.5 V ,V
REF
= +10 V
当每个DAC装有全0时发生。
当每个DAC装有全1时发生。
V
IN
= 0 V或V
DD
V / ms以上
ms
最大
纳伏秒(典型值)
千瓦分钟
V MIN / V最大
最大mA
最大mA
ns(最小值)
ns(最小值)
ns(最小值)
ns(最小值)
ns(最小值)
V
REF
= 10 V ;建立时间
±
1/2最低位
V
OUT
= 10 V
对于指定的性能
输出空载; V
IN
= V
INL
或V
INH
输出空载; V
IN
= V
INL
或V
INH
笔记
1
最大可能的基准电压。
2
温度范围如下:
K版: -40∞C至+ 85∞C
B版本: -40∞C至+ 85∞C
3
通过设计保证。未经生产测试。
4
在25℃下的样品进行测试,以确保遵守。
5
开关特性适用于单,双电源供电。
特定网络阳离子如有更改,恕不另行通知。
–2–
启示录
D
AD7226
单电源
参数
静态性能
决议
总非调整误差
微分非线性
参考输入
输入阻抗
输入电容
3
数字输入
输入高电压,V
INH
输入低电压,V
INL
输入漏电流
输入电容
输入的码
动态性能
输出电压摆率
4
输出电压建立时间
4
数字串扰
最小负载电阻
电源
V
DD
范围
I
DD
笔记
1
最大可能的基准电压。
2
温度范围如下:
K版: -40∞C至+ 85∞C
B版本: -40∞C至+ 85∞C
3
通过设计保证。未经生产测试。
4
在25℃下的样品进行测试,以确保遵守。
特定网络阳离子如有更改,恕不另行通知。
(V
DD
= 15 V 5%, V
SS
= AGND = DGND = O V ; V
REF
= 10 V
1
除非另有说明。
所有特定网络阳离子牛逼
给T
最大
除非另有说明)。
K,B版本
2
8
±
2
±
1
2
50
200
2.4
0.8
±
1
8
二进制
2
4
10
2
14.25/15.75
13
单位
LSB(最大值)
LSB(最大值)
千瓦分钟
pF的分
pF的最大
V分钟
V最大
mA
最大
pF的最大
条件/评论
保证单调性
当每个DAC装有全0时发生。
当每个DAC装有全1时发生。
V
IN
= 0 V或V
DD
V / ms以上
ms
最大
纳伏秒(典型值)
千瓦分钟
V MIN / V最大
最大mA
建立时间
±
1/2最低位
V
OUT
= +10 V
对于指定的性能
输出空载; V
IN
= V
INL
或V
INH
绝对最大额定值
1
V
DD
到AGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.3 V , 17 V
V
DD
到DGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.3 V , 17 V
V
SS
到AGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -7 V ,V
DD
V
SS
到DGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -7 V ,V
DD
V
DD
到V
SS
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . –0.3 V, +24 V
AGND至DGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.3 V ,V
DD
数字输入电压至DGND 。 。 。 。 。 。 。 0.3 V ,V
DD
+ 0.3 V
V
REF
到AGND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 0.3 V ,V
DD
V
OUT
到AGND
2
. . . . . . . . . . . . . . . . . . . . . . . . . . . . V
SS
, V
DD
功率耗散(任何套餐)到75∞C 。 。 。 。 。 。 。 。 。 。 500毫瓦
减额以上75∞C了。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 2.0毫瓦/ ∞C
工作温度
商业(K版) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -40 ° C至+ 85°C
工业(B版) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -40 ° C至+ 85°C
储存温度。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ° C至+ 150°C
引线温度(焊接, 10秒) 。 。 。 。 。 。 。 。 。 。 。 。 。 300℃
笔记
1
注意,超出上述绝对最大额定值可能会导致perma-
新界东北损坏设备。这是一个额定值,功能的操作
器件在这些或以上的任何其他条件,在操作说明
本规范的部分将得不到保证。暴露在绝对最大额定值
长时间条件下可能影响器件的可靠性。
2
输出可以被缩短到AGND提供的功耗
不超出包。通常情况下,以AGND短路电流为50毫安。
小心
ESD (静电放电)敏感器件。静电荷高达4000 V容易
积聚在人体和测试设备,可排出而不被发现。虽然
AD7226具有专用ESD保护电路,永久性的损害可能对设备产生
受到高能量静电放电。因此,适当的ESD防范措施建议
以避免性能下降或功能丧失。
启示录
D
–3–
AD7226
销刀豆网络gurations
DIP和SOIC / SSOP
V
OUT
B
1
V
OUT
A
2
V
SS 3
V
REF 4
AGND
5
V
OUT
C
V
OUT
D
V
DD
A0
A1
20
19
18
17
AD7226
16
DGND
6
顶视图
15
WR
(不按比例)
14
DB0(LSB)
DB7 (MSB)
7
DB6
8
DB5
9
DB4
10
13
12
11
DB1
DB2
DB3
PLCC
V
OUT
B
1
V
OUT
C
20
3
2
V
OUT
D
19
18
V
DD
17
A0
16
A1
15
WR
14
DB0(LSB)
13
V
REF
4
AGND
5
DGND
6
DB7 (MSB)
7
DB8
8
9
10
11
12
V
SS
DB5
顶视图
(不按比例)
DB4
V
OUT
A
AD7226
DB3
DB2
术语
总非调整误差
微分非线性
这是一个全面的规范,其中包括全尺寸
误差,相对准确度和零代码错误。最大输出
电压为V
REF
- 1 LSB (理想) ,其中1 LSB (理想)为V
REF
/
256. LSB大小会随着变化了的V
REF
范围内。因此,零
码错误会相对于LSB的大小,增加为V
REF
减小。
因此,总的调整误差,其包括零
码错误,也将各不相同的LSB的比V条款
REF
范围内。
其结果是,被指定的总非调整误差固定为参考
为10 V电压ENCE
相对精度
微分非线性是测得的差
更改任意两个相邻之间的理想的1 LSB变化
码。的额定微分非线性
±
1 LSB(最大值)过
在工作温度范围内确保单调性。
数字串扰
传送给一个转换器的输出处的毛刺脉冲
由于在数字输入码到另一CON组的变化
变流器。它被指定为nV秒,并测量V
REF
= 0 V.
满量程误差
满量程误差定义为:
测量值 - 零代码错误 - 非常超值
相对精度或端点非线性,是衡量
从一个直线穿过的最大偏差
DAC传递函数的端点。这是后测量
允许零点和满度误差和正常表达
在LSB的或满量程读数的百分比。
DB1
–4–
启示录
D
AD7226
电路信息
D / A部分
在单电源供电(V
SS
= 0 V = AGND)与输出
把接近AGND (即数字代码接近全0 )
V
DD
的AD7226包含四个相同的8位,电压模式数字 -
模拟转换器。来自转换器的输出电压具有
相同极性的基准电压使单电源操作
化。对AD7226的新型DAC开关对布置允许
参考电压范围从2 V至12.5V。
每个DAC包括一个高度稳定的薄膜, R-2R梯形的
八高速NMOS ,单刀双掷
开关。的简化电路图对一个信道是
如图1所示。注意是V
REF
( 4针)和AGND (引脚5 )
通用于所有四个DAC 。
I / P
O / P
400 A
V
SS
图2.放大器输出级
R
2R
2R
DB0
V
REF
AGND
如图所示为全1 ON DAC
2R
DB5
R
2R
DB6
R
2R
DB7
V
OUT
当前的负载不再充当电流吸收器,并开始充当
为约2千瓦的电阻负载到AGND。出现这种情况
作为NMOS晶体管的脱离饱和。这意味着
即,在单电源供电,接收器的扩增能力
当输出电压等于或近AGND fiers减小。一
电流吸收能力的变化的典型曲线与输出
放的电压示于图3 。
500
图1. D / A简化电路图
在V输入阻抗
REF
在AD7226的引脚是
四个单独的DAC基准输入的并联组合
阻抗。这是代码的依赖,并可能从2千瓦到
无穷大。最低的输入阻抗(即,2个
千瓦)
当发生
所有四个DAC都装有数字代码01010101 。
因此,重要的是,基准呈现低
在变化的负荷条件下的输出阻抗。节点
电容在参考终端也是代码依赖
和一般少则100 pF到250 pF的。
每个V
OUT
销可以被认为是数字可编程
电压源的输出电压:
V
的OUTx
=
D
X
V
REF
V
SS
= –5V
400
I
SINK
( A)
300
V
SS
= 0
200
V
DD
= +15V
100
(1)
0
0
2
4
V
OUT
(V)
6
8
10
哪里
D
X
是的数字输入码小数表示
并且可以变化为0 255/256 。
源阻抗的缓冲器的输出电阻
放大器。
OP放大器部分
图3.变异我
SINK
随着V
OUT
各电压模式的D / A转换器的输出由一个统一缓冲
获得,同相CMOS放大器。此缓冲放大器是
能够发展10 V在一个2千瓦的负荷,可以驱动
3300 pF的容性负载。此放大器的输出级
由来自V双极晶体管的
DD
线和一个电流
加载到V
SS
时,负电源的输出放大器。
这个输出级,如图2所示。
NPN晶体管提供所需的输出电流驱动
(最多5 mA)的。当前的负载由NMOS晶体管
通常作为400的恒定电流吸收
mA
到V
SS
,
让每个输出大约灌电流能力
400
mA
如果需要的话。
该AD7226可以操作产生的单电源或双电源
在从输出部分参数不同性能
放大器器。
如果完全吸收能力,需要具有输出电压,或
附近AGND ( = 0 V) ,则V
SS
可以通过5伏被带到0V以下
并由此保持400
mA
在表示电流吸收器
图3.偏置V
SS
低于0 V还提供了额外的余量
在输出放大器,它允许更好的零码错误
每个输出性能。还改进是压摆率和
负向放大器的稳定时间(在后面讨论) 。
每个放大器的偏移,以制造过程中,激光微调
消除偏移归零的任何要求。
数字部分
在AD7226的数字输入TTL和CMOS
( 5 V ),从V兼容
DD
= 11.4 V至16.5 V所有逻辑输入
是静态保护, MOS门与典型的输入电流
比1 nA的少。内部输入保护是由所获得的
片上分布式二极管从DGND每个MOS栅极。对
最大限度地减少电源电流,则建议的
数字输入电压来驱动尽可能靠近电源轨(V
DD
和DGND )的实际可能。
启示录
D
–5–
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    电话:0755-82780082
    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

    AD7226KPZ
    -
    -
    -
    -
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联系人:吴小姐
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