a
特点
500 MHz的驱动程序操作
驱动禁止功能
100 ps的边缘匹配
担保行业规范
50
输出阻抗
>1.5 V / ns的压摆率
可变输出电压为ECL ， TTL和CMOS
高速差分输入提供最大的灵活性
与内置散热器超小型20引脚SOP封装
应用
自动测试设备
半导体测试系统
电路板测试系统
仪器仪表和表征设备
超高速引脚驱动器
与禁止模式
AD53040
功能框图
V
CC
V
CC
V
EE
V
EE
39nF
V
H
数据
数据
INH
INH
V
L
司机
50
V
OUT
V
LDCPL
TV
CC
V
HDCPL
39nF
AD53040
1.0 / K
THERM
GND
GND
GND
GND
GND
产品说明
该AD53040是一款完整的高速引脚驱动器设计
在数字或混合信号测试系统使用。结合了高
加快整体进程，独特的表面贴装封装，
该产品达到同时preserv-精湛的电气性能
荷兰国际集团最佳包装密度和长期可靠性在一个
超小型20引脚的SOP封装有内置散热器。
它采用了-3 V单位增益可编程输出电平
+8 V ，小于100 mV至9 V输出摆幅能力，
该AD53040的目的是刺激ECL ， TTL和CMOS
逻辑系列。在500MHz的数据速率容量和匹配
输出阻抗允许对这些实时刺激
数字逻辑系列。测试I / O设备时，引脚驱动器可以
可切换成高阻抗状态（禁止模式） ， electri-
美云除去从路径中的驱动程序。引脚驱动器的泄漏
目前抑制通常是100 nA和输出电荷转移
进入禁止通常小于20 pC的。
从HI / LO或抑制AD53040过渡控制
通过数据和抑制输入。输入电路的用途
用的共模范围高速差分输入
±
3五，这样就可以直接连接到差分精度
电致化学发光的定时或从一个刺激的管脚驱动器的简单性
单端TTL或CMOS逻辑信号源。模拟逻辑HI / LO
输入也同样很容易连接。通常需要10
A
of
偏置电流，所述AD53040可以直接耦合到
输出的数字 - 模拟转换器。
该AD53040可在一个20引脚SOP封装，
内置散热器和被指定为工作在环境
商业级温度范围为-25 ° C至+ 85°C 。
版本B
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使用，也不对第三方专利或其他权利的任何侵犯
这可能是由于它的使用。没有获发牌照以暗示或
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万维网网站： http://www.analog.com
传真： 781 / 326-8703
ADI公司， 1999
是T =
5 +V =
AD53040–SPECIFICATIONS
是（所有规格+ 75atC - 95 + 85 （ AC 39 NFC ，电容+ 12 V BE3 ％ ， -V = -7 V
3 ％，除非另有说明。所有的温度系数
在T =测
C).
必须连接之间
J
S
S
J
V
CC
和V
HDCPL
和V之间
EE
和V
LDCPL
.)
参数
差分输入特性
输入摆幅（数据以
数据显示，
INH到
INH ）
马克斯（ DATA ，
数据）
闵（ INH ，
INH ）
马克斯（ INH ，
INH ）
闵（数据，
数据）
偏置电流
参考输入
偏置电流
输出特性
逻辑高电平范围
–50
–2
民
典型值
ECL
±
10
+50
+8
最大
2
2
单位
伏
伏
A
A
伏
测试条件
V
IN
= –2 V, 0.0 V
V
L
, V
H
= 5 V
DATA = H ，V
H
= -2 V至+8 V
V
L
= –3 V (V
H
= -2 V至6 V）
V
L
= –1 V (V
H
= 6 V至8 V）
数据= L，V
L
= -3 V至+5 V ，V
H
= +6 V
V
L
= –0.05 V, V
H
= 0.05 V和
V
L
= –2 V, V
H
= +7 V
DATA = H ，V
H
= -2 V至8 V ，V
L
= –3 V
DATA = H ，V
H
= -2 V至8 V ，V
L
= –3 V
数据= L，V
L
= -3 V至+5 V ，V
H
= +6 V
数据= L，V
L
= -3 V至+5 V ，V
H
= +6 V
V
L
, V
H
= 0 V ，+ 5 V和-3 V ， 0 V
DATA = H ，V
H
= +3 V, V
L
= 0 V,
I
OUT
= 30毫安
V
OUT
= -3 V至+8 V
C
BYP
= 39 nF的，V
H
= +7 V, V
L
= –2 V
输出到-3 V ，V
H
= +8 V, V
L
= –1 V,
DATA = H ，并输出到+8 V ，V
H
= +6 V,
V
L
= -3 V ， DATA = L
V
S
= V
S
±
3%
逻辑低量程
振幅（V
H
和V
L
)
绝对精度
V
H
OFFSET
V
H
增益+线性误差
V
L
OFFSET
V
L
增益+线性误差
失调TC ，V
H
或V
L
输出电阻
输出漏
动态限流
静态电流限制
–3
0.1
+5
9
伏
伏
–100
±
0.3
±
5
–100
±
0.3
±
5
0.5
47
45
–1.0
100毫伏
％V的
H
+ MV
100毫伏
％V的
L
+ MV
毫伏/°C的
49
+1.0
A
mA
mA
150
±
65
PSRR ，驱动模式
动力性能，驱动器
(V
H
和V
L
)
传播延迟时间
传播延迟TC
延迟匹配，边缘到边缘
上升和下降时间
1 V秋千
3 V秋千
5 V秋千
上升和下降时间TC
1 V秋千
3 V秋千
5 V秋千
过冲，下冲和前冲
35
dB
1.5
2
100
ns
PS /°C的
ps
测得的50％ ，V
H
= 400 mV时，
V
L
= -400 mV的
测得的50％ ，V
H
= 400 mV时，
V
L
= -400 mV的
测得的50％ ，V
H
= 400 mV时，
V
L
= -400 mV的
测得的20％-80 ％以下，V
L
= 0 V, V
H
= 1 V
测得的10％-90 ％以下，V
L
= 0 V, V
H
= 3 V
测得的10％-90 ％以下，V
L
= 0 V, V
H
= 5 V
测得的20％-80 ％以下，V
L
= 0 V, V
H
= 1 V
测得的10％-90 ％以下，V
L
= 0 V, V
H
= 3 V
测得的10％-90 ％以下，V
L
= 0 V, V
H
= 5 V
A. V
L
, V
H
= 0.0 V, 1.0 V
B 。 V
L
, V
H
= 0.0 V, 3.0 V
。 V
L
, V
H
= 0.0 V, 5.0 V
V
L
= 0 V, V
H
= 0.5 V
V
L
= 0 V, V
H
= 0.5 V
V
L
= 0 V, V
H
= 2 V,
脉冲宽度= 2.5纳秒/ 7.5 NS ， NS 30 /100纳秒
0.8
1.7
2.4
±
1
±
2
±
3
±
（1％ 50毫伏）
ns
ns
ns
PS /°C的
PS /°C的
PS /°C的
步骤％ + MV的
建立时间
到15毫伏
4毫伏
延迟变化与脉宽
40
8
50
ns
s
ps
–2–
版本B
AD53040
参数
动力性能，驱动器
(V
H
和V
L
）（续）
最小脉宽
3 V秋千
5 V秋千
切换率
动态性能，抑制
延迟时间，有效抑制
延迟时间，禁止以激活
I / O斯派克
输出电容
电源
总电源电压范围
正电源
负电源
正电源电流
负电源电流
总功耗
温度传感器增益因子
民
典型值
最大
单位
测试条件
1.7
2.6
500
ns
ns
兆赫
4.0 ns输入，10％ / 90 ％的输出，
V
L
= 0 V, V
H
= 3 V
6.0 ns输入，10％ / 90 ％的输出，
V
L
= 0 V, V
H
= 5 V
V
L
= –1.8 V, V
H
= –0.8 V,
V
OUT
> 600 mV的P-P
测得的50％ ，V
H
= +2 V,
V
L
= –2 V
测得的50％ ，V
H
= +2 V,
V
L
= –2 V
V
H
= 0 V, V
L
= 0 V
司机Inhibited（禁用）
2
2
<200
5
19
+12
–7
5
5
ns
ns
毫伏， P-P
pF
V
V
V
mA
mA
W
μA / K
1.15
1.0
75
75
1.43
R
负载
= 10 K，V
来源
= +12 V
笔记
连接或短路的去耦电容至地会导致器件的破坏。
特定网络阳离子如有更改，恕不另行通知。
绝对最大额定值
1
电源电压
+V
S
到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 +13 V
–V
S
到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -8 V
+V
S
为±V
S
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . +20 V
输入
数据显示，
数据显示，
INH ，
INH
. . . . . . . . . . . . . . . . +5 V, –3 V
DATA TO
数据显示，
INH到
INH
. . . . . . . . . . . . . . . . . .
±
3 V
V
H
, V
L
到GND 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 +9 V， -4 V
V
H
到V
L
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . +11 V, 0 V
输出
V
OUT
短路持续时间。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。不定
2
V
OUT
在禁止模式范围
V
HDCPL
。 。 。 。 。不要连接除电容V
CC
V
LDCPL
。 。 。 。 。不要连接除电容V
EE
THERM 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 +13 V， 0 V
环境的
工作温度（结） 。 。 。 。 。 。 。 。 。 。 。 。 。 。 + 175℃
储存温度。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 -65 ° C至+ 150°C
焊接温度（焊接， 10秒）
3
. . . . . . . . . . +260°C
笔记
1
注意，超出上述绝对最大额定值可能会导致perma-
新界东北损坏设备。这是一个压力只有额定值。的功能操作
器件在这些或以上的任何其他条件，在操作说明
本规范的部分将得不到保证。绝对最大限制
个别地，而不是在组合。暴露在绝对最大额定值条件
长时间可能会影响器件的可靠性。
2
输出短路保护功能，保证只要适当的散热是
用来确保遵守操作温度限制。
3
为了保证引脚共面性（ ±0.002英寸），可焊性，处理与裸
手应避免与该设备应在24被存储在环境
°C
±
5 ° C（ 75 °F
±
10 °F），相对湿度不超过65％。
订购指南
装运方法，
单位数量
包
中海集装箱选项
RP-20
模型
包
描述
AD53040KRP 20引脚SOIC封装功率管， 38件
小心
ESD （静电放电）敏感器件。静电荷高达4000 V容易
积聚在人体和测试设备，可排出而不被发现。
虽然AD53040具有专用ESD保护电路，可能永久的损坏
发生在受到高能静电放电设备。因此，适当的ESD
预防措施建议，以避免性能下降或功能丧失。
警告！
ESD敏感器件
版本B
–3–
AD53040
应用信息
电源分配，旁路和测序
该AD53040吸引了来自大量的瞬态电流的
州和精心的设计之间进行切换时电源
动力分配旁路的关键是得到试样
田间表现。耗材应使用广泛的分布，
低电感的痕迹或（最好）面的多层
板与一个专用的接地平面层。设备的所有的
电源管脚，应使用最小化内部IN-
感抗的部分的接合线呈现。每个人都必须供应
被旁路到地与至少一种0.1
F
电容;削片
风格电容是最好，因为它们减少电感。一
以上10
F
（或更高）每板钽电容
还建议提供额外的局部能量存储。
该AD53040的限流电路，还需要外部
旁路电容。图1示出了一个简化的示意性
正电流限制电路。在输出过大的集电极电流
放晶体管Q49产生跨越10上的电压降
电阻
器，它打开PNP晶体管Q48 。 Q48转移的rising-
边摆电流，关闭电流镜和去除
荷兰国际集团在输出级的基极驱动。在V
HDCPL
引脚应
旁路到正电源用0.039
F
电容，而
在V
LDCPL
销（未示出）需要一个类似电容器的
消极的供应─这些电容保证了AD53040
在正常的输出转换了没有电流限制其
全9 V额定步长。这两个电容必须有最小 -
长度连接到AD53040 。在这里，片状电容器
是理想的。
VPOS
10
Q48
10%
V
HDCPL
关于限流电路，有几点应注意。
首先，限幅电流不严格控制，因为它们是
无论是绝对晶体管V的功能
BES
和结温
perature ;较高的直流输出电流可在下部结
温度。第二，必须以连接在V
HDCPL
电容器到正电源（和V
LDCPL
电容
负电源） -failure这样做会导致相当大的热敏
发作应力在正常支持在限流电阻（多个）
帘布层测序并可能最终导致它们失效，渲染
部分无功能。最后， AD53040可能会出现
正常为小输出的步骤（小于3伏左右） ，如果
其中一个电容器的一个或两个是不存在的，但它会表现
过度上升或下降时间步骤较大振幅。
该AD53040不需要特殊的电源排序。
然而，良好的设计实践决定了数字和模拟
控制信号不被施加到部件的供应是前
稳定。违反这一原则不会破坏正常的
一部分，但活性输入可以绘制相当大的电流，直到
主电源被应用。
数字输入范围限制
总范围在所有的数字信号（数据，
数据显示，
INH ，
和
INH ）
必须是小于或等于2 V到满足规定的
时序。该装置将上述功能2 V降低perfor-
MANCE直至绝对最大极限。这一业绩
降解可能不被注意到，在所有操作模式。的
所有六种可能的转变（Ⅴ
H
v
V
L
, V
L
v
V
H
, V
H
v
INH ，
INH
v
V
H
, V
L
v
INH和INH
v
V
L
），有可能只有一个
这将显示出降解，通常是在延迟时间。采取
极端情况下，驾驶员可能无法实现正确的输出电压
年龄，输出阻抗，或可能无法完全抑制。
一个场景，不会对AD53040工作的一个例子
如果是部分采用5 V单端CMOS驱动。一针
每个差分输入将被捆绑到+ 2.5V参考电平
与逻辑电压将被施加到另一个。这将
符合绝对最大额定值
±
3 V，因为最大
差是。
±
2.5V。然而，可以，例如，用于
0.0V，要施加到所述INH输入和+ 5V施加到
数据输入。这5 V的差异远远超过了2.0 V
上面给出的限制。即使采用3 V CMOS或TTL的
逻辑高和逻辑低之间差值大于或
等于3 V ，将无法正常工作。唯一的办法是
使用电阻分压器或等同的降低的电压电平。
上升沿SLEW
控制电流
电平位移
逻辑驱动器
V
H
VNEG
Q49
OUT
5.12V
Q50
550mV
/ DIV
该AD53040输出图1.原理示意图
舞台上，正电流限制电路
–380mV
66.25ns
500ps/DIV
71.25ns
图2. 5 V输出摆幅
版本B
–5–
QQ：2881677436 复制
