a
特点
AC '97 2.3兼容功能
S / PDIF输出, 20位数据格式,支持
48 kHz和44.1 kHz采样率
集成立体声耳机放大器器
可变采样率的音频
外部音频断电控制
大于90 dB动态范围
立体声全双工编解码器
20位PCM DAC
3模拟线路电平立体声输入,
LINE-IN , AUX和CD
单声道线路电平输入手机
双麦克风输入,内置可编程前置放大器
与地面感的高品质CD输入
AC '97的SoundMAX编解码器
AD1981BL
单声道输出扬声器或内置扬声器
电源管理支持
48引脚LQFP封装,无铅封装
增强功能
立体声MIC前置放大器支持
内置数字均衡器功能优化
扬声器的声音
全双工可变采样率从7040 Hz至
48 kHz的1 Hz分辨率
杰克检测引脚提供自动输出开关
软件编程V
REFOUT
输出偏置
麦克风和外置功率放大器
低功耗3.3 V操作模拟和
数字电源
多种编解码器的配置选项
功能框图
V
REFOUT
V
REF
XTL_OUT XTL_IN SPDIF
AD1981BL
G
麦克风前置放大器
MIC1
MS
电压
参考
核心编解码器
G
G
2CMIC
SPDIF
TX
MIC2
PHONE_IN
CD_L
CD_GND
CD_R
AUX_L
AUX_R
LINE_IN_L
LINE_IN_R
CD
差动放大器
PCM L / R
ADC率
记录
选择器
PLL
ID0
G
M
16-BIT
- ADC
16-BIT
- ADC
ID1
G
M
G
G
MONO_OUT
M
A
混
M
M
16-BIT
- ADC
16-BIT
- ADC
AC '97接口
ADC
和
DAC
SLOT
逻辑
RESET
SYNC
BIT_CLK
EQ的核心存储
M
GA
20-BIT
- DAC
绕行
SDATA_OUT
EQ
HP_OUT_L
HP
M
A
输出选择器
M
GA
GA
M
M
M
M
GA
GA
GA
GA
M
M
M
M
M
GA
GA
GA
20-BIT
- DAC
PCM前
DAC率
绕行
SDATA_IN
EQ
LINE_OUT_L
MZ
A
G =增益
A =衰减
M =静音
Z =高阻态
LINE_OUT_R
MZ
A
AC '97
控制
注册
HP_OUT_R
HP
M
A
M
模拟混合
控制逻辑
EAPD
JS0
JS1
EAPD
第0版
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AD1981BL–SPECIFICATIONS
标准试验条件下,除非
另有说明
DAC测试条件
温度
数字电源( DVDD )
模拟电源( AVDD )
采样速率(六
S
)
输入信号
模拟输出通带
25°C
3.3 V
3.3 V
48千赫
1008赫兹
20赫兹到20千赫兹
CALIBRATED
-3 dB衰减相对于满量程
0分贝输入
10 kΩ输出负载( LINE_OUT )
32
输出负载( HP_OUT )
ADC测试条件
CALIBRATED
增益为0 dB
输入-3.0分贝相对于满量程
参数
模拟量输入
输入电压( RMS值假设正弦波输入)
LINE_IN , AUX ,CD , PHONE_IN
MIC_IN与20分贝增益
MIC_IN 0 dB增益
输入阻抗
1
输入电容
1
主音量
步长(0 dB至-46.5 dB为单位) : LINE_OUT_L , LINE_OUT_R
输出衰减范围
1
步长(0 dB至-46.5 dB为单位) : MONO_OUT
输出衰减范围
1
步长(0 dB至-46.5 dB为单位) : HP_OUT_R , HP_OUT_L
输出衰减范围跨度
1
0dB的基本静音衰减
1
可编程增益放大器, ADC
步长(0 dB到22.5分贝)
PGA增益范围
模拟混频器输入增益/放大器/衰减器
信号 - 噪声比( SNR)的
CD到LINE_OUT
其他与LINE_OUT
1
步长(+12 dB至-34.5 dB为单位) (所有步骤测试) :
MIC_IN , LINE_IN ,CD , AUX , PHONE_IN , DAC
输入增益/衰减范围:
MIC_IN , LINE_IN ,CD , AUX , PHONE_IN , DAC
数字抽取和内插滤波器
1
通带
通带纹波
过渡带
阻带
阻带抑制
群时延
群时延变化过通带
民
典型值
最大
单位
0.707
2.0
0.0707
0.2
0.707
2.0
20
5
1.5
46.5
1.5
46.5
1.5
46.5
80
1.5
22.5
7.5
V有效值
V P-P
V有效值
V P-P
V有效值
V P-P
k
pF
dB
dB
dB
dB
dB
dB
dB
dB
dB
90
90
1.5
46.5
0
0.4
0.6
–74
f
S
f
S
16/f
S
0
0.4 f
S
±
0.09
0.6 f
S
dB
dB
dB
dB
Hz
dB
Hz
Hz
dB
美国证券交易委员会
s
–2–
第0版
AD1981BL
参数
模拟 - 数字转换器
决议
总谐波失真( THD )
动态范围( -60 dB输入THD + N参考满量程,
A计权)
信噪比,互调失真
1
( CCIF方法)
ADC串扰
1
线路输入(输入L,地面R,读R ,输入R,地面L,读L)
LINE_IN到其他
增益误差
2
(满刻度量程相对于标称输入电压)
通道间增益不匹配(增益误差的差异)
ADC失调误差
1
数字 - 模拟转换器
决议
总谐波失真( THD ) LINE_OUT
总谐波失真( THD ) HP_OUT
动态范围( -60 dB输入THD + N参考满量程,
A计权)
信噪比,互调失真
1
( CCIF方法)
增益误差
2
( FS输出电压相对于额定输出电压FS )
通道间增益不匹配(增益误差的差异)
DAC串音
1
(输入L,零点R,测量R_OUT ;输入R,
零L,测量L_OUT )
模拟输出
满量程输出电压; LINE_OUT和MONO_OUT
输出阻抗
1
外部负载阻抗
1
输出电容
1
外部负载电容
1
满量程输出电压; HP_OUT (0 dB增益)
外部负载阻抗
1
V
REF
V
REF_OUT
V
REF_OUT
电流驱动
点击静音(静音负输出未静噪中间电平DAC输出)
静态数码产品规格
高电平输入电压(V
IH
) :数字输入
低电平输入电压(V
IL
)
高电平输出电压(V
OH
), I
OH
= 2毫安
低电平输出电压(V
OL
), I
OL
= 2毫安
输入漏电流
输出漏电流
电源
电源范围 - ( AV
DD
和DV
DD
)
功耗
模拟电源电流3.3 V ( AV
DD
)
数字电源电流3.3 V ( DV
DD
)
电源抑制( 100 mV峰峰值信号@ 1 kHz时)
1
(在模拟和数字电源引脚,两个ADC和DAC )
民
典型值
16
–87
78
83
85
–80
–100
最大
单位
位
dB
dB
dB
dB
dB
%
dB
mV
位
dB
dB
dB
±
10
±
0.7
–80
0.707
2.0
800
10
15
100
1
32
1
1.12
2.25
±
5
0.65
0.9
–10
–10
3.0
287
39
48
40
DVDD
0.35
DVDD
0.1 DVDD
+10
+10
3.47
DVDD
1.225
5
dB
%
dB
dB
V有效值
V P-P
k
pF
pF
V有效值
V
V
mA
mV
V
V
V
V
A
A
V
mW
mA
mA
dB
–80
±
10
±
0.5
±
5
82
20
–88
–81
87.5
–100
第0版
–3–
AD1981BL
特定网络阳离子
(续)
参数
时钟特定网络阳离子
1
输入时钟频率
推荐时钟占空比
笔记
1
保证,但未经测试。
2
测量结果反映的主要ADC。
特定网络阳离子如有更改,恕不另行通知。
民
典型值
24.576
50
最大
单位
兆赫
%
40
60
参数
POWER- DOWN STATES *
(完全有效)
ADC
DAC
ADC + DAC
混频器
ADC +调音台
DAC +调音台
ADC + DAC +调音台
待机
耳机待机
*值
呈现V
REFOUT
未加载。
特定网络阳离子如有更改,恕不另行通知。
设置位
(没有位值)
PR0
PR1
PR1 , PR0
PR2
PR2 , PR0
PR2 , PR1
PR2 , PR1 , PR0
PR5 , PR4 , PR3 , PR2 , PR1 , PR0
PR6
DV
DD
典型值
47.76
40.1
32.8
13.2
47.7
40
32.77
13.9
0
47.7
AV
DD
典型值
38.9
34.39
26.3
20.55
19.39
14.86
6.39
1.15
0
32
单位
mA
mA
mA
mA
mA
mA
mA
mA
mA
mA
时序参数
参数
(保证在工作温度范围)
符号
t
rst_low
t
RST2CLK
t
sync_high
t
sync_low
t
SYNC2CLK
t
clk_period
t
clk_high
t
clk_low
t
sync_period
t
格局
t
HOLD
t
RISECLK
t
FALLCLK
t
RISESYNC
t
FALLSYNC
t
RISEDIN
t
FALLDIN
t
RISEDOUT
t
FALLDOUT
t
S2_PDOWN
t
SETUP2RST
t
关闭
32.56
32.56
5
5
2
2
2
2
2
2
2
2
0
15
25
15
50
15
民
162.8
1.3
19.5
162.8
12.288
81.4
750
42
38
48.0
20.8
2.5
4
4
4
4
4
4
4
4
±
1
2000
48.84
典型值
1.0
最大
单位
ms
ns
s
s
ns
兆赫
PPM
ns
ps
ns
ns
千赫
ms
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ms
ns
ns
ns
ns
ns
RESET
低电平脉冲宽度
RESET
不活跃到BIT_CLK启动延迟
SYNC高电平脉冲宽度
SYNC低电平脉宽
SYNC无效到BIT_CLK启动延迟
BIT_CLK频率
BIT_CLK频率精度
BIT_CLK期
BIT_CLK输出抖动
1, 2, 3
BIT_CLK高脉冲宽度
BIT_CLK低脉冲宽度
同步频率
SYNC期
安装到BIT_CLK的下降沿
从BIT_CLK的下降沿举行
BIT_CLK上升时间
BIT_CLK下降时间
SYNC的上升时间
SYNC下降时间
SDATA_IN上升时间
SDATA_IN下降时间
SDATA_OUT上升时间
SDATA_OUT下降时间
插槽2月末至BIT_CLK , SDATA_IN低
设置,重置后缘
(适用于SYNC, SDATA_OUT )
复位到高阻延迟上升沿
传播延迟
RESET
上升时间
从BIT_CLK的上升沿到SDI有效输出有效延迟
6
6
6
6
6
6
6
6
1.0
笔记
1
保证,但未经测试。
2
输出抖动是直接依赖于晶体的输入抖动。
3
最大抖动规范只非晶态操作。水晶操作最大的要低得多。
特定网络阳离子如有更改,恕不另行通知。
–4–
第0版
AD1981BL
t
RST2CLK
t
rst_low
RESET
t
TRI2ACTV
BIT_CLK
t
TRI2ACTV
SDATA_IN
图1.冷复位时序(编解码器是直供BIT_CLK信号)
t
sync_high
SYNC
t
SYNC2CLK
BIT_CLK
图2.热复位时序
t
clk_low
BIT_CLK
t
clk_high
t
clk_period
t
sync_low
SYNC
t
sync_high
t
sync_period
图3.时钟时序
BIT_CLK
t
RISECLK
t
FALLCLK
SYNC
t
RISESYNC
t
FALLSYNC
SDATA_IN
t
RISEDIN
t
FALLDIN
SDATA_OUT
t
RISEDOUT
t
FALLDOUT
图4.信号上升和下降时间
第0版
–5–