【2 ADC ， DAC 6 ，96千赫， 24位Σ -Δ编解码器AD1839A特点5 V立体声音响系】,IC型号AD1839AASZ1,AD1839AASZ1 PDF资料,AD1839AASZ1经销商,ic,电子元器件-51电子网

2 ADC ， DAC 6 ，

96千赫， 24位Σ -Δ编解码器

AD1839A

特点

5 V立体声音响系统，带3.3 V宽容数字接口

支持高达96 kHz采样率

192 kHz的采样率可在1 DAC

支持16位/ 20- / 24位字长

多位

Σ-

调制器，具有完善的微分线性

恢复，可降低怠速色调和本底噪声

数据定向加扰DAC的，最不敏感的抖动

单端输出

模数转换器： -95 dB的THD + N 105分贝信噪比和动态范围

数模转换器： -92 dB的THD + N ，有108分贝信噪比和动态范围

片上每个声道音量控制，1024阶线性

规模

DAC和ADC软件可控无杂音静音

数字去重处理

支持256 ×F

, 512 × f

和768 ×F

主时钟模式

掉电模式和软关断模式

灵活的串行数据端口与右对齐，左对齐，

兼容和DSP串行模式

TDM接口模式支持8入/ 8出操作使用

单SHARC SPORT

52引脚MQFP塑料包装

概述

该AD1839A是一种高性能的单芯片编解码器

拥有3个立体声DAC和一个立体声ADC 。每个DAC

包括一个高性能的数字内插滤波器，一个

多位Σ - Δ调制器具有ADI公司的专利

技术，和一个连续时间电压输出模拟部分。

每个DAC都有独立的音量控制和静音无杂音

功能。该ADC包括两个24位转换频道

与多位Σ- Δ调制器和抽取滤波器。

该AD1839A还包含一个片上参考了

2.25五标称值

该AD1839A具有灵活的串行接口，可

各种DSP芯片， AES / EBU的无缝连接

接收器和采样率转换器。该AD1839A可以

配置为左对齐，右对齐，我

S或DSP compati-

BLE串行模式。该AD1839A的控制是通过装置实现

一个SPI兼容的串行端口。而AD1839A可以

从5 V单电源供电，并设有一间独立的

其数字接口电源引脚，允许该设备是

接口使用3.3 V电源供电等设备。该

AD1839A可在一个52引脚MQFP封装，

工作在-40° C至+ 85°C工业温度范围。

应用

DVD视频和音频播放器

家庭影院系统

汽车音响系统

音频/视频接收器

数字音频效果处理

功能框图

DVDD DVDD ODVDD ALRCLK ABCLK ASDATA CCLK CLATCH CIN COUT

MCLK PD / RST M / S AVDD AVDD

AAUXDATA3

DLRCLK

DBCLK

DSDATA1

DSDATA2

DSDATA3

DAUXDATA

ADCLP

ADCLN

ADCRP

ADCRn

Σ-

ADC

Σ-

ADC

控制端口

卷

串行数据

I / O端口

卷

数字

滤波器

数字

滤波器

卷

时钟

数字

滤波器

数字

滤波器

数字

滤波器

Σ-

DAC

Σ-

DAC

Σ-

DAC

OUTL1

OUTR1

OUTL2

OUTR2

OUTL3

OUTR3

FILTD

FILTR

03627-B-001

AD1839A

REF

DGND DGND AGND AGND AGND AGND

图1 。

版本B

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传真： 781.326.8703

AD1839A

规格................................................. .................................... 3

测试条件................................................ ............................. 3

时序规格................................................ ....................... 5

绝对最大额定值............................................... ............. 7

温度范围................................................ ...................... 7

ESD注意事项................................................ .................................. 7

引脚配置和功能说明............................. 8

典型性能特征............................................. 9

术语................................................. ................................... 11

功能概述................................................ ...................... 12

ADC的................................................. ........................................... 12

DAC的................................................. ........................................... 12

DAC和ADC编码.............................................. ................ 12

AD1839A时钟方案............................................... ...... 12

复位和掉电............................................. ............. 13

电源和基准电压源....................................... 13

串行控制端口............................................... ...................... 13

串行数据端口，数据格式............................................ ... 14

包装方式................................................ ............................. 14

辅助时分多路复用（ TDM ）模式........... 14

控制/状态寄存器.............................................. .............. 19

级联方式................................................ ............................. 22

外形尺寸................................................ ....................... 24

订购指南................................................ .......................... 24

修订历史

5月4日，数据手册，从版本A更改为版本B

更新FormatUniversal

更改数据表标题1

2月4日，数据表，从第0更改为版本A

更改订购指南.............................................. ............... 6

删除时钟信号组.............................................. ......... 11

新增AD1835A时钟方案第................................ 11

添加表二和表三和重新编号如下表11

更改辅助（ TDM模式）第................................ 13

图5 ..............................................变化........................... 14

变化图6 .............................................. ........................... 14

添加图7a和8a ............................................. .................... 15

更名为图7和图8至图7b和图8b ..... 15

图9 ..............................................变化........................... 15

更改表VIII .............................................. ....................... 21

更新的外形尺寸............................................... ......... 24

版本B |页24 2

AD1839A

特定网络阳离子

测试条件

电源电压

环境温度

输入时钟

DAC的输入信号

ADC输入信号

输入采样率（F

)

测量带宽

字宽

负载电容

负载阻抗

5.0 V （ AVDD ， DVDD ）

25°C

12.288兆赫（ 256 ×F

模式）

1.0078125千赫， 0 dBFS的

1.0078125千赫，

dBFS的

48千赫

0赫兹至20千赫兹

24位

100 pF的

47 k

所有信道的性能是相同的（除了通道间增益失配和间相位偏差规格）。

表1中。

参数

模拟 - 数字转换器

ADC的分辨率

动态范围（ 20 Hz至20 kHz ， -60 dB输入）

无滤波器

A加权（ 48 kHz和96 kHz时）

总谐波失真+噪声（ THD + N）

48千赫

96千赫

通道间隔离

通道间增益不匹配

模拟输入

差分输入范围（ ±满量程）

共模输入电压

输入阻抗

输入电容

REF

DC精度

增益误差

增益漂移

数字 - 模拟转换器

DAC分辨率

动态范围（ 20 Hz至20 kHz ， -60 dBFS的输入）

无滤波器

A加权滤波器（ 48 kHz和96 kHz时）

总谐波失真+噪声（ 48 kHz和96 kHz时）

通道间隔离

DC精度

增益误差

通道间增益不匹配

增益漂移

通道间相位偏差

音量控制步长（ 1023级线性）

音量控制范围（最大衰减）

静音衰减

去加重增益误差

满量程输出电压在每个引脚（单端）

输出阻抗在每个引脚

共模输出电压

民

典型值

103

105

–95

100

0.025

–2.828

2.25

±5

103

105

108

–92

110

±4

0.025

200

±0.1

0.098

–100

±0.1

1.0 (2.8)

180

2.25

–88.5

–87.5

最大

单位

位

PPM /°C的

位

PPM /°C的

度

V有效值（V P-P ）

100

+2.828

–90

版本B |第24 3

AD1839A

参数

ADC抽取滤波器， 48千赫

通带

通带纹波

阻带

阻带衰减

群时延

ADC抽取滤波器， 96千赫

通带

通带纹波

阻带

阻带衰减

群时延

DAC插值滤波器， 48千赫

通带

通带纹波

阻带

阻带衰减

群时延

DAC插值滤波器， 96千赫

通带

通带纹波

阻带

阻带衰减

群时延

DAC插值滤波器， 192千赫

通带

通带纹波

阻带

阻带衰减

群时延

数字I / O

输入电压高

输入电压低

输出电压高

输出电压低

漏电流

电源

电源电压（ AVDD和DVDD ）

电源电压（ ODVDD ）

供应电流I

类似物

供应电流I

类似物

，掉电

供应电流I

数字

供应电流I

数字

，掉电

耗散

操作上，两个电源

操作上，模拟电源

操作上，数字电源

掉电，两个电源

电源抑制比

1千赫， 300 mV的P-P的信号在模拟电源引脚

20千赫， 300 mV的P-P的信号在模拟电源引脚

民

典型值

21.77

±0.01

26.23

120

910

43.54

±0.01

52.46

120

460

最大

单位

千赫

21.77

±0.01

340

43.54

±0.01

160

81.2

±0.06

110

2.4

0.8

ODVDD - 0.4

0.4

±10

4.5

3.0

5.0

740

420

320

280

–70

–75

5.5

DVDD

4.5

千赫

通过设计保证。

版本B |第24 4

AD1839A

时序特定网络阳离子

表2中。

参数

主时钟和复位

PDR

SPI端口

CCH

CCL

CCP

CDS

鼎晖

CLS

CLH

COE

鳕鱼

COTS

DAC的串行端口（ 48 kHz和96 kHz时）

正常模式（从）

胸径

DBL

DLS

DLH

DDS

DDH

盒装128/256模式（从）

胸径

DBL

DLS

DLH

DDS

DDH

ADC的串行端口（ 48 kHz和96 kHz时）

正常模式（主）

ABD

ALD

ABDD

正常模式（从）

ABH

ABL

ALS

ALH

ABDD

盒装128/256模式（主）

PABD

PALD

PABDD

民

MCLK高

MCLK低

PD / RST低

CCLK高

CCLK低

CCLK周期

CDATA设置

CDATA保持

CLATCH设置

CLATCH保持

COUT启用

COUT延迟

COUT三态

最大

单位

到CCLK上升沿

从CCLK上升沿

到CCLK上升沿

从CCLK上升沿

从CLATCH下降沿

从CCLK下降沿

从CLATCH上升沿

DBCLK高

DBCLK低

DBCLK频率

DLRCLK设置

DLRCLK保持

DSDATA设置

DSDATA保持

DBCLK高

DBCLK低

DBCLK频率

DLRCLK设置

DLRCLK保持

DSDATA设置

DSDATA保持

64 × f

256 × f

要DBCLK上升沿

从DBCLK上升沿

要DBCLK上升沿

从DBCLK上升沿

要DBCLK上升沿

从DBCLK上升沿

要DBCLK上升沿

从DBCLK上升沿

ABCLK延迟

ALRCLK延迟

ASDATA延迟

ABCLK高

ABCLK低

ABCLK频率

ALRCLK设置

ALRCLK保持

ASDATA延迟

ABCLK延迟

LRCLK延迟

ASDATA延迟

64 × f

从MCLK上升沿

从ABCLK下降沿

要ABCLK上升沿

从ABCLK上升沿

从ABCLK下降沿

从MCLK上升沿

从ABCLK下降沿

版本B |第24个5