82C50A
引脚说明
符号
DISTR ，
DISTR
针
数
22
21
TYPE
I
I
活跃
水平
H
L
描述
DATA IN频闪， DATA IN频闪： DISTR ， DISTR读取输入引起的
82C50A将数据输出到数据总线（ D0-D7 ） 。该数据输出取决于
寄存器的地址输入A0 ， A1 ， A2选择。片选输入CS0 ， CS1 ，
CS2使DISTR ， DISTR投入。
唯一的活性DISTR或DISTR ，而不是两个，是用来从82C50A接收数据
在读出操作。如果DISTR被用作读出输入， DlSTR应当高电平。
如果DISTR被用作有效的读输入， DISTR应接低电平。
DATA OUT频闪， DATA OUT频闪： DOSTR ， DOSTR是写输入端，
造成从数据总线（ D0-D7 ）的数据要被输入到所述82C50A 。数据输入取决于
一旦由地址输入A0 ，A1，A2所选择的寄存器。片选输入CS0 ，
CS1，CS2使DOSTR ， DOSTR输入。
唯一的活性DOSTR或DOSTR ，而不是两个，用于将数据发送到82C50A
在写操作。如果DOSTR作为写输入， DOSTR应该连接
高。如果DOSTR作为写输入， DOSTR应接低电平。
数据位0-7 ：数据总线为8 ，三态输入/输出线的
传输数据，控制和82C50A和CPU之间的状态信息。为
少于8位字符格式， D7 ， D6和D5是“不关心”写入数据
操作和0为数据读操作。这些线通常处于高阻抗
国家除了在读取操作。 D0是最低有效位（ LSB），并且是第一个
要被接收或发送的串行数据位。
寄存器选择：地址线选择在CPU总线的内部寄存器
操作。见表1 。
CRYSTAL /时钟：晶体连接的内部波特率发生器。 XTAL1
也可以被用作外部时钟输入，在这种情况下XTAL2要保持开放。
串行数据输出：从82C50A发射器电路输出串行数据。一
标记（1）是一个逻辑1 （高）和空间（ 0）是一个逻辑0 （低）。 SOUT在所保持的
当发射器被禁用的标记状况，MR为真，发送寄存器是
空，或在循环模式时。 SOUT不受CTS输入。
地面：电源接地（V
SS
).
清除发送： CTS引脚的逻辑状态反映到的CTS位
（ MSR ） Modem状态寄存器（ CTS是位MSR 4 ，写MSR （ 4 ） ） 。的变化
状态以来， MSR以前读书的CTS引脚使DCTS的设置
（ MSR （ O） ）调制解调器状态寄存器。当CTS引脚有效（低电平） ，调制解调器
这表明在SOUT数据可以在通信链路上进行传输。如果CTS引脚
变为无效（高）时， 82C50A不应该被允许发送数据SOUT出来的。
CTS引脚不影响循环模式操作。
数据设置就绪：在DSR引脚的逻辑状态反映到MSR （ 5 ）的
调制解调器状态寄存器。 DDSR （MSR （1））表示在DSR引脚是否已改变
由于MSR以前的阅读状态。当DSR引脚有效（低电平）时，
调制解调器表明它已准备好与82C50A交换数据，当DSR
引脚无效（高）表示调制解调器没有准备好进行数据交换。该
ACTIVE状态表示本地数据通信的唯一条件
设备（DCE） ，并且并不意味着一个数据电路为建立与远程
设备。
数据终端就绪： DTR引脚可设置（低）可以通过写1到MCR （ 0 ）
调制解调器控制寄存器的位0 ，这个信号被清除（高）通过写0到DTR
位（ MCR （0）） ，或当一个MR活性（高）被施加到82C50A 。当活动
（低） ， DTR引脚指示到DCE的82C50A已准备好接收数据。在一些
情况下， DTR引脚用作指示灯电源。非活动（高）状态的原因
大商所断开从电信线路的调制解调器。
请求发送： RTS信号用于使能调制解调器的输出。在RTS
引脚设置为低电平可以通过写1到MCR （ 1 ）位1的调制解调器控制寄存器。该
RTS引脚复位主复位高。激活时， RTS引脚指示到DCE
该82C50A有数据准备发送。在半双工操作， RTS被用来
控制线的方向。
BAUDOUT ：这个输出是一个16X时钟输出用于发射器部分（ 16X = 16
倍数据速率）。该BAUDOUT时钟速率等于所述基准振荡器
频率由指定的因子在波特率发生器除数锁存分
DLL和DLM 。 BAUDOUT可以使用由接收器部分通过把此输出到
RCLK 。
DOSTR ，
DOSTR
19
18
I
I
H
L
D0-D7
1-8
I / O
A0, A1,
A2
XTAL1,
XTAL2
SOUT
28, 27,
26
16
17
11
I
I
I
O
O
H
GND
CTS
20
36
I
L
L
DSR
37
I
L
DTR
33
O
L
RTS
32
O
L
BAUDOUT
15
O
4
FN2958.5
2006年8月24日
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