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集成电路
74LVC161
可预置同步4位二进制
计数器;异步复位
产品speci fi cation
取代1996年的数据8月23日
IC24数据手册
1998年5月20日
飞利浦
半导体
飞利浦半导体
产品speci fi cation
可预置同步4位二进制计数器;
异步复位
74LVC161
特点
1.2 V至3.6 V的宽电源电压范围
按照JEDEC标准没有。 8-1A
输入接收电压高达5.5 V
CMOS低功耗
直接接口与TTL电平
异步复位
同步计数和加载
两个计数使能输入为n位级联
正边沿触发时钟
输出驱动能力50
W
输电线路@ 85_C
描述
该74LVC161是一款高性能，低功耗，低电压，
硅栅CMOS器件和优越于最先进的CMOS
兼容TTL家庭。
该74LVC161是同步预置二进制计数器，它
功能内部的查找头携带和可用于
高速计数。同步操作是由具有设置
所有触发器同时主频上的正向沿
时钟（CP） 。输出（Q
0
以Q
3
）的计数器可以是
预设为高或低的水平。低水平的并行实现
输入（PE）禁止计数动作，并且使数据在
数据输入（D
0
到D
3
）被装入在该计数器
正向的时钟的边缘（前提是设置和保持
满足于PE时间的要求） 。预设的发生不分
的水平计数使能输入（ CEP和CET ） 。在一个低的水平
主复位输入（MR ）设置触发器的所有四个输出
(Q
0
以Q
3
），以在CP的低电平无论水平，PE， CET
和CEP输入（从而提供了一种异步清零功能） 。
先行进位简化的计数器的串行级联。
两个计数使能输入（ CEP和CET）必须为高电平来算。
四，六级考试的输入前馈，使终端计数输出
（TC） 。在TC输出从而使会产生很高的输出脉冲
的持续时间约等于Q的高电平输出
0
。这
脉冲可用来使下一个级联级。该
最大时钟频率为级联计数器确定
由CP为TC传播延迟和CEP到CP的建立时间，
根据下列公式计算：
f
最大
=
1
_______________________________
tp
（最大）
（ CP到TC ） + T
SU
（ CEP到CP ）
快速参考数据
GND = 0V ;吨
AMB
= 25°C ;吨
R
= T
F

2.5ns
符号
参数
传播延迟
CP到Q
n
CP为TC
MR到Q
n
MR到TC
CET到TC
最大时钟频率
输入电容
每门功率耗散电容
注1和2
条件
C
L
= 50 pF的
V
CC
= 3.3V
典型
4.9
5.7
5.2
5.7
4.5
200
5.0
39
单位
t
PHL
/t
PLH
ns
f
最大
C
I
C
PD
兆赫
pF
pF
注意事项：
1. C
PD
被用于确定所述动态功耗（P
D
in
W)
P
D
= C
PD
X V
CC2
架F
i
+Σ (C
L
X V
CC2
架F
o )
其中：
f
i
=以MHz输入频率;
L
=以pF输出负载能力;
f
o
=以MHz输出频率; V
CC
在V =电源电压;
Σ
(C
L
X V
CC2
架F
o )
=输出的总和
2.条件为V
1
= GND到V
CC
订购信息
套餐
16引脚塑料SO
16引脚塑封SSOP II型
16引脚塑料TSSOP I型
温度范围
-40 ° C至+ 85°C
-40 ° C至+ 85°C
-40 ° C至+ 85°C
北美以外的地区
74LVC161
74LVC161 DB
74LVC161 PW
北美
74LVC161
74LVC161 DB
74LVC161PW DH
DWG号
SOT109-1
SOT338-1
SOT403-1
1998年5月20日
2
853-1864 19421
飞利浦半导体
产品speci fi cation
可预置同步4位二进制计数器;
异步复位
74LVC161
引脚配置
MR
CP
D0
D1
D2
D3
CEP
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
V
CC
TC
Q0
Q1
Q2
Q3
CET
PE
引脚说明
引脚数
1
2
3,4,5,6
7
8
9
10
14,13,12,11
符号
MR
CP
D
0
到D
3
CEP
GND
PE
CET
Q
0
以Q
3
TC
V
CC
功能
异步主
RESET （低电平有效）
时钟输入（低到高，
边沿触发的）
数据输入
计数使能输入
地（ 0V ）
平行允许输入
（低电平有效）
计数使能输入进
FL IP- FL运算输出
终端计数输出
正电源电压
SF00656
逻辑符号
15
15
16
逻辑符号（ IEEE / IEC ）
1
Q
0
Q
1
Q
2
Q
3
14
13
12
11
9
7
10
2
R
M1
G3
G4
C2 /1,3,4+
CTR4
TC
3
4
5
6
9
D
0
D
1
D
2
D
3
PE
CEP CET
CP
MR
3
4
1,2 D
14
13
12
11
15
7
10
2
1
5
6
4 CT = 15
V
CC
= 16 PIN
GND = 8 PIN
SY00065
SY00066
1998年5月20日
3
飞利浦半导体
产品speci fi cation
可预置同步4位二进制计数器;
异步复位
74LVC161
工作原理图
3
4
5
6
功能表
操作
模式
复位（清）
输入
MR
L
H
H
H
H
H
CP
X
↑
↑
↑
X
X
CEP
X
X
X
h
l
X
CET
X
X
X
h
X
l
PE
X
l
l
h
h
h
Dn
X
l
h
X
X
X
输出
Qn
L
L
H
算
q
n
q
n
TC
L
L
*
*
*
L
D
0
9 PE
D
1
D
2
D
3
并行加载
并行加载
电路
算
HOLD
（做什么）
TC 15
10 CET
7 CEP
2
CP
二进制
计数器
1 MR
Q
0
Q
1
Q
2
Q
3
14
13
12
11
注意事项：
*
=
在TC输出为高时， CET为高，计数器
是在终端计数（ HHHH ）
H
=
高电压电平
h
=
高压一级建立时间之前低到高
时钟转换
L
=
低电压电平
l
=
低压一级建立时间之前低到高
时钟转换
q
=
小写字母表示的参考状态
输出1设置时间之前低到高时钟
过渡
X
=
不在乎
↑
=
低到高时钟转换
SY00068
典型时序序列
MR
状态图
PE
D0
D1
D2
0
1
2
3
4
D3
CP
15
5
CEP
CET
14
6
Q0
Q1
13
7
Q2
Q3
12
11
10
9
8
TC
12
13
14
15
0
1
2
抑制
RESET预设
算
SF00664
SY00069
典型的时序：复位输出为零;预设为二进制
12 ;数到十三，十四，十五，零个，一个，两个，
抑制
1998年5月20日
4
飞利浦半导体
产品speci fi cation
可预置同步4位二进制计数器;
异步复位
74LVC161
逻辑图
D0
D1
D2
D3
CET
CEP
PE
FF0
D
CP
CP
Q
R
D
Q
D
FF1
Q
D
FF2
Q
D
FF3
Q
CP
Q
R
D
CP
Q
R
D
CP
Q
R
D
MR
Q0
Q1
Q2
Q3
TC
SY00070
1998年5月20日
5
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79109-1262
73644-1003
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