SN74GTLPH1612
18位LVTTL至GTLP可调节边沿速率
通用总线收发器
www.ti.com
SCES287D - 1999年10月 - 修订2005年5月
特点
德州仪器Widebus会员
家庭
UBT 收发器结合了D类锁存器
和D型触发器操作中
透明锁存，主频，或
时钟使能模式
TI- OPC电路限制呼入
不均衡负载背板
OEC 电路提高了信号完整性和
降低电磁干扰
GTLP之间的双向信号接口
水平和LVTTL逻辑电平
LVTTL接口是5V容限
高驱动GTLP输出（ 100 mA时）
LVTTL输出（ -24毫安/ 24 mA）的
可变边沿速率控制（ ERC ）输入
选择GTLP上升和下降时间为最佳
在数据传输速率和信号完整性
分布式负载
I
关闭
，上电三态和BIAS V
CC
支持
直播插入
对A端口数据输入总线保持
分布式V
CC
和GND引脚最小化
高速开关噪声
闭锁性能超过100mA的每
JESD 78 ， II类
ESD保护超过JESD 22
- 2000 -V人体模型（ A114 -A ）
- 200 -V机型号（ A115 -A ）
- 1000 -V带电器件模型（ C101 ）
OEAB
LEAB
A1
A2
GND
A3
V
CC
A4
A5
GND
A6
A7
A8
GND
A9
V
CC
A10
GND
A11
A12
GND
A13
A14
GND
A15
V
CC
A16
ERC
A17
A18
OEBA
LEBA
DGG包装
（ TOP VIEW ）
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
64
63
62
61
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
CEAB
CLKAB
B1
B2
GND
B3
BIAS V
CC
B4
B5
GND
B6
B7
B8
GND
B9
V
CC
B10
GND
B11
B12
GND
B13
B14
GND
B15
V
REF
B16
GND
B17
B18
CLKBA
CEBA
描述
该SN74GTLPH1612是高驱动器， 18位UBT 收发器，它提供LVTTL至GTLP和
GTLP至LVTTL信号电平转换。它允许透明，锁存，时钟或时钟使能模式
数据传输。该装置提供在LVTTL逻辑电平和一个操作数之间的高速接口
背板在GTLP信号电平操作。高速（比标准TTL或LVTTL快约3倍）
背板操作是GTLP的降低输出摆幅（ <1 V） ，降低了输入阈值电平的直接结果，
改进的差分输入， OEC 电路和TI- OPC 电路。改进GTLP OEC和TI- OPC电路
尽量减少总线建立时间和经过设计和测试，使用多个背板模型。高驱动器
允许入射波开关在重负载背板与等效负载阻抗下降到11
.
GTLP是发射接收逻辑器件（ GTL ） JEDEC标准的德州仪器（ TI ）的衍生物
JESD 8-3 。该SN74GTLPH1612的交流规范给出仅在首选高噪声容限GTLP ，
但用户使用该设备，在任一的GTL的灵活性（Ⅴ
TT
= 1.2 V和V
REF
= 0.8V）或GTLP
(V
TT
= 1.5 V和V
REF
= 1 V）的信号电平。
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
Widebus ， UBT ， TI- OPC ， OEC ， TI是德州仪器的商标。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有 1999-2005 ，德州仪器
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描述（续）
正常情况下，而B端口操作在GTLP信号电平。在A口和控制输入操作的LVTTL逻辑电平，
但5 -V宽容与TTL和5 V CMOS输入兼容。 V
REF
是B端口差分输入
参考电压。
这个装置是用我住插入应用程序完全指定
关闭
，上电三态和BIAS V
CC
。在我
关闭
电路禁止输出，防止损坏电流回流，通过该装置在通电时
下来。该电三态电路置于高阻抗状态下的输出在上电期间和电源
下来，从而防止驱动冲突。偏压V
CC
电路预充电和前提条件的B端口输入/输出
的连接，从而防止卡插入或移除期间在背板上的活动数据的干扰，并
允许真正的实时插入能力。
这GTLP器件采用TI -OPC电路，主动限制所造成的不当终止过冲
背板，在低到高的信号跃变不均匀分布卡，或空槽。这提高了信号
被保持在较高频率的完整性，从而允许足够的噪声容限。
高驱动GTLP背板接口器件具有可调的边沿速率控制（ ERC ） 。更改ERC
GND和V之间的输入电压
CC
调整B端口输出上升时间和下降时间。这允许设计人员
优化系统的数据传输率和信号完整性的背板负载。
有源总线保持电路被设置在有效的逻辑状态保持未使用的或无驱动的LVTTL数据输入。利用
上拉或下拉电阻器与总线保持电路，不建议使用。
当V
CC
是在0和1.5伏特，该装置是在上电期间或断电的高阻抗状态。
然而，为了确保以上1.5伏的高阻抗状态，输出使能（OE ）输入应当连接到V
CC
通过上拉电阻;该电阻的最小值由的所述电流吸收能力决定
驱动程序。
订购信息
T
A
-40 ° C至85°C
(1)
TSSOP - DGG
包
(1)
磁带和卷轴
订购型号
SN74GTLPH1612DGGR
顶部端标记
GTLPH1612
包装图纸，标准包装数量，热数据，符号和PCB设计指南可在
www.ti.com/sc/package 。
2
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功能说明
该SN74GTLPH1612是高驱动含D型锁存器和D型（100 mA）的， 18位UBT收发
触发器在透明，锁存，主频或时钟使能模式，数据路径运行，并且可以更换任何的
在表1中的数据的极性所示的功能是同相。
表1. SN74GTLPH1612 UBT收发器的替代函数
功能
收发器
缓冲器/驱动器
锁存收发器
LATCH
寄存收发器
倒装佛罗里达州运
标准UBT
通用总线驱动器
注册收发器时钟使能
触发器时钟使能
标准UBT与时钟使能
SN74GTLPH1612 UBT收发器替换所有上述功能
xxx
8位
'245, '623, '645
'241, '244, '541
'543
'373, '573
'646, '652
'374, '574
9位
'863
10位
'861
'827
16位
'16245, '16623
'16241, '16244, '16541
'16543
'16373
'16646, '16652
'16374
18位
'16863
'16825
'16472
'16843
'16474
'16500, '16501
'16835
'843
'841
'821
'2952
'377
'823
'16470, '16952
'16823
'16600, '16601
在由时钟控制每个方向的数据流使（ CEAB和CEBA ） ，锁存使能（ LEAB和
LEBA ） ，时钟（ CLKAB和CLKBA ）和输出使能（ OEAB和OEBA ） 。 CEAB和CEBA和OEAB和
OEBA控制的18位数据为A到B和B到-A方向，分别。
对于A至B的数据流，当CEAB为低时，器件的工作CLKAB为低到高转变
触发器和LEAB的锁存器路径的高到低的转换，也就是说，如果CEAB和LEAB均为低电平时，数据是
锁定，而不管CLKAB （高或低）的状态，如果LEAB高，该装置是在透明模式。
当OEAB为低电平时，输出处于激活状态。当OEAB为高电平时，输出处于高阻抗状态。
为B到A的数据流是类似于A至B的，所不同的是CEBA ， OEBA ， LEBA和CLKBA被使用。
功能表
空间HOLDER
OUTPUT ENABLE
(1)
输入
CEAB
X
L
L
X
X
L
L
H
(1)
(2)
(3)
OEAB
H
L
L
L
L
L
L
L
LEAB
X
L
L
H
H
L
L
L
CLKAB
X
H
L
X
X
↑
↑
X
A
X
X
X
L
H
L
H
X
产量
B
Z
B
0
(2)
模式
隔离
的数据锁存存储
真正的透明
的数据存储计时
禁止时钟
B
0 (3)
L
H
L
H
B
0 (3)
A到B的数据流图： B-到一个数据流相似，但使用CEBA ， OEBA ， LEBA和CLKBA 。
当OEAB和OEBA都是低电平，同时在条件不被推荐。
输出电平所指示的稳态输入条件成立之前，其前提是
CLKAB是前高LEAB去低
在表示稳态输入条件之前的输出电平建立
3
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B- PORT边沿速率控制（ERC ）
输入ERC
逻辑
水平
L
H
公称
电压
GND
V
CC
产量
B- PORT
边沿速率
慢
快
逻辑图（正逻辑）
39
V
REF
28
ERC
1
OEAB
CEAB
64
63
CLKAB
2
LEAB
32
LEBA
34
CLKBA
CEBA
33
31
OEBA
3
A1
CE
1D
C1
CLK
CE
1D
C1
CLK
62
B1
17其他渠道
4
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绝对最大额定值
(1)
在工作自由空气的温度范围内（除非另有说明）
民
V
CC
BIAS V
CC
V
I
V
O
I
O
I
O
I
IK
I
OK
θ
JA
T
英镑
(1)
(2)
(3)
(4)
电源电压范围
输入电压范围
(2)
电压范围应用于任何输出在
高阻抗或电源关断状态
(2)
目前进入低状态的任何输出
A-端口， ERC和控制输入
端口B和V
REF
一个端口
B端口
一个端口
B端口
–0.5
–0.5
–0.5
–0.5
–0.5
最大
4.6
7
4.6
7
4.6
48
200
48
±100
V
I
＆ LT ; 0
V
O
＆ LT ; 0
–65
–50
–50
55
150
单位
V
V
V
mA
mA
mA
mA
mA
° C / W
°C
目前进入中高状态的任何一个端口的输出
(3)
连续电流通过每个V
CC
或GND
输入钳位电流
输出钳位电流
封装的热阻抗
(4)
存储温度范围
超越那些在"absolute最大ratings"上市的强调可能会造成永久性损坏设备。这些压力额定值
只，而根据"recommended操作指示的装置，在这些或超出任何其他条件的功能操作
conditions"是不是暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。
如果输入和输出钳位电流额定值是所观察到的输入和输出负电压额定值可能被超过。
此电流流仅当输出处于高状态和V
O
＆ GT ; V
CC
.
封装的热阻抗的计算按照JESD 51-7 。
5
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