74AC163 74ACT163同步可预置二进制计数器
1988年11月
修订后的2000年2月
74AC163 74ACT163
同步可预置二进制计数器
概述
在AC / ACT163的高速同步模16
二进制计数器。它们是同步预置了
应用中可编程分频器和具有两种类型的
计数使能输入端加一个终端计数输出
多功能性形成多级同步计数器。该
AC / ACT163具有同步复位输入，它覆盖
计数和并行加载和允许输出是
同时复位在时钟的上升沿。
特点
s
I
CC
减少了50％
s
同步计数和加载
s
高速同步扩张
s
125 MHz的典型计数率
s
输出源/汇24毫安
s
ACT163具有TTL兼容的输入
订购代码：
订单号
74AC163SC
74AC163SJ
74AC163MTC
74AC163PC
74ACT163SC
74ACT163SJ
74ACT163MTC
74ACT163PC
包装数
M16A
M16D
MTC16
N16E
M16A
M16D
MTC16
N16E
包装说明
16引脚小外形集成电路（ SOIC ） ， JEDEC MS- 012 ， 0.150 “窄体
16引脚小外形封装（ SOP ） ， EIAJ TYPE II ， 5.3毫米宽
16引脚超薄紧缩小型封装（ TSSOP ） ， JEDEC MO- 153 ， 4.4毫米宽
16引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ， 0.300 “宽
16引脚小外形集成电路（ SOIC ） ， JEDEC MS- 012 ， 0.150 “窄体
16引脚小外形封装（ SOP ） ， EIAJ TYPE II ， 5.3毫米宽
16引脚超薄紧缩小型封装（ TSSOP ） ， JEDEC MO- 153 ， 4.4毫米宽
16引脚塑料双列直插式封装（ PDIP ） ， JEDEC MS- 001 ， 0.300 “宽
也可在磁带和卷轴装置。通过附加后缀字母“X”的订货代码指定。
接线图
引脚说明
引脚名称
CEP
CET
CP
SR
P
0
–P
3
PE
Q
0
–Q
3
TC
描述
计数使能并行输入
计数使能涓流输入
时钟脉冲输入
同步复位输入
并行数据输入
平行允许输入
FL IP- FL运算输出
终端计数输出
2000仙童半导体公司
DS009932
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74AC163 74ACT163
逻辑符号
功能说明
在AC / ACT163计算在模16的二进制序列。
从状态15 （ HHHH ）是递增到状态0 （ LLLL ） 。该
所有触发器的时钟输入端通过一个并联驱动
时钟缓冲器。这样的Q输出都发生变化的
的结果，并同步于，所述低到高的跃迁
和灰CP输入信号。该电路有四个丰达
操作心理模式，按优先级顺序：
同步复位，并行加载，计数和保持。四
控制输入，同步复位（ SR ），并行启用
（ PE ） ，计数使能并行（ CEP）和计数使能
滴流（CET） -determine操作模式，如图所示
在模式选择表。在SR覆盖低信号
计算和并行加载，并允许所有输出去
低对CP的下一个上升沿。在PE低信号
覆盖计数，允许在并行信息
数据（P
n
）输入要加载到触发器上的下一个
上升CP的边缘。用PE和SR HIGH ， CEP和CET
允许计数，当两者都高。相反，一个低
在任CEP或CET信号抑制计数。
交流/ ACT163使用D型边沿触发的触发器及
改变SR ， PE ， CEP和CET输入时的CP是
在任一状态不会导致错误，只要该消遣
ommended建立和保持时间，对于上升的
CP的边缘，观察到。
终端计数（ TC ）输出为高电平时， CET是
高和计数器状态15.为了实现同步的
理性多级专柜， TC输出可与使用
在CEP和CET输入两种不同的方式。
对瑞星行动
时钟边沿（
图1示出了用于简单脉动进位的连接，在
该时钟周期必须长于CP为TC
延迟的第一阶段，加上累积CET为TC
中间阶段的延迟，再加上CET到CP
最后一级的设置时间。这个总的延迟加上建立时间
上设置的时钟频率的上限。为了更快的时钟
率，在图2所示的进位先行连接
被推荐的。在这个方案中，通过纹波延迟
的中间阶段开始用相同的时钟
导致第一阶段打勾了从最大到最小的
的模式，或最小值到最大值，在掉电模式下，启动其
最后一个周期。由于这最后的周期需要16个时钟的COM
完整的，有足够的时间纹波进步
通过中间阶段。关键时刻的lim-
其时钟周期为CP在所述第一阶段的TC延迟
加在CEP到最后阶段的CP的设置时间。在TC
输出是受解码尖峰由于内部种族
条件，因此不推荐用作一个
时钟或触发器异步复位，或注册
计数器。
逻辑公式：计数使能
=
CEP CET PE
TC
=
Q
0
Q
1
Q
2
Q
3
CET
IEEE / IEC
模式选择表
SR
PE
CET
CEP
)
L
H
H
H
H
X
L
H
H
H
X
X
H
L
X
X
X
H
X
L
复位（清）
负载（P
n
→
Q
n
)
计数（递增）
没有变化（保持）
没有变化（保持）
H
=
高电压电平
L
=
低电压电平
X
=
非物质
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2
74AC163 74ACT163
状态图
图1 。
图2中。
框图
请注意，该图仅用于逻辑操作的理解提供的，不应该被用来估计的传播延迟。
3
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74AC163 74ACT163
绝对最大额定值
（注1 ）
电源电压（V
CC
)
DC输入二极管电流（I
IK
)
V
I
= 0.5V
V
I
=
V
CC
+
0.5V
直流输入电压（V
I
)
DC输出二极管电流（I
OK
)
V
O
= 0.5V
V
O
=
V
CC
+
0.5V
直流输出电压（V
O
)
DC输出源
或吸收电流（I
O
)
DC V
CC
或接地电流
每个输出引脚（I
CC
还是我
GND
)
存储温度（T
英镑
)
结温（T
J
)
PDIP
140°C
±50
mA
65°C
to
+150°C
±50
mA
20
mA
+20
mA
0.5V
到V
CC
+
0.5V
20
mA
+20
mA
0.5V
到V
CC
+
0.5V
0.5V
to
+7.0V
推荐工作
条件
电源电压（V
CC
)
AC
法案
输入电压（V
I
)
输出电压（V
O
)
工作温度（T
A
)
最小输入边沿速率（ ΔV / ΔT）
AC设备
V
IN
从30％到V的70％
CC
V
CC
@ 3.3V, 4.5V, 5.5V
最小输入边沿速率（ ΔV / ΔT）
ACT设备
V
IN
0.8V至2.0V
V
CC
@ 4.5V, 5.5V
125毫伏/ NS
注1 ：
绝对最大额定值是那些价值超过该受损
可能发生的设备。本数据手册规范应满足，与 -
出的异常，以确保该系统的设计是可靠的过它的功率
供给，温度，以及输出/输入加载变量。飞兆半导体不
推荐线路运行外数据手册规范。
2.0V至6.0V
4.5V至5.5V
0V至V
CC
0V至V
CC
40°C
to
+85°C
125毫伏/ NS
直流电气特性交流
符号
V
IH
参数
最低高层
输入电压
V
IL
最大低电平
输入电压
V
OH
最低高层
输出电压
V
CC
(V)
3.0
4.5
5.5
3.0
4.5
5.5
3.0
4.5
5.5
3.0
4.5
5.5
V
OL
最大低电平
输出电压
3.0
4.5
5.5
3.0
4.5
5.5
I
IN
（注4 ）最大输入漏电流
I
老
I
OHD
I
CC
（注4 ）
最小动态
输出电流（注3）
最大静态
电源电流
5.5
5.5
5.5
5.5
4.0
0.002
0.001
0.001
T
A
= +25°C
典型值
1.5
2.25
2.75
1.5
2.25
2.75
2.99
4.49
5.49
2.1
3.15
3.85
0.9
1.35
1.65
2.9
4.4
5.4
2.56
3.86
4.86
0.1
0.1
0.1
0.36
0.36
0.36
±
0.1
T
A
= 40°C
to
+85°C
保证限制
2.1
3.15
3.85
0.9
1.35
1.65
2.9
4.4
5.4
V
IN
=
V
IL
或V
IH
2.46
3.76
4.76
0.1
0.1
0.1
V
IN
=
V
IL
或V
IH
0.44
0.44
0.44
±
1.0
75
75
40.0
A
mA
mA
A
V
I
OL
= 12毫安
I
OL
= 24毫安
I
OL
= 24毫安（注2）
V
I
=
V
CC
， GND
V
老
=
1.65V最大
V
OHD
=
3.85V敏
V
IN
=
V
CC
或GND
V
I
OUT
=
50
A
V
I
OH
=
12
mA
I
OH
=
24
mA
I
OH
=
24
MA（注2 ）
V
I
OUT
= 50 A
V
V
OUT
=
0.1V
或V
CC
0.1V
V
单位
条件
V
OUT
=
0.1V
或V
CC
0.1V
注2 ：
所有输出负载;输入阈值与输出测试有关。
注3 ：
最大测试时间为2.0 ms ，一个输出一次加载。
注4 ：
I
IN
我
CC
@ 3.0V保证是小于或等于各自的极限@ 5.5VV
CC
.
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4
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