与3态输出74ABT16244 16位缓冲器/线路驱动器
1992年4月
修订后的2005年5月
74ABT16244
16位与3态输出缓冲器/线路驱动器
概述
该ABT16244包含了16个非反相缓冲器
三态输出设计为用作存储器
和地址驱动器，时钟驱动器，或面向总线和Transmit
器/接收器。该装置是受控的半字节。个人3-
状态控制输入端，可短接8位或
16位操作。
特点
s
每个半字节单独的控制逻辑
s
16位版本的ABT244的
s
输出陷落64毫安，源能力的能力
32毫安
s
保证输出偏斜
s
保证多路输出开关规格
s
输出开关为50 pF的规定和
250 pF的负载
s
保证同步开关噪声水平和
动态阈值的表现
s
保证闭锁保护
s
整个过程中高阻抗故障免费巴士装
上电和断电周期
s
无损热插入功能
订购代码：
订单号
74ABT16244CSSC
74ABT16244CMTD
包装数
MS48A
MTD48
包装说明
48引脚收缩小外形封装（ SSOP ） ， JEDEC MO- 118 ， 0.300"宽
48引脚超薄紧缩小型封装（ TSSOP ） ， JEDEC MO- 153 ， 6.1毫米宽
器件还提供磁带和卷轴可用。通过附加的后缀字母“X”的订货代码指定。
逻辑符号
接线图
引脚说明
引脚名称
OE
n
I
0
–I
15
O
0
–O
15
描述
输出使能输入（低电平有效）
输入
输出
2005仙童半导体公司
DS010985
www.fairchildsemi.com
74ABT16244
DC电气特性
符号
V
OLP
V
OLV
V
OHV
V
IHD
V
ILD
参数
静默输出最大动态V
OL
安静的输出最低动态V
OL
最小高级别动态输出电压
最小高级别动态输入电压
最大低电平动态输入电压
民
典型值
0.4
最大
0.7
单位
V
V
V
V
0.8
V
V
CC
5.0
5.0
5.0
5.0
5.0
条件
C
L
T
A
T
A
T
A
T
A
T
A
为50 pF ，R
L
25
q
C（注4 ）
25
q
C（注4 ）
25
q
C（注5 ）
25
q
C（注6 ）
25
q
C（注6 ）
500
:
1.3
2.7
2.0
1.0
3.0
1.4
1.2
注4 ：
定义为（n ）输出最大数量。 n-1个数据输入驱动0V至3V 。一个输出为低电平。保证，但未经测试。
注5 ：
定义为（n ）输出最大数量。
1数据输入驱动0V至3V 。一个输出高电平。保证，但未经测试。
注6 ：
数据输入（ N）开关最大数量。 n-1个开关量输入0V至3V 。输入被测开关： 3V阈值（V
ILD
） ， 0V到阈值（Ⅴ
IHD
).
保证，但未经测试。
AC电气特性
T
A
25
q
C
符号
参数
民
t
PLH
t
PHL
t
PZH
t
PZL
t
PHZ
t
PLZ
传播
延迟数据到输出
OUTPUT ENABLE
时间
输出禁用
时间
1.0
1.0
1.5
1.5
1.0
1.0
V
CC
5V
C
L
50 pF的
典型值
2.3
2.7
3.5
3.5
4.2
3.2
最大
3.9
3.9
6.3
6.3
6.7
6.7
民
1.0
1.0
1.5
1.5
1.0
1.0
T
A
40
q
C到
85
q
C
4.5V–5.5V
50 pF的
最大
3.9
3.9
6.3
6.3
6.7
6.7
ns
ns
ns
C
L
单位
V
CC
扩展交流电气特性
40
q
C到
85
q
C
V
CC
符号
参数
C
L
4.5V–5.5V
50 pF的
T
A
40
q
C到
85
q
C
4.5V–5.5V
250 pF的
C
L
T
A
40
q
C到
85
q
C
4.5V–5.5V
250 pF的
单位
C
L
V
CC
V
CC
16路输出开关
（注7 ）
民
f
切换
t
PLH
t
PHL
t
PZH
t
PZL
t
PHZ
t
PLZ
输出禁止时间
最大切换频率
传播延迟
数据输出
输出使能时间
1.5
1.5
1.5
1.5
1.0
1.0
典型值
100
5.0
5.3
6.5
6.5
6.7
6.7
最大
1输出开关
（注8）
民
1.5
1.5
2.5
2.5
（注10 ）
最大
6.0
6.0
7.8
7.8
16路输出开关
（注9 ）
民
2.5
2.5
2.5
2.5
（注10 ）
最大
兆赫
8.0
8.0
9.5
8.5
ns
ns
ns
注7 ：
本规范是保证，但未经测试。该限制适用于传输延迟为所有路径切换描述相
（即，所有低到高，高到低，等等） 。
注8 ：
本规范是保证，但未经测试。极限代表取代50 pF负载的传输延迟与250 pF负载电容
电容器中的标准AC负载。本规范适用于单路输出开关而已。
注9 ：
本规范是保证，但未经测试。这些限制代表的传播延迟为所有路径切换描述相
（即，所有低到高，高到低，等）代替了标准的交流负载的50 pF负载电容250 pF负载电容。
注10 ：
三态延迟时间由RC网络为主（ 500
:
， 250 pF）的输出端或已被排除在数据表。
www.fairchildsemi.com
4
74ABT16244
SKEW
T
A
40
q
C到
85
q
C
4.5V–5.5V
50 pF的
C
L
T
A
40
q
C到
85
q
C
4.5V–5.5V
250 pF的
单位
C
L
V
CC
符号
参数
V
CC
16路输出开关
（注11 ）
最大
t
OSHL
（注13 ）
t
OSLH
（注13 ）
t
PS
（注14 ）
t
OST
（注13 ）
t
PV
（注15 ）
引脚到引脚歪斜
HL转换
引脚到引脚歪斜
LH转换
占空比
LH- HL倾斜
引脚到引脚歪斜
LH / HL转换
设备到设备斜
LH / HL转换
1.0
1.0
1.5
1.7
2.0
16路输出开关
（注12 ）
最大
1.5
1.5
1.5
2.0
2.5
ns
ns
ns
ns
ns
注11 ：
本规范是保证，但未经测试。该限制适用于传输延迟为所有路径切换描述相
（即，所有低到高，高到低，等等）
注12 ：
保证这些规范，但未经测试。极限代表取代50 pF负载的传输延迟与250 pF负载电容
电容器中的标准AC负载。
注13 ：
歪斜是指实际的传播延迟为同一装置的任何两个单独的输出之间的差的绝对值。
该规范适用于任何输出高电平切换到低电平（T
OSHL
） ，低到高（叔
OSLH
） ，或者其任意组合开关低到高的和/或高到
低（T
OST
） 。该规范是保证，但未经测试。
注14 ：
这说明在同一引脚低到高和高到低转换的延迟之间的差异。它在所有测量
输出在同一芯片上（驱动程序）中，最差（最大增量）数是保证规范。本规范是保证，但未经测试。
注15 ：
对于一组给定的条件（即，温度和V的传播延迟变化
CC
）从设备到设备。本规范是保证，但不
测试。
电容
符号
C
IN
C
OUT
（注16 ）
参数
输入电容
输出电容
典型值
5.0
9.0
1兆赫;每MIL-STD - 883 ，方法3012 。
单位
pF
pF
V
CC
V
CC
5.0V
5.0V
条件
T
A
25
q
C
注16 ：
C
OUT
的测量是在频率f
5
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与3态输出74ABT16244 16位缓冲器/线路驱动器
1992年4月
修订后的2005年5月
74ABT16244
16位与3态输出缓冲器/线路驱动器
概述
该ABT16244包含了16个非反相缓冲器
三态输出设计为用作存储器
和地址驱动器，时钟驱动器，或面向总线和Transmit
器/接收器。该装置是受控的半字节。个人3-
状态控制输入端，可短接8位或
16位操作。
特点
s
每个半字节单独的控制逻辑
s
16位版本的ABT244的
s
输出陷落64毫安，源能力的能力
32毫安
s
保证输出偏斜
s
保证多路输出开关规格
s
输出开关为50 pF的规定和
250 pF的负载
s
保证同步开关噪声水平和
动态阈值的表现
s
保证闭锁保护
s
整个过程中高阻抗故障免费巴士装
上电和断电周期
s
无损热插入功能
订购代码：
订单号
74ABT16244CSSC
74ABT16244CMTD
包装数
MS48A
MTD48
包装说明
48引脚收缩小外形封装（ SSOP ） ， JEDEC MO- 118 ， 0.300"宽
48引脚超薄紧缩小型封装（ TSSOP ） ， JEDEC MO- 153 ， 6.1毫米宽
器件还提供磁带和卷轴可用。通过附加的后缀字母“X”的订货代码指定。
逻辑符号
接线图
引脚说明
引脚名称
OE
n
I
0
–I
15
O
0
–O
15
描述
输出使能输入（低电平有效）
输入
输出
2005仙童半导体公司
DS010985
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74ABT16244
DC电气特性
符号
V
OLP
V
OLV
V
OHV
V
IHD
V
ILD
参数
静默输出最大动态V
OL
安静的输出最低动态V
OL
最小高级别动态输出电压
最小高级别动态输入电压
最大低电平动态输入电压
民
典型值
0.4
最大
0.7
单位
V
V
V
V
0.8
V
V
CC
5.0
5.0
5.0
5.0
5.0
条件
C
L
T
A
T
A
T
A
T
A
T
A
为50 pF ，R
L
25
q
C（注4 ）
25
q
C（注4 ）
25
q
C（注5 ）
25
q
C（注6 ）
25
q
C（注6 ）
500
:
1.3
2.7
2.0
1.0
3.0
1.4
1.2
注4 ：
定义为（n ）输出最大数量。 n-1个数据输入驱动0V至3V 。一个输出为低电平。保证，但未经测试。
注5 ：
定义为（n ）输出最大数量。
1数据输入驱动0V至3V 。一个输出高电平。保证，但未经测试。
注6 ：
数据输入（ N）开关最大数量。 n-1个开关量输入0V至3V 。输入被测开关： 3V阈值（V
ILD
） ， 0V到阈值（Ⅴ
IHD
).
保证，但未经测试。
AC电气特性
T
A
25
q
C
符号
参数
民
t
PLH
t
PHL
t
PZH
t
PZL
t
PHZ
t
PLZ
传播
延迟数据到输出
OUTPUT ENABLE
时间
输出禁用
时间
1.0
1.0
1.5
1.5
1.0
1.0
V
CC
5V
C
L
50 pF的
典型值
2.3
2.7
3.5
3.5
4.2
3.2
最大
3.9
3.9
6.3
6.3
6.7
6.7
民
1.0
1.0
1.5
1.5
1.0
1.0
T
A
40
q
C到
85
q
C
4.5V–5.5V
50 pF的
最大
3.9
3.9
6.3
6.3
6.7
6.7
ns
ns
ns
C
L
单位
V
CC
扩展交流电气特性
40
q
C到
85
q
C
V
CC
符号
参数
C
L
4.5V–5.5V
50 pF的
T
A
40
q
C到
85
q
C
4.5V–5.5V
250 pF的
C
L
T
A
40
q
C到
85
q
C
4.5V–5.5V
250 pF的
单位
C
L
V
CC
V
CC
16路输出开关
（注7 ）
民
f
切换
t
PLH
t
PHL
t
PZH
t
PZL
t
PHZ
t
PLZ
输出禁止时间
最大切换频率
传播延迟
数据输出
输出使能时间
1.5
1.5
1.5
1.5
1.0
1.0
典型值
100
5.0
5.3
6.5
6.5
6.7
6.7
最大
1输出开关
（注8）
民
1.5
1.5
2.5
2.5
（注10 ）
最大
6.0
6.0
7.8
7.8
16路输出开关
（注9 ）
民
2.5
2.5
2.5
2.5
（注10 ）
最大
兆赫
8.0
8.0
9.5
8.5
ns
ns
ns
注7 ：
本规范是保证，但未经测试。该限制适用于传输延迟为所有路径切换描述相
（即，所有低到高，高到低，等等） 。
注8 ：
本规范是保证，但未经测试。极限代表取代50 pF负载的传输延迟与250 pF负载电容
电容器中的标准AC负载。本规范适用于单路输出开关而已。
注9 ：
本规范是保证，但未经测试。这些限制代表的传播延迟为所有路径切换描述相
（即，所有低到高，高到低，等）代替了标准的交流负载的50 pF负载电容250 pF负载电容。
注10 ：
三态延迟时间由RC网络为主（ 500
:
， 250 pF）的输出端或已被排除在数据表。
www.fairchildsemi.com
4
74ABT16244
SKEW
T
A
40
q
C到
85
q
C
4.5V–5.5V
50 pF的
C
L
T
A
40
q
C到
85
q
C
4.5V–5.5V
250 pF的
单位
C
L
V
CC
符号
参数
V
CC
16路输出开关
（注11 ）
最大
t
OSHL
（注13 ）
t
OSLH
（注13 ）
t
PS
（注14 ）
t
OST
（注13 ）
t
PV
（注15 ）
引脚到引脚歪斜
HL转换
引脚到引脚歪斜
LH转换
占空比
LH- HL倾斜
引脚到引脚歪斜
LH / HL转换
设备到设备斜
LH / HL转换
1.0
1.0
1.5
1.7
2.0
16路输出开关
（注12 ）
最大
1.5
1.5
1.5
2.0
2.5
ns
ns
ns
ns
ns
注11 ：
本规范是保证，但未经测试。该限制适用于传输延迟为所有路径切换描述相
（即，所有低到高，高到低，等等）
注12 ：
保证这些规范，但未经测试。极限代表取代50 pF负载的传输延迟与250 pF负载电容
电容器中的标准AC负载。
注13 ：
歪斜是指实际的传播延迟为同一装置的任何两个单独的输出之间的差的绝对值。
该规范适用于任何输出高电平切换到低电平（T
OSHL
） ，低到高（叔
OSLH
） ，或者其任意组合开关低到高的和/或高到
低（T
OST
） 。该规范是保证，但未经测试。
注14 ：
这说明在同一引脚低到高和高到低转换的延迟之间的差异。它在所有测量
输出在同一芯片上（驱动程序）中，最差（最大增量）数是保证规范。本规范是保证，但未经测试。
注15 ：
对于一组给定的条件（即，温度和V的传播延迟变化
CC
）从设备到设备。本规范是保证，但不
测试。
电容
符号
C
IN
C
OUT
（注16 ）
参数
输入电容
输出电容
典型值
5.0
9.0
1兆赫;每MIL-STD - 883 ，方法3012 。
单位
pF
pF
V
CC
V
CC
5.0V
5.0V
条件
T
A
25
q
C
注16 ：
C
OUT
的测量是在频率f
5
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