54AC373
54ACT373八路透明锁存器具有三态输出
1998年8月
54AC373
54ACT373
八路透明锁存与TRI -STATE
输出
概述
在“ AC /' ACT373包括八个锁存器与TRI -STATE
输出的总线组织系统的应用。触发器
出现透明的数据时,锁存使能( LE )是
HIGH 。当LE是低电平时,数据满足建立时间
被锁定。数据出现在总线上,当输出使能
(OE)为LOW 。当OE为高电平时,总线输出是在高
阻抗状态。
特点
n
n
n
n
n
n
I
CC
我
OZ
减少了50%
八个锁存器在一个封装
三态输出的总线接口
输出源/汇24毫安
“ ACT373具有TTL兼容的输入
标准微电路图纸( SMD )
- “ AC373 : 5962-87555
- “ ACT373 : 5962-87556
逻辑符号
IEEE / IEC
DS100329-1
DS100329-2
引脚名称
D
0
–D
7
LE
OE
O
0
–O
7
描述
数据输入
锁存使能输入
输出使能输入
三态输出锁存
三州
是美国国家半导体公司的注册商标。
FACT
是仙童半导体公司的注册商标。
1998美国国家半导体公司
DS100329
www.national.com
连接图
引脚分配为DIP
和Flatpak
引脚分配为LCC
DS100329-4
DS100329-3
功能说明
在“ AC /' ACT373包含八个D型锁存器
TRI -STATE标准输出。当锁存使能( LE )
输入为高电平时,在D个数据
n
输入端进入锁存器。在
该状态下,锁存器是透明的,即,锁存器输出
每一次的D输入的变化将改变状态。当LE是
低时,锁存器存储是存在于信息
在D输入建立时间高到低转录前
LE习得的。三态输出的标准控制
由输出使能( OE )输入。当OE是低电平,则标
准输出在2态模式。当OE为高电平,则
标准输出处于高阻抗状态,但是这
不干扰输入新的数据进入锁存器。
真值表
输入
LE
X
H
H
L
OE
H
L
L
L
D
n
X
L
H
X
输出
O
n
Z
L
H
O
0
H =高电压等级
L =低电压等级
Z =高阻抗
X =非物质
O
0
=上一页
0
之前HIGH到锁存器的低转换启动
www.national.com
2
逻辑图
DS100329-5
请注意,该图仅用于逻辑操作的理解提供的,不应该被用来估计的传播延迟。
3
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54ACT373八路透明锁存器具有三态输出
1998年8月
54AC373
54ACT373
八路透明锁存与TRI -STATE
输出
概述
在“ AC /' ACT373包括八个锁存器与TRI -STATE
输出的总线组织系统的应用。触发器
出现透明的数据时,锁存使能( LE )是
HIGH 。当LE是低电平时,数据满足建立时间
被锁定。数据出现在总线上,当输出使能
(OE)为LOW 。当OE为高电平时,总线输出是在高
阻抗状态。
特点
n
n
n
n
n
n
I
CC
我
OZ
减少了50%
八个锁存器在一个封装
三态输出的总线接口
输出源/汇24毫安
“ ACT373具有TTL兼容的输入
标准微电路图纸( SMD )
- “ AC373 : 5962-87555
- “ ACT373 : 5962-87556
逻辑符号
IEEE / IEC
DS100329-1
DS100329-2
引脚名称
D
0
–D
7
LE
OE
O
0
–O
7
描述
数据输入
锁存使能输入
输出使能输入
三态输出锁存
三州
是美国国家半导体公司的注册商标。
FACT
是仙童半导体公司的注册商标。
1998美国国家半导体公司
DS100329
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连接图
引脚分配为DIP
和Flatpak
引脚分配为LCC
DS100329-4
DS100329-3
功能说明
在“ AC /' ACT373包含八个D型锁存器
TRI -STATE标准输出。当锁存使能( LE )
输入为高电平时,在D个数据
n
输入端进入锁存器。在
该状态下,锁存器是透明的,即,锁存器输出
每一次的D输入的变化将改变状态。当LE是
低时,锁存器存储是存在于信息
在D输入建立时间高到低转录前
LE习得的。三态输出的标准控制
由输出使能( OE )输入。当OE是低电平,则标
准输出在2态模式。当OE为高电平,则
标准输出处于高阻抗状态,但是这
不干扰输入新的数据进入锁存器。
真值表
输入
LE
X
H
H
L
OE
H
L
L
L
D
n
X
L
H
X
输出
O
n
Z
L
H
O
0
H =高电压等级
L =低电压等级
Z =高阻抗
X =非物质
O
0
=上一页
0
之前HIGH到锁存器的低转换启动
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逻辑图
DS100329-5
请注意,该图仅用于逻辑操作的理解提供的,不应该被用来估计的传播延迟。
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