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3D7304
单片翻两番
固定延迟线
(系列3D7304 )
特点
数据
3
延迟
设备,
公司
套餐
全硅,低功耗CMOS技术
VDD
I1
1
14
TTL / CMOS兼容输入和输出
N / C
N / C
2
13
气相,红外,波焊
O1
I2
3
12
自动插入( DIP PKG )。
N / C
I3
4
11
低接地反弹噪声
O2
I4
5
10
前沿和后沿的精度
O3
N / C
6
9
延时范围:
10到500纳秒
O4
GND
7
8
时延容限:
2%或1.0ns
温度稳定性:
±3%
典型的( 0℃ 70℃ )
3D7304 DIP
VDD稳定:
±1%
典型的( 4.75V - 5.25V )
3D7304G鸥翼
最小输入脉冲宽度:
总量的20%
( 300密耳)
延迟
14引脚的鸥翼式可作为简易替换为混合延迟线
I1
N / C
I2
I3
I4
N / C
GND
1
2
3
4
5
6
7
14
13
12
11
10
9
8
VDD
N / C
O1
N / C
O2
O3
O4
3D7304D
SOIC
( 150密耳)
功能说明
该3D7304四延迟线产品系列包括固定的
延迟CMOS集成电路。每个程序包包含四个匹配,
独立延迟线。延迟值的范围可以从10ns的通
为500ns 。该输入再生无反转输出,转移
在时间上为每个用户指定的破折号编号。该3D7304可与TTL
与CMOS兼容,能够驱动10 74LS型负载,并
特征既rising-和下降沿精度。
的全CMOS 3D7304集成电路已被设计成一个
可靠,经济的替代混合TTL固定的延时线。这是
在一个标准的14针自动插入DIP和节省空间提供
表面贴装14引脚SOIC封装。
引脚说明
I1
I2
I3
I4
O1
O2
O3
O4
VCC
GND
N / C
延迟线输入1
延迟线输入2
延迟线输入3
延迟线输入4
延迟线1输出
延迟线2输出
延迟线3输出
延迟线4输出
+5伏
无连接
表1 : PART号的说明
DIP-14
3D7304
-10
-15
-20
-25
-30
-40
-50
-100
-200
-300
-400
-500
产品型号
DIP-14
SOIC-14
3D7304G 3D7304D
-10
-10
-15
-15
-20
-20
-25
-25
-30
-30
-40
-40
-50
-50
-100
-100
-200
-200
-300
-300
-400
-400
-500
-500
延迟
每行
(纳秒)
10
±
1.0
15
±
1.0
20
±
1.0
25
±
1.0
30
±
1.0
40
±
1.0
50
±
1.0
100
±
2.0
200
±
4.0
300
±
6.0
400
±
8.0
500
±
10.0
最大工作
频率
33.3兆赫
22.2兆赫
16.7兆赫
13.3兆赫
11.1兆赫
8.33兆赫
6.67兆赫
3.33兆赫
1.67兆赫
1.11兆赫
0.83兆赫
0.67兆赫
输入的限制
绝对最大
min工作
歌剧院。频率。
脉冲宽度
100.0兆赫
15.0纳秒
100.0兆赫
22.5纳秒
100.0兆赫
30.0纳秒
83.3兆赫
37.5纳秒
71.4兆赫
45.0纳秒
62.5兆赫
60.0纳秒
50.0兆赫
75.0纳秒
25.0兆赫
150.0纳秒
12.5兆赫
300.0纳秒
8.33兆赫
450.0纳秒
6.25兆赫
600.0纳秒
5.00兆赫
750.0纳秒
绝对最小值
歌剧院。 P.W.
5.0纳秒
5.0纳秒
5.0纳秒
6.0纳秒
7.0纳秒
8.0纳秒
10.0纳秒
20.0纳秒
40.0纳秒
60.0纳秒
80.0纳秒
100.0纳秒
注:如图10和500纳秒之间没有任何延迟也可用。
1996年的数据延时器
文档# 96002
12/2/96
数据延迟设备, INC 。
3山。展望大道。克利夫顿,新泽西州07013
1
3D7304
应用笔记
操作说明
该3D7304四倍延迟线架构
在如图1所示的各个时延线
一些延迟单元连接构成的
串联。各延时线在其输出端
在其输入端上的信号的一个复制品,移
在时间上。延时线匹配和共享
相同的补偿信号,这些信号
最小线到线延迟性偏差超过
温度和电源电压的变化。
来保证
表1
延时精度
输入频率比更高
最大
工作频率,
该3D7304必须
在用户操作频率进行测试。
因此,为了便于生产和设备
鉴定,
零件数目将包括一个
自定义的参考标志
确定
意频操作。该
所述装置的编程的延迟精确度是
保证的,因此,仅在用户指定的
输入频率。小的输入频率变化
关于所选择的频率将仅略微
如果在所有影响编程的延迟精度。
不过,强烈建议
该工程人员在数据延迟
器件进行咨询。
输入信号特性
频率和/或脉冲宽度(高或低)
操作的指定可能产生不利影响
延缓特定装置的精度。该
原因,输出延迟的相关性
精度上的输入信号特性是
多样和复杂。因此,一个
最大
an
绝对最大
工作输入
频率和一
最低
绝对
最低
工作脉冲宽度已
指定的。
操作脉宽
绝对最小工作脉冲
宽度
(高或低)说明书中,列于
表1
确定的最小脉冲宽度
延迟线的输入信号,可以是
复制,转移的时间,在器件输出,
具有可接受的脉宽失真。
最小工作脉宽
(高或
低)规范确定最小脉冲
宽度延迟线输入信号的量,
输出延时精度列于
表1
is
保证。
来保证
表1
延时精度
输入脉冲宽度比小
最低
工作脉冲宽度,
该3D7304必须
在用户操作的脉冲宽度检测。
因此,为了便于生产和设备
标识,所述
部件号将包括一个
O2
O3
O4
工作频率
绝对最大工作频率
规范,列于
表1
确定
延迟线输入的最高频率
信号可以被复制,在时移,在
该设备输出,具有可接受的占空比
失真。
最大工作频率
说明书中确定的最高频率
延迟线输入信号的量,输出
延迟的精度得到了保证。
VDD
O1
温度& VDD
赔偿金
延迟
LINE
延迟
LINE
延迟
LINE
延迟
LINE
GND
I1
I2
I3
I4
图1 : 3D7304功能框图
文档# 96002
12/2/96
数据延迟设备, INC 。
联系电话: 973-773-2299
传真: 973-773-9672
http://www.datadelay.com
2
3D7304
应用注释(续)
自定义的参考标志
确定
预期频率和操作占空比。
该装置的编程的延迟精确度是
保证的,因此,只对用户指定的
输入特性。小输入脉冲宽度
变化有关的选定的脉冲宽度将仅
轻微影响编程的延迟
准确度,如果在所有。
然而,强烈
建议的工程技术人员在
数据延迟器件进行咨询。
电路,以减少引起的延迟变化
在电源波动和/或
温度。
导热系数
被减小到
600
PPM / C ,
这相当于一个变型中,多
在0℃ 70℃的工作范围内,对
±
3%
室温延迟设置和/或
1.0ns,
以较高者为准。该
电源
系数
减小,在4.75V - 5.25V的
操作范围内,以
±
1%
在延迟设置
标称5.0VDC电源和/或
2.0ns,
以较高者为准。
至关重要的是,该
电源引脚充分绕过
并过滤。此外,电源总线
应尽可能低的阻抗的
建设成为可能。电源平面的
首选。
电源和
考虑温度因素
CMOS集成电路中的延迟是强烈
依赖于电源和温度。
单片3D7304可编程延迟线
利用新的和创新的赔偿
设备的特定连接的阳离子
表2 :绝对最大额定值
参数
直流电源电压
输入引脚电压
输入引脚电流
储存温度
焊接温度
符号
V
DD
V
IN
I
IN
T
STRG
T
领导
-0.3
-0.3
-1.0
-55
最大
7.0
V
DD
+0.3
1.0
150
300
单位
V
V
mA
C
C
笔记
25C
10秒
表3 : DC电气特性
( 0℃ 70℃ , 4.75V至5.25V )
参数
静态电源电流*
高电平输入电压
低电平输入电压
高电平输入电流
低电平输入电流
高电平输出电流
低电平输出电流
输出上升&下降时间
符号
I
DD
V
IH
V
IL
I
IH
I
IL
I
OH
I
OL
T
R
&放大器;牛逼
F
2.0
0.8
1
1
-4.0
4.0
2
最大
30
单位
mA
V
V
A
A
mA
mA
ns
笔记
V
IH
= V
DD
V
IL
= 0V
V
DD
= 4.75V
V
OH
= 2.4V
V
DD
= 4.75V
V
OL
= 0.4V
C
LD
= 5 pF的
*I
DD
(动态) = 3 * C
LD
* V
DD
* F
其中:C
LD
=平均电容负载/线路( PF )
F =输入频率(GHz)
输入电容= 10pF的典型
输出负载电容(C
LD
) = 25 PF最大
文档# 96002
12/2/96
数据延迟设备, INC 。
3山。展望大道。克利夫顿,新泽西州07013
3
3D7304
硅延迟线自动化测试
测试条件
输入:
环境温度:
25
o
C
±
3
o
C
电源电压(VCC ) :
5.0V
±
0.1V
输入脉冲:
高= 3.0V
±
0.1V
低= 0.0V
±
0.1V
源阻抗:
50Ω最大。
上升/下降时间:
3.0 ns(最大值) 。 (测
0.6V和2.4V之间)
脉冲宽度:
PW
IN
= 1.25×总延时
期限:
IN
= 2.5×总延时
输出:
R
负载
:
C
负载
:
门槛:
10K
±
10%
5pf
±
10%
1.5V (瑞星&下降)
设备
TEST
10K
数字
范围
5pf
470
注意:
上述条件是仅用于测试,并且不以任何方式限制该装置的操作。
电脑
系统
打印机
REF
脉冲
发电机
OUT
TRIG
IN1
设备下
IN2
被测件(DUT )
IN3
IN4
OUT1
OUT2
OUT3
OUT4
IN
TRIG
数字示波器/
时间间隔计数器
图2 :测试设置
IN
PW
IN
t
上升
输入
信号
2.4V
1.5V
0.6V
t
秋天
V
IH
2.4V
1.5V
0.6V
V
IL
t
PHL
t
PLH
产量
信号
V
OH
1.5V
1.5V
V
OL
图3 :时序图
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数据延迟设备, INC 。
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传真: 973-773-9672
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    联系人:Sante Zhang/Mollie
    地址:總部地址:UNIT D18 3/FWONG KING INDUSTRIAL BUILDINGNO.2-4 TAI YAU STREETKL
    深圳地址:深圳市龍崗區坂田街道永香路創匯

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