74LS112和74LS175简介及逻辑功能测试
发布时间:2012/2/6 20:40:00 访问次数:25934
74LS112集成块EC1200SJTS-33.333MHZ
74 LS112集成块是一双下降沿J-K触发器。其逻辑符号和外引线排列如图2.8.1(a)和
741,S112的逻辑功能如表2.8.3所列。
表2.8.3 74LS112功能表
┏━━━━┳━━━━━━━━━━━━━━━━━━━━━━━━━┳━━━━━━━━━━━┓
┃ 功能 ┃ 输入 ┃ 输出 ┃
┣━━━━╋━━━━━┳━━━━┳━━━━┳━━━━┳━━━━╋━━━━━┳━━━━━┫
┃ ┃ 1 SD ┃ 1RD ┃ 1C ┃ 1J ┃ 1K ┃ io。+1 ┃ 1Q。+l ┃
┣━━━━╋━━━━━╋━━━━╋━━━━╋━━━━╋━━━━╋━━━━━╋━━━━━┫
┃ 复位 ┃ 1 ┃ O ┃ × ┃ × ┃ × ┃ O ┃ 1 ┃
┣━━━━╋━━━━━╋━━━━╋━━━━╋━━━━╋━━━━╋━━━━━╋━━━━━┫
┃ 置位 ┃ O ┃ 1 ┃ × ┃ × ┃ × ┃ 1 ┃ 0 ┃
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┃ 记1 ┃ 1 ┃ 1 ┃ + ┃ 1 ┃ O ┃ 1 ┃ O ┃
┣━━━━╋━━━━━╋━━━━╋━━━━╋━━━━╋━━━━╋━━━━━╋━━━━━┫
┃ 记O ┃ 1 ┃ 1 ┃ + ┃ O ┃ 1 ┃ O ┃ 1 ┃
┣━━━━╋━━━━━╋━━━━╋━━━━╋━━━━╋━━━━╋━━━━━╋━━━━━┫
┃ 计数 ┃ 1 ┃ 1 ┃ 0 ┃ 1 ┃ 1 ┃ 1Q。 ┃ 1Qn ┃
┣━━━━╋━━━━━╋━━━━╋━━━━╋━━━━╋━━━━╋━━━━━╋━━━━━┫
┃保持 ┃ 1 ┃ 1 ┃ 0 ┃ O ┃ O ┃ 1Qn ┃ 1Q。 ┃
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在图2.8.1中,1C,2C为时钟输入端;1J,1K,2J,2K为数据输入端;1Q,io,2Q,2Q为输出端;1R。,2R。为直接复位端(低电平有效);1SD.2SD为直接置位端(低电平有效)。
2. 74LS112的逻辑功能测试
(1)连接测试电路:首先将J-K触发器7415112第16脚连往“+5 V”,8脚与“地”相连,再按图2.8.2连接测试电路。1J,1K,1S.,和1RD分别接“高、低电平发生器”;1C接“单次脉冲”信号;io,io分别接“高低电平指示器”。
(2) 1SD和1RD功能测试:按表2.8.4要求改变1SD和1RD的状态。并在1SD =0,1RD =1或1SD =1,1RD一0时任意改变1J,1K,1C的状态,观察Li和L2灯亮情况。将1Q和1Q状态记录在该表中。
表2.8.4 74LS112的SD和RD功能测试
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┃ 1SD ┃ 1RD ┃ io ┃ 1Q ┃功能 ┃
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┃ 1 ┃ O ┃ ┃ ┃ ┃
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┃ O ┃ 1 ┃ ┃ ┃ ┃
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┃ 1 ┃ 1 ┃ ┃ ┃ ┃
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(3) 1J,1K逻辑功能测试:令1RD =1,SD =1,按表2.8.5要求输入1J,1K和C,记录测试结果。表中触发器的初始状态1Q。可由1SD,1RD的逻辑开关控制。
表2.8.5 74LS112的J.K逻辑功能测试
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┃ ┃ ┃ ┃ iQn+i ┃ ┃
┃ 1J ┃ 1K ┃ 1C ┃ ┃ 功能 ┃
┃ ┃ ┃ ┣━━━━━┳━━━━━┫ ┃
┃ ┃ ┃ ┃ 1Q。-o ┃ lQn =1 ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ O ┃ O ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1—’0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O--l ┃ ┃ ┃ ┃
┃ 0 ┃ 1 ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1--0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ 1 ┃ O ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1-}O ┃ ┃ ┃ ┃
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┃ ┃ ┃ O --1 ┃ ┃ ┃ ┃
┃ 1 ┃ 1 ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1 -*0 ┃ ┃ ┃ ┃
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74LS112集成块EC1200SJTS-33.333MHZ
74 LS112集成块是一双下降沿J-K触发器。其逻辑符号和外引线排列如图2.8.1(a)和
741,S112的逻辑功能如表2.8.3所列。
表2.8.3 74LS112功能表
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┃ 功能 ┃ 输入 ┃ 输出 ┃
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┃ ┃ 1 SD ┃ 1RD ┃ 1C ┃ 1J ┃ 1K ┃ io。+1 ┃ 1Q。+l ┃
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┃ 复位 ┃ 1 ┃ O ┃ × ┃ × ┃ × ┃ O ┃ 1 ┃
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┃ 置位 ┃ O ┃ 1 ┃ × ┃ × ┃ × ┃ 1 ┃ 0 ┃
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┃ 记1 ┃ 1 ┃ 1 ┃ + ┃ 1 ┃ O ┃ 1 ┃ O ┃
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┃ 记O ┃ 1 ┃ 1 ┃ + ┃ O ┃ 1 ┃ O ┃ 1 ┃
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┃ 计数 ┃ 1 ┃ 1 ┃ 0 ┃ 1 ┃ 1 ┃ 1Q。 ┃ 1Qn ┃
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┃保持 ┃ 1 ┃ 1 ┃ 0 ┃ O ┃ O ┃ 1Qn ┃ 1Q。 ┃
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在图2.8.1中,1C,2C为时钟输入端;1J,1K,2J,2K为数据输入端;1Q,io,2Q,2Q为输出端;1R。,2R。为直接复位端(低电平有效);1SD.2SD为直接置位端(低电平有效)。
2. 74LS112的逻辑功能测试
(1)连接测试电路:首先将J-K触发器7415112第16脚连往“+5 V”,8脚与“地”相连,再按图2.8.2连接测试电路。1J,1K,1S.,和1RD分别接“高、低电平发生器”;1C接“单次脉冲”信号;io,io分别接“高低电平指示器”。
(2) 1SD和1RD功能测试:按表2.8.4要求改变1SD和1RD的状态。并在1SD =0,1RD =1或1SD =1,1RD一0时任意改变1J,1K,1C的状态,观察Li和L2灯亮情况。将1Q和1Q状态记录在该表中。
表2.8.4 74LS112的SD和RD功能测试
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┃ 1SD ┃ 1RD ┃ io ┃ 1Q ┃功能 ┃
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┃ 1 ┃ O ┃ ┃ ┃ ┃
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┃ O ┃ 1 ┃ ┃ ┃ ┃
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┃ 1 ┃ 1 ┃ ┃ ┃ ┃
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(3) 1J,1K逻辑功能测试:令1RD =1,SD =1,按表2.8.5要求输入1J,1K和C,记录测试结果。表中触发器的初始状态1Q。可由1SD,1RD的逻辑开关控制。
表2.8.5 74LS112的J.K逻辑功能测试
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┃ ┃ ┃ ┃ iQn+i ┃ ┃
┃ 1J ┃ 1K ┃ 1C ┃ ┃ 功能 ┃
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┃ ┃ ┃ ┃ 1Q。-o ┃ lQn =1 ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ O ┃ O ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1—’0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O--l ┃ ┃ ┃ ┃
┃ 0 ┃ 1 ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1--0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ 1 ┃ O ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1-}O ┃ ┃ ┃ ┃
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┃ ┃ ┃ O --1 ┃ ┃ ┃ ┃
┃ 1 ┃ 1 ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1 -*0 ┃ ┃ ┃ ┃
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