宽带电缆应用中宽带谐波失真的影响,传统窄带数字预失真在复杂基带处完成。在这些实例中，仅一次谐波产物在频带范围内，因此其基带产物直接转换为RF。考虑宽带电缆数字预失真时，较高阶次的谐波失真必须是频率偏移，才能使上变频后的基带产物正确位于实际RF频谱中。

一种数字预失真的实现。在理想情况下，从数字上变频器(DUC)（通过数字预失真）到DAC乃至通过功率倍增器的路径将没有带宽限制。同样地，观测路径上的ADC将对全带宽进行数字化。请注意，为了进行说明，我们扩展2倍带宽的信号路径；在某些无线蜂窝应用中，可扩展到3至5倍的带宽。理想方案是通过数字预失真产生带内项和带外项，从而完全消除功率放大器引入的失真。

为了准确消除失真，需要在目标信号的带宽之外创建项，这一点非常重要。在实际方案中，信号路径具有带宽限制和倾斜特性，数字预失真性能无法达到理想方案要求.

一个完全实时、闭环、自适应电缆数字预失真解决方案，由FPGA结构中的执行器和嵌入式处理器中基于软件的自适应机制组成。该实现方案使用Intel® Arria® 10 660 FPGA和嵌入式ARM® Cortex®处理器。DPD IP内核和ARM的功耗为5.3 W，尽管使用更新一代的FPGA或转换为ASIC，此功率仍应低于3 W。

宽带数字预失真复杂基带处理中的频率偏移要求。

传统窄带数字预失真在复杂基带处完成

宽带电缆数字预失真、OOB HD必须是频率偏移以允许RF上变频

无带宽限制的理想化数字预失真方案,显示ADCA3992在76.8 dBmV总复合电源、34 V电源电压、400 mA偏置电流（13.6 W直流电源）下工作的测试结果。

与530 mA标称非数字预失真功率倍增器电流相比，直流电源节省4.4 W，那么，4端口系统节省的总功率为17.6 W减5.3 W FPGA电源，得到12.3 W。对于72 W至59.7 W的4端口系统，功耗（散热）显著降低。每个倍增器的偏置电流很可能进一步回退至350 mA (11.9 W)，同时仍达到41 dB的MER目标值，从而系统净节省19.2 W。

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