ad9914bcpz 上拉电阻、下拉电阻和弱保持电路
发布时间:2020/1/16 17:37:46 访问次数:1121
ad9914bcpz简化的IOB原理框图作,其最短延迟时间为零,3个触发器均可编程配置为边沿触发或电平触发方式,它们共用一个时钟信号CLK,但有各自的时钟使能控制信号。通过它们可以实现同步输入/输出。输入、输出缓冲器和IOB中所有的信号,均有独立的极性控制电路(图7.4.8中未画出),可以控制信号是否反相,使能信号是高有效还是低有效,触发器是上升沿触发还是下降沿触发等。
图7.4.8中两个钳位二极管具有瞬时过压保护和静电保护作用。上拉电阻、下拉电阻和弱保持电路(Weak keeper Circuit)可通过编程配置给I/o引脚。弱保持电路监视并跟踪1/0引脚输入电压的变化,当连至引脚总线上所有的驱动信号全部无效时,弱保持电路将维持在引脚最后一个状态的逻辑电平上,可以避免总线处于悬浮状态,消除总线抖动。
为使FPGA能在不同电源系统中正常工作,IOB中设计了两个电压输入端Vcc。和ⅤRm(它们由多个IOB共用)。VRⅢ为逻辑电平的参考电压,在执行某些I/0标准时,需要输人ⅤREF①。大约每6个I/o有一个VREF引脚。在此基础上,为了增强FPGA的适应性和灵活性,将若干个IOB组织在一起,构成一个组(Bank),如图7.4,9所示。一般FPGA的I/o划分为8个详见厂商数据手册,存储器、复杂可编程器件和明场可编程门阵列.
0FF可编程输出缓冲进位到相邻的GRM,到相邻的GRM,每个开关矩阵中的6路开关管,图7.4.11 GRM的结构.
I/0布线资源,在CLB阵列与10B接口的外围,有附加的布线资源,称为万能环(Ⅴer~saRing)。通过对这些布线资源的编程,可以方便地实现引脚的交换和锁定。使引脚位置的变动与内部逻辑无关。
专用布线资源,除了以上布线资源,FPGA中还包含具有特殊用途的横向片内三态总线和纵向进位链(如图7,4.10)的专用布线资源。
存储器、复杂可编程器件,和现场可编程闸,到相邻的GRM进位链(专线).
深圳市唯有度科技有限公司http://wydkj.51dzw.com/
ad9914bcpz简化的IOB原理框图作,其最短延迟时间为零,3个触发器均可编程配置为边沿触发或电平触发方式,它们共用一个时钟信号CLK,但有各自的时钟使能控制信号。通过它们可以实现同步输入/输出。输入、输出缓冲器和IOB中所有的信号,均有独立的极性控制电路(图7.4.8中未画出),可以控制信号是否反相,使能信号是高有效还是低有效,触发器是上升沿触发还是下降沿触发等。
图7.4.8中两个钳位二极管具有瞬时过压保护和静电保护作用。上拉电阻、下拉电阻和弱保持电路(Weak keeper Circuit)可通过编程配置给I/o引脚。弱保持电路监视并跟踪1/0引脚输入电压的变化,当连至引脚总线上所有的驱动信号全部无效时,弱保持电路将维持在引脚最后一个状态的逻辑电平上,可以避免总线处于悬浮状态,消除总线抖动。
为使FPGA能在不同电源系统中正常工作,IOB中设计了两个电压输入端Vcc。和ⅤRm(它们由多个IOB共用)。VRⅢ为逻辑电平的参考电压,在执行某些I/0标准时,需要输人ⅤREF①。大约每6个I/o有一个VREF引脚。在此基础上,为了增强FPGA的适应性和灵活性,将若干个IOB组织在一起,构成一个组(Bank),如图7.4,9所示。一般FPGA的I/o划分为8个详见厂商数据手册,存储器、复杂可编程器件和明场可编程门阵列.
0FF可编程输出缓冲进位到相邻的GRM,到相邻的GRM,每个开关矩阵中的6路开关管,图7.4.11 GRM的结构.
I/0布线资源,在CLB阵列与10B接口的外围,有附加的布线资源,称为万能环(Ⅴer~saRing)。通过对这些布线资源的编程,可以方便地实现引脚的交换和锁定。使引脚位置的变动与内部逻辑无关。
专用布线资源,除了以上布线资源,FPGA中还包含具有特殊用途的横向片内三态总线和纵向进位链(如图7,4.10)的专用布线资源。
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