TT41NGRA1同步十进制加计数器
发布时间:2019/10/17 20:46:23 访问次数:1227
TT41NGRA1随着电源+vcc通过电阻R对电容C充电,使C两端电压复位电路逐渐升高,经过一段时间之后,REsEr手动复位电路上电自动复位电路信号才跨越逻辑阈值转变为高电平,使系统脱离复位状态而进入正常工作状态。设计了复位电路的时序电路则不必考虑自启动问题。
需要说明的是,上述步骤是设计同步时序电路的一般化过程,实际设计中并不是每一步都要执行,可根据具体情况简化或省略一些步骤,这通过6.3.2节的设计实例可以看出。
电路设计,例6,3,1 用D触发器设计一个8421 BCD码同步十进制加计数器。
解:计数器实际上是对时钟脉冲进行计数,每来一个时钟脉冲,计数器状态改变一次。8421 BCD码十进制加计数器在每个时钟脉冲作用下,触发器输出编码值加1,编码顺序与8421 BCD码一致,每十个时钟脉冲完成一个计数周期。由于电路的状态数、状态转换关系及状态编码等都是明确的,因此设计过程较简单,没有必要拘泥于6,3.1节所述的设计步骤。
列出状态表,十进制计数器共有10个状态,需要4个D触发器构成,其状态表如表
6,3.1所示。
表6.3.1 8421 BCD码同步十进制加计数器的状态表
确定激励方程组
按表6.3.1可画出各触发器激励信号的卡诺图,如图6.3.3所示。
4个触发器可组合16个状态(0000~1111),其中有6个状态(1010~1111)在8421 BCD码十进制计数器中是无效状态,在图6.3.3所示的卡诺图中以无关项×表示。于是,得到激励方程组(在本例中同时得到状态方程组)
TT41NGRA1随着电源+vcc通过电阻R对电容C充电,使C两端电压复位电路逐渐升高,经过一段时间之后,REsEr手动复位电路上电自动复位电路信号才跨越逻辑阈值转变为高电平,使系统脱离复位状态而进入正常工作状态。设计了复位电路的时序电路则不必考虑自启动问题。
需要说明的是,上述步骤是设计同步时序电路的一般化过程,实际设计中并不是每一步都要执行,可根据具体情况简化或省略一些步骤,这通过6.3.2节的设计实例可以看出。
电路设计,例6,3,1 用D触发器设计一个8421 BCD码同步十进制加计数器。
解:计数器实际上是对时钟脉冲进行计数,每来一个时钟脉冲,计数器状态改变一次。8421 BCD码十进制加计数器在每个时钟脉冲作用下,触发器输出编码值加1,编码顺序与8421 BCD码一致,每十个时钟脉冲完成一个计数周期。由于电路的状态数、状态转换关系及状态编码等都是明确的,因此设计过程较简单,没有必要拘泥于6,3.1节所述的设计步骤。
列出状态表,十进制计数器共有10个状态,需要4个D触发器构成,其状态表如表
6,3.1所示。
表6.3.1 8421 BCD码同步十进制加计数器的状态表
确定激励方程组
按表6.3.1可画出各触发器激励信号的卡诺图,如图6.3.3所示。
4个触发器可组合16个状态(0000~1111),其中有6个状态(1010~1111)在8421 BCD码十进制计数器中是无效状态,在图6.3.3所示的卡诺图中以无关项×表示。于是,得到激励方程组(在本例中同时得到状态方程组)
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