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LT1328BCS8用或非门构成基本

发布时间:2019/10/14 17:55:19 访问次数:1571

LT1328BCS8为什么图5,1.2所示的电路能长期保持状态不变?

从模拟分析的角度看,图5.1.2所示的电路构成正反馈环路,为什么它不会产生自激振荡?

锁存器和触发器①是构成各种时序电路的存储单元电路,其共同特点是都具有0和1两种稳定状态,一旦状态被确定,就能自行保持,即长期存储1位二进制码,直到有外部信号作用时才有可能改变。锁存器是一种对脉冲电平敏感的存储单元电路,它们可以在特定输入脉冲电平作用下改变状态。而由不同锁存器构成的触发器则是一种对脉冲边沿敏感的存储电路,它们只有在作为触发信号的时钟脉冲上升沿或下降沿的变化瞬间才能改变状态。

SR锁存器,基本SR锁存器,将图5.1.2中双稳态电路的非门替换为或非门,则构成图5.2,1(a)所示的基本SR锁存器①。它是―种具有简单功能的双稳态存储电路,图5.2,1(b)所示为其逻辑符号。电路有两个输人端,其中s端称为置位(1)端,R端称为复位端或清零(0)端。按照逻辑图,可以列出输出端Q和口的逻辑表达式

Q=R+0           (5.2.1)

Q=s+O           (5.2.2)

根据以上两式,可得基本sR锁存器的功能表,如表5.2.1所示。

用或非门构成基本,SR锁存器的功能表,用或非门构成基本sR锁存器(a)逻辑图 (b)国标逻辑符号.

当s=R=0时,对应表5.2.1的第1行。根据式(5.2.1)和式(5.2.2),这两个输入信号对两或非门的输出o和回不起作用,电路状态保持不变,功能与图5.1.2的双稳态电路相同,可存储1位二进制数据。


表5.2.1的第2、3行分别为锁存器的置0和置1操作。在Q=0,R=0的条件下 ,当s端出现逻辑1电平时 ,Q端输出电压下降 ,一旦跨越介稳态点,电路便迅速转换为Q=1状态。若原来状态为Q=1,则s端出现的1电平不改变其状态。电路是对称的 ,置0操作将使锁存器置为Q=0。


当s=R=1时 ,对应表5.2.1中的第4行 。根据上述两式 ,Q=Q=0,锁存器处在既非1,又非0的不确定状态。若s和R同时回到0,则无法预先确定锁存器将回到1状态还是0状态。因此,在正常工作时,输人信号应遵守本教材以前几版将锁存器也称为触发器,实际上二者是有差别的,在5.3节还将就此作进一步的讨论.




LT1328BCS8为什么图5,1.2所示的电路能长期保持状态不变?

从模拟分析的角度看,图5.1.2所示的电路构成正反馈环路,为什么它不会产生自激振荡?

锁存器和触发器①是构成各种时序电路的存储单元电路,其共同特点是都具有0和1两种稳定状态,一旦状态被确定,就能自行保持,即长期存储1位二进制码,直到有外部信号作用时才有可能改变。锁存器是一种对脉冲电平敏感的存储单元电路,它们可以在特定输入脉冲电平作用下改变状态。而由不同锁存器构成的触发器则是一种对脉冲边沿敏感的存储电路,它们只有在作为触发信号的时钟脉冲上升沿或下降沿的变化瞬间才能改变状态。

SR锁存器,基本SR锁存器,将图5.1.2中双稳态电路的非门替换为或非门,则构成图5.2,1(a)所示的基本SR锁存器①。它是―种具有简单功能的双稳态存储电路,图5.2,1(b)所示为其逻辑符号。电路有两个输人端,其中s端称为置位(1)端,R端称为复位端或清零(0)端。按照逻辑图,可以列出输出端Q和口的逻辑表达式

Q=R+0           (5.2.1)

Q=s+O           (5.2.2)

根据以上两式,可得基本sR锁存器的功能表,如表5.2.1所示。

用或非门构成基本,SR锁存器的功能表,用或非门构成基本sR锁存器(a)逻辑图 (b)国标逻辑符号.

当s=R=0时,对应表5.2.1的第1行。根据式(5.2.1)和式(5.2.2),这两个输入信号对两或非门的输出o和回不起作用,电路状态保持不变,功能与图5.1.2的双稳态电路相同,可存储1位二进制数据。


表5.2.1的第2、3行分别为锁存器的置0和置1操作。在Q=0,R=0的条件下 ,当s端出现逻辑1电平时 ,Q端输出电压下降 ,一旦跨越介稳态点,电路便迅速转换为Q=1状态。若原来状态为Q=1,则s端出现的1电平不改变其状态。电路是对称的 ,置0操作将使锁存器置为Q=0。


当s=R=1时 ,对应表5.2.1中的第4行 。根据上述两式 ,Q=Q=0,锁存器处在既非1,又非0的不确定状态。若s和R同时回到0,则无法预先确定锁存器将回到1状态还是0状态。因此,在正常工作时,输人信号应遵守本教材以前几版将锁存器也称为触发器,实际上二者是有差别的,在5.3节还将就此作进一步的讨论.




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